[go: up one dir, main page]

WO2010046997A1 - 電子デバイスおよび製造方法 - Google Patents

電子デバイスおよび製造方法 Download PDF

Info

Publication number
WO2010046997A1
WO2010046997A1 PCT/JP2008/069374 JP2008069374W WO2010046997A1 WO 2010046997 A1 WO2010046997 A1 WO 2010046997A1 JP 2008069374 W JP2008069374 W JP 2008069374W WO 2010046997 A1 WO2010046997 A1 WO 2010046997A1
Authority
WO
WIPO (PCT)
Prior art keywords
floating electrode
signal processing
processing unit
electronic device
electron beam
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Ceased
Application number
PCT/JP2008/069374
Other languages
English (en)
French (fr)
Inventor
大輔 渡邊
俊幸 岡安
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Advantest Corp
Original Assignee
Advantest Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Advantest Corp filed Critical Advantest Corp
Priority to JP2010534647A priority Critical patent/JPWO2010046997A1/ja
Priority to PCT/JP2008/069374 priority patent/WO2010046997A1/ja
Priority to KR1020117003751A priority patent/KR20110042188A/ko
Priority to TW098135805A priority patent/TWI393345B/zh
Publication of WO2010046997A1 publication Critical patent/WO2010046997A1/ja
Priority to US13/027,977 priority patent/US8614465B2/en
Anticipated expiration legal-status Critical
Ceased legal-status Critical Current

Links

Images

Classifications

    • GPHYSICS
    • G01MEASURING; TESTING
    • G01RMEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R31/00Arrangements for testing electric properties; Arrangements for locating electric faults; Arrangements for electrical testing characterised by what is being tested not provided for elsewhere
    • G01R31/28Testing of electronic circuits, e.g. by signal tracer
    • G01R31/302Contactless testing
    • G01R31/305Contactless testing using electron beams
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D30/00Field-effect transistors [FET]
    • H10D30/60Insulated-gate field-effect transistors [IGFET]
    • H10D30/68Floating-gate IGFETs
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L22/00Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
    • H01L22/10Measuring as part of the manufacturing process
    • H01L22/14Measuring as part of the manufacturing process for electrical parameters, e.g. resistance, deep-levels, CV, diffusions by electrical means
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L22/00Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
    • H01L22/20Sequence of activities consisting of a plurality of measurements, corrections, marking or sorting steps
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K5/00Manipulating of pulses not covered by one of the other main groups of this subclass
    • H03K5/13Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D64/00Electrodes of devices having potential barriers
    • H10D64/01Manufacture or treatment
    • H10D64/031Manufacture or treatment of data-storage electrodes
    • H10D64/035Manufacture or treatment of data-storage electrodes comprising conductor-insulator-conductor-insulator-semiconductor structures

Definitions

  • the present invention relates to an electronic device and a manufacturing method.
  • An electronic device such as a semiconductor circuit has a circuit that performs predetermined signal processing on an input signal.
  • the electronic device includes a circuit that delays an input signal, a circuit that changes the amplitude of the input signal, and the like.
  • These signal processing circuits are formed to have predetermined characteristics (see, for example, Patent Document 1). Japanese Patent Laid-Open No. 2001-7660
  • the characteristics of these signal processing circuits may have an error with respect to the predetermined characteristics due to manufacturing variations of the signal processing circuits.
  • an error may occur in the characteristics of the signal processing circuit due to variations in impurity concentration, variations in etching, and the like that occur in the process of forming a semiconductor circuit.
  • an object of the present invention is to provide a signal processing circuit and a manufacturing method that can solve the above-described problems. This object is achieved by a combination of features described in the independent claims.
  • the dependent claims define further advantageous specific examples of the present invention.
  • an electronic device that generates an output signal corresponding to an input signal, the signal receiving the input signal and generating an output signal corresponding to the input signal
  • the signal processing unit includes an electronic device that corrects the electrical characteristics of the output signal in accordance with the amount of charge accumulated in the floating electrode.
  • a method of manufacturing an electronic device that generates an output signal in accordance with an input signal, wherein a floating electrode that accumulates charges when irradiated with an electron beam is formed, the input signal is received, and an input is received
  • a signal processing unit that generates an output signal according to the signal and corrects the electrical characteristics of the output signal according to the amount of charge accumulated in the floating electrode is tested, and the operation of the signal processing unit is tested to perform signal processing.
  • a manufacturing method for irradiating an electron beam to a floating electrode according to a test result of a part is provided.
  • FIG. 6 is a diagram illustrating another configuration example of the electronic device 100.
  • FIG. 6 is a diagram illustrating another configuration example of the electronic device 100.
  • 3 is a flowchart illustrating an example of a method for manufacturing the electronic device 100.
  • 10 is a flowchart illustrating another example of the manufacturing method of the electronic device 100.
  • FIG. 3 is a diagram illustrating a structural example of a switch 16.
  • FIG. 6 is a diagram illustrating another example of the structure of the switch 16.
  • 3 is a diagram illustrating a structural example of a transistor 14.
  • DESCRIPTION OF SYMBOLS 10 ... Signal processing part, 12 ... Delay element, 14 ... Transistor, 16 ... Switch, 18 ... Transmission line, 20 ... Adjustment part, 30 ... Floating electrode, 40. ..Semiconductor substrate 42... Insulating film 44... Gate electrode 46. Insulating film 100... Electronic device 111... Source region 113. -Isolation region, 121 ... insulating film, 122 ... insulating film, 123 ... insulating film, 151 ... via hole, 161 ... pattern wiring, 162 ... pattern wiring, 171 ... guard Ring, 191 ... through hole
  • FIG. 1 is a diagram illustrating a configuration example of an electronic device 100 according to an embodiment.
  • the electronic device 100 generates an output signal obtained by performing predetermined signal processing on the input signal.
  • the electronic device 100 of this example includes a signal processing unit 10, an adjustment unit 20, and a floating electrode 30.
  • the electronic device 100 may be a semiconductor circuit formed on a semiconductor substrate.
  • the signal processing unit 10 receives an input signal and generates an output signal obtained by performing predetermined signal processing on the input signal.
  • the signal processing unit 10 may be a delay circuit having a plurality of delay elements 12 connected in cascade as shown in FIG.
  • the signal processing unit 10 of this example generates an output signal obtained by delaying the input signal by a predetermined delay amount.
  • the delay amount in the signal processing unit 10 varies depending on the bias voltage applied to the delay element 12.
  • the floating electrode 30 accumulates charges when irradiated with an electron beam. For example, the floating electrode 30 accumulates a charge amount according to the current density of the electron beam and the irradiation time of the electron beam.
  • the adjustment unit 20 corrects the electrical characteristics of the output signal output from the signal processing unit 10 according to the amount of charge accumulated in the floating electrode 30.
  • the adjustment unit 20 of this example corrects the delay amount in the signal processing unit 10 by adjusting the bias voltage applied to the delay element 12 according to the amount of charge accumulated in the floating electrode 30.
  • the adjustment unit 20 may receive an analog voltage corresponding to the amount of charge accumulated in the floating electrode 30 and adjust the bias voltage applied to the delay element 12 based on the analog voltage.
  • the adjustment unit 20 may receive a digital value corresponding to the amount of charge accumulated in the floating electrode 30 and adjust the bias voltage applied to the delay element 12 based on the digital value.
  • the floating electrode 30 may generate a binary digital value indicating whether or not an electron beam has been irradiated.
  • the electronic device 100 may include a plurality of floating electrodes 30 for one signal processing unit 10 in order to generate a multi-bit digital value.
  • the floating electrode 30 may be provided for each signal processing unit 10.
  • a plurality of floating electrodes 30 may be provided for one adjusting unit 20.
  • the floating electrode 30 is irradiated with an electron beam so that the electrical characteristics of the output signal output from the signal processing unit 10 have predetermined characteristics.
  • an external device may measure the electrical characteristics of the output signal.
  • an external electron beam irradiation apparatus may irradiate the floating electrode 30 with an electron beam based on the said electrical property.
  • the floating electrode 30 is insulated from the ground potential, wiring, electrodes, and other electronic components in order to maintain the amount of charge by the irradiated electron beam.
  • the floating electrode 30 is formed so as to be capable of being irradiated with an electron beam.
  • a via hole that is irradiated with an electron beam may be formed in the insulating film that covers the floating electrode 30.
  • the floating electrode 30 may be formed so that it can be irradiated with an electron beam at least in a part of the manufacturing stage.
  • the electrical characteristics of the signal processing unit 10 may be measured during the manufacture of the electronic device 100 and the floating electrode 30 may be irradiated with an electron beam.
  • the floating electrode 30 may not be capable of being irradiated with an electron beam.
  • FIG. 2 is a diagram illustrating another configuration example of the electronic device 100.
  • the floating electrode 30 is formed inside the signal processing unit 10.
  • the floating electrode 30 may be provided in the transistor 14 formed inside the signal processing unit 10.
  • the electronic device 100 may not include the adjustment unit 20 separately.
  • the transistor 14 may be an FET formed on the semiconductor substrate between the input terminal and the output terminal in the signal processing unit 10.
  • the floating electrode 30 is formed between the gate electrode of the transistor 14 and the semiconductor substrate. The threshold voltage of the transistor 14 varies depending on the amount of charge accumulated in the floating electrode 30.
  • the electrical characteristics in the signal processing unit 10 can be adjusted by adjusting the amount of charge accumulated in the floating electrode 30.
  • the floating electrode 30 may be irradiated with an electron beam according to the measurement result of the output signal.
  • FIG. 3 is a diagram illustrating another configuration example of the electronic device 100.
  • the floating electrode 30 is formed inside the signal processing unit 10.
  • the electronic device 100 of this example includes a plurality of transmission lines 18 and a plurality of switches 16.
  • the plurality of transmission lines 18 have different electrical characteristics and transmit input signals in parallel.
  • the plurality of switches 16 are provided corresponding to the plurality of transmission lines 18. Each switch 16 is formed with a floating electrode 30, and switches whether to transmit an input signal to the corresponding transmission line 18 according to the amount of charge applied to the floating electrode 30.
  • the characteristics of the signal processing unit 10 can be adjusted by selecting which floating electrode 30 is irradiated with the electron beam. If the characteristics of the signal processing unit 10 are to be changed, the predetermined floating electrode 30 may be irradiated with an electron beam after erasing the charge by irradiating the floating electrode 30 in which the charge is accumulated with ultraviolet rays.
  • FIG. 4 is a flowchart showing an example of a method for manufacturing the electronic device 100.
  • the signal processing unit 10 and the floating electrode 30 are formed on a semiconductor substrate (S200).
  • the electrical characteristics of the signal processing unit 10 are measured (S202).
  • the signal processing unit 10 receives the input signal, generates an output signal corresponding to the input signal, and corrects the electrical characteristics of the output signal according to the amount of charge accumulated in the floating electrode 30.
  • the floating electrode 30 corresponding to the electrical characteristic is irradiated with an electron beam with an irradiation amount corresponding to the measurement result ( S204). Then, another structure of the electronic device 100 is formed and the electronic device 100 is packaged (S206). By such processing, the electronic device 100 whose characteristics have been adjusted in advance can be manufactured.
  • FIG. 5 is a flowchart illustrating another example of the manufacturing method of the electronic device 100.
  • the signal processing unit 10 and the floating electrode 30 are formed on a semiconductor substrate (S200).
  • the electrical characteristics of the signal processing unit 10 are measured (S202).
  • the floating electrode 30 corresponding to the operation is irradiated with an electron beam with an irradiation amount according to the measurement result (S204). Thereby, the characteristics of the signal processing unit 10 are corrected.
  • the operation of the signal processing unit 10 is measured again (S208). Then, it is determined whether or not the operation of the signal processing unit 10 satisfies a predetermined specification (S210). At this time, in S210, the quality of the operation may be determined for each predetermined region of the signal processing unit 10. If it is determined that the operation of all areas of the signal processing unit 10 is normal, the electronic device 100 is packaged (S206), and the process is terminated.
  • the entire surface of the electronic device 100 or the signal processing unit 10 is irradiated with ultraviolet rays (S212). Thereby, the electric charge accumulated in each floating electrode 30 is removed. And the process from S204 is repeated and each floating electrode 30 is again irradiated with an electron beam.
  • the region of the signal processing unit 10 determined to be normal in the processing in S210 is irradiated with an electron beam with the same setting as the previous time.
  • the region of the signal processing unit 10 determined to be defective is irradiated with an electron beam by changing the electron beam irradiation location, irradiation time, current amount, and the like. By repeating such processing, each region of the signal processing unit 10 can be irradiated with an electron beam under appropriate irradiation conditions.
  • FIG. 6 is a diagram illustrating an example of the structure of the switch 16.
  • the switch 16 may be an FET having the floating electrode 30 as a gate electrode.
  • the switch 16 is provided in a region partitioned by a plurality of isolation regions 115 formed of an insulating material such as silicon dioxide on a semiconductor substrate, and includes a source region 111, a drain region 113, a floating electrode 30, a via hole 151, and A guard ring 171 is included.
  • the source region 111 and the drain region 113 are formed apart from each other in the surface layer portion of the semiconductor substrate.
  • the source region 111 and the drain region 113 may be formed, for example, by implanting phosphorus ions from a top surface of a single crystal silicon semiconductor substrate to a predetermined depth.
  • the semiconductor region may be a P-type substrate, while the source region 111 and the drain region 113 may be N-type regions.
  • the floating electrode 30 is provided to face the source region 111 and the drain region 113 with an insulating film 121 formed by laminating an insulating material such as silicon dioxide on a semiconductor substrate.
  • the floating electrode 30 may be provided between the source region 111 and the drain region 113 in the surface direction of the semiconductor substrate.
  • the via hole 151 is formed of a conductive material and is provided so as to penetrate from the surface of the insulating film 123 to the floating electrode 30.
  • an insulating film 122 and an insulating film 123 in which an insulating material is laminated are formed on the floating electrode 30, and the via hole 151 is provided through the insulating films 122 and 123, and one end thereof Is exposed on the surface of the insulating film 123.
  • the pattern wiring 161 and the pattern wiring 162 are provided between the insulating film 122 and the insulating film 123.
  • the pattern wiring 161 electrically connects the source terminal provided on the semiconductor substrate and the source region 111.
  • the pattern wiring 162 electrically connects the drain terminal and the drain region 113.
  • the source terminal may be connected to the transmission line 18, for example.
  • the guard ring 171 is formed of, for example, a conductive metal material, and is provided so as to surround the via hole 151 on the surface of the insulating film 123.
  • the guard ring 171 may be electrically connected to the reference potential.
  • the guard ring 171 is not limited to the form formed in the annular
  • the via hole 151 when the via hole 151 is irradiated with an electron beam, a part of the electrons contained in the irradiated electron beam may be scattered around the via hole 151.
  • the conductive guard ring 171 is provided around the via hole 151 as described above, the scattered electrons are trapped by the guard ring 171. Therefore, in the switch 16, the scattered electrons are taken into the insulating film 123, for example, so that electric charges can be prevented from being accumulated in the insulating film 123 over time.
  • FIG. 7 is a diagram illustrating another example of the structure of the switch 16.
  • the entire surface of the floating electrode 30 described with reference to FIG. 6 is covered with the insulating film 122.
  • the floating electrode 30 of this example has the insulating film 122 so that at least a part of the surface is exposed. It may be covered with.
  • the switch 16 of this example may have a through hole 191 instead of the via hole 151.
  • Other structures may be the same as the switch 16 described in connection with FIG.
  • the through hole 191 is formed through the insulating film 122 from the surface of the insulating film 122 to the floating electrode 30. Even in such a configuration, by irradiating the floating electrode 30 with an electron beam through the through hole 191, a charge amount corresponding to the irradiation amount is accumulated in the floating electrode 30.
  • the diameter of the through hole 191 is preferably larger than the diameter of the electron beam.
  • FIG. 8 is a diagram illustrating a structure example of the transistor 14.
  • the transistor 14 may be an FET formed on the semiconductor substrate 40.
  • the gate electrode 44 of the transistor 14 is formed on the surface of the semiconductor substrate 40 via the insulating film 42.
  • An insulating film 46 may also be formed on part of the surface of the gate electrode 44.
  • the floating electrode 30 is formed on the surface of the semiconductor substrate 40 on which the gate electrode 44 of the transistor 14 is formed, separated from the gate electrode 44 of the transistor 14 and along the gate electrode 44 of the transistor 14. As shown in FIG. 8, the floating electrode 30 may be formed away from the gate electrode 44 in a direction perpendicular to the channel direction of the transistor 14. The distance D between the gate electrode 44 and the floating electrode 30 in the vertical direction is preferably close enough to change the threshold voltage of the transistor 14 depending on the amount of charge in the floating electrode 30. A dielectric material may be provided between the floating electrode 30 and the gate electrode 44.
  • the floating electrode 30 may be formed on the insulating film 42. Note that the insulating film 46 may not be formed on the surface of the floating electrode 30. Further, similarly to the floating electrode 30 shown in FIG. 6 or 7, an insulating film 46 having a via hole 151 or a through hole 191 may be formed on the surface of the floating electrode 30. With such a configuration, the characteristics of the transistor 14 can be adjusted by easily irradiating the floating electrode 30 with an electron beam.

Landscapes

  • Engineering & Computer Science (AREA)
  • Manufacturing & Machinery (AREA)
  • Power Engineering (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Semiconductor Integrated Circuits (AREA)
  • Non-Volatile Memory (AREA)
  • Design And Manufacture Of Integrated Circuits (AREA)
  • Semiconductor Memories (AREA)
  • Testing Or Measuring Of Semiconductors Or The Like (AREA)
  • Junction Field-Effect Transistors (AREA)

Abstract

 入力信号に応じた出力信号を生成する電子デバイスであって、入力信号を受け取る入力端子および前記出力信号を出力する出力端子の間に、半導体基板上に形成されるトランジスタを有し、入力信号を受け取り、入力信号に応じた出力信号を生成する信号処理部と、トランジスタのゲート電極と、前記半導体基板との間に形成され、電子ビームが照射されることで電荷を蓄積するフローティング電極とを備え、信号処理部は、フローティング電極に蓄積された電荷量に応じて、出力信号の電気特性を補正する電子デバイスを提供する。

Description

電子デバイスおよび製造方法
 本発明は、電子デバイスおよび製造方法に関する。
 半導体回路等の電子デバイスは、入力信号に対して所定の信号処理を行う回路を有する。例えば、電子デバイスは入力信号を遅延させる回路、入力信号の振幅を変化させる回路等を有する。これらの信号処理回路は、所定の特性を有するように形成される(例えば、特許文献1参照)。
特開2001-7660号公報
 しかし、信号処理回路の製造バラツキにより、これらの信号処理回路の特性が、所定の特性に対して誤差を有する場合がある。例えば、半導体回路を形成するプロセスにおいて生じる、不純物濃度のバラツキ、エッチングのバラツキ等により信号処理回路の特性に誤差が生じてしまう場合がある。
 そこで本発明は、上記の課題を解決することのできる信号処理回路および製造方法を提供することを目的とする。この目的は請求の範囲における独立項に記載の特徴の組み合わせにより達成される。また従属項は本発明の更なる有利な具体例を規定する。
 上記課題を解決するために、本発明の第1の態様においては、入力信号に応じた出力信号を生成する電子デバイスであって、入力信号を受け取り、入力信号に応じた出力信号を生成する信号処理部と、電子ビームが照射されることで電荷を蓄積するフローティング電極とを備え、信号処理部は、フローティング電極に蓄積された電荷量に応じて、出力信号の電気特性を補正する電子デバイスを提供する。
 第2の態様においては、入力信号に応じた出力信号を生成する電子デバイスの製造方法であって、電子ビームが照射されることで電荷を蓄積するフローティング電極を形成し、入力信号を受け取り、入力信号に応じた出力信号を生成し、且つ、フローティング電極に蓄積された電荷量に応じて、出力信号の電気特性を補正する信号処理部を形成し、信号処理部の動作を試験し、信号処理部の試験結果に応じて、フローティング電極に電子ビームを照射する製造方法を提供する。
 なお、上記の発明の概要は、発明の必要な特徴の全てを列挙したものではなく、これらの特徴群のサブコンビネーションもまた、発明となりうる。
一つの実施形態に係る電子デバイス100の構成例を示す図である。 電子デバイス100の他の構成例を示す図である。 電子デバイス100の他の構成例を示す図である。 電子デバイス100の製造方法の一例を示すフローチャートである。 電子デバイス100の他の製造方法例を示すフローチャートである。 スイッチ16の構造例を示す図である。 スイッチ16の他の構造例を示す図である。 トランジスタ14の構造例を示す図である。
符号の説明
10・・・信号処理部、12・・・遅延素子、14・・・トランジスタ、16・・・スイッチ、18・・・伝送線路、20・・・調整部、30・・・フローティング電極、40・・・半導体基板、42・・・絶縁膜、44・・・ゲート電極、46・・・絶縁膜、100・・・電子デバイス、111・・・ソース領域、113・・・ドレイン領域、115・・・分離領域、121・・・絶縁膜、122・・・絶縁膜、123・・・絶縁膜、151・・・ビアホール、161・・・パターン配線、162・・・パターン配線、171・・・ガードリング、191・・・貫通孔
 以下、発明の実施の形態を通じて本発明を説明するが、以下の実施形態は請求の範囲にかかる発明を限定するものではない。また、実施形態の中で説明されている特徴の組み合わせの全てが発明の解決手段に必須であるとは限らない。
 図1は、一つの実施形態に係る電子デバイス100の構成例を示す図である。電子デバイス100は、入力信号に対して所定の信号処理を行った出力信号を生成する。本例の電子デバイス100は、信号処理部10、調整部20、および、フローティング電極30を備える。電子デバイス100は、半導体基板に形成される半導体回路であってよい。
 信号処理部10は、入力信号を受け取り、入力信号に対して所定の信号処理を行った出力信号を生成する。例えば信号処理部10は、図1に示すように、縦続接続された複数の遅延素子12を有する遅延回路であってよい。本例の信号処理部10は、入力信号を所定の遅延量で遅延させた出力信号を生成する。例えば信号処理部10における遅延量は、遅延素子12に与えられるバイアス電圧によって変化する。
 フローティング電極30は、電子ビームが照射されることで電荷を蓄積する。例えばフローティング電極30は、電子ビームの電流密度および電子ビームの照射時間に応じた電荷量を蓄積する。
 調整部20は、フローティング電極30に蓄積された電荷量に応じて、信号処理部10が出力する出力信号の電気特性を補正する。本例の調整部20は、フローティング電極30に蓄積された電荷量に応じて、遅延素子12に与えるバイアス電圧を調整することで、信号処理部10における遅延量を補正する。
 例えば調整部20は、フローティング電極30に蓄積された電荷量に応じたアナログ電圧を受け取り、当該アナログ電圧に基づいて、遅延素子12に与えるバイアス電圧を調整してよい。また、調整部20は、フローティング電極30に蓄積された電荷量に応じたデジタル値を受け取り、当該デジタル値に基づいて、遅延素子12に与えるバイアス電圧を調整してよい。
 例えばフローティング電極30は、電子ビームが照射されたか否かを示す2値のデジタル値を生成してよい。また、複数ビットのデジタル値を生成すべく、電子デバイス100は、一つの信号処理部10に対して、複数のフローティング電極30を有してよい。また、電子デバイス100が複数の信号処理部10を有する場合、フローティング電極30は、信号処理部10ごとに設けられてよい。また同様に、一つの調整部20に対して、複数のフローティング電極30を有してよい。
 フローティング電極30には、信号処理部10が出力する出力信号の電気特性が、所定の特性となるように、電子ビームが照射される。例えば外部の装置が、出力信号の電気特性を測定してよい。そして、外部の電子ビーム照射装置が、当該電気特性に基づいて、フローティング電極30に電子ビームを照射してよい。
 なお、フローティング電極30は、照射された電子ビームによる電荷量を保持すべく、接地電位、配線、電極、その他の電子部品から絶縁される。また、フローティング電極30は、電子ビームが照射可能に形成される。例えば、フローティング電極30を覆う絶縁膜には、電子ビームが照射されるビアホールが形成されてよい。
 また、フローティング電極30は、少なくとも製造段階の一部において、電子ビームが照射可能に形成されてもよい。この場合、電子デバイス100の製造中に信号処理部10の電気的特性を測定して、フローティング電極30に電子ビームを照射してよい。この場合は、製造が完了した電子デバイス100において、フローティング電極30は、電子ビームが照射可能でなくともよい。以上のような構成により、信号処理部10における電気的特性を、所定の特性に補正することができる。
 図2は、電子デバイス100の他の構成例を示す図である。本例の電子デバイス100は、信号処理部10の内部にフローティング電極30が形成される。例えばフローティング電極30は、信号処理部10の内部に形成されるトランジスタ14に設けられてよい。この場合、電子デバイス100は、調整部20を別途備えなくともよい。
 トランジスタ14は、信号処理部10における入力端子および出力端子の間において、半導体基板上に形成されるFETであってよい。フローティング電極30は、トランジスタ14のゲート電極と、半導体基板との間に形成される。トランジスタ14の閾値電圧は、フローティング電極30に蓄積された電荷量によって変化する。
 このため、フローティング電極30が蓄積する電荷量を調整することで、信号処理部10における電気的特性を調整することができる。図1に関連して説明した場合と同様に、フローティング電極30には、出力信号の測定結果に応じて電子ビームが照射されてよい。
 図3は、電子デバイス100の他の構成例を示す図である。本例の電子デバイス100は、信号処理部10の内部にフローティング電極30が形成される。本例の電子デバイス100は、複数の伝送線路18および複数のスイッチ16を備える。
 複数の伝送線路18は、それぞれ異なる電気的特性を有して、入力信号を並列に伝送する。複数のスイッチ16は、複数の伝送線路18に対応して設けられる。それぞれのスイッチ16には、フローティング電極30が形成され、フローティング電極30に与えられる電荷量に応じて、対応する伝送線路18に入力信号を伝送させるか否かを切り替える。
 このような構成において、いずれのフローティング電極30に電子ビームを照射するかを選択することで、信号処理部10の特性を調整することができる。なお、信号処理部10の特性を変更したい場合、電荷が蓄積されているフローティング電極30に紫外線を照射して電荷を消去してから、所定のフローティング電極30に電子ビームを照射してよい。
 図4は、電子デバイス100の製造方法の一例を示すフローチャートである。まず、信号処理部10およびフローティング電極30を、半導体基板に形成する(S200)。次に、信号処理部10の電気的特性を測定する(S202)。信号処理部10は、入力信号を受け取り、入力信号に応じた出力信号を生成し、且つ、フローティング電極30に蓄積された電荷量に応じて、出力信号の電気特性を補正する。
 信号処理部10の電気的特性が、所定の特性に対して誤差を有している場合、当該電気的特性に対応するフローティング電極30に、測定結果に応じた照射量で電子ビームを照射する(S204)。そして、電子デバイス100の他の構造を形成して、電子デバイス100をパッケージする(S206)。このような処理により、特性を予め調整した電子デバイス100を製造することができる。なお、電子デバイス100を製造する工程に、紫外線を用いる工程がある場合、電子ビームを照射するステップは、紫外線を用いる工程のあとに行うことが好ましい。
 図5は、電子デバイス100の他の製造方法例を示すフローチャートである。まず、信号処理部10およびフローティング電極30を、半導体基板に形成する(S200)。次に、信号処理部10の電気的特性を測定する(S202)。そして、信号処理部10の動作が、所定の仕様を満たしているか否かを判定する(S203)。信号処理部10の動作が、所定の仕様を満たしている場合には、電子デバイス100をパッケージして(S206)処理を終了する。
 信号処理部10の動作が、所定の仕様を満たしていない場合、当該動作に対応するフローティング電極30に、測定結果に応じた照射量で電子ビームを照射する(S204)。これにより、信号処理部10の特性を補正する。
 次に、信号処理部10の動作を再度測定する(S208)。そして、信号処理部10の動作が、所定の仕様を満たしているか否かを判定する(S210)。このとき、S210においては、信号処理部10の予め定められた領域毎に、動作の良否を判定してよい。信号処理部10の全ての領域の動作が、正常と判定された場合には、電子デバイス100をパッケージして(S206)処理を終了する。
 信号処理部10のいずれかの領域の動作が、所定の仕様を満たしていない場合、紫外線を電子デバイス100または信号処理部10の全面に照射する(S212)。これにより、それぞれのフローティング電極30に蓄積されている電荷を除去する。そして、S204からの処理を繰り返して、それぞれのフローティング電極30に再度、電子ビームを照射する。
 ただし、2回目以降のS204における処理では、S210の処理において正常と判定された信号処理部10の領域に対して、前回と同一の設定で電子ビームを照射する。なお、不良と判定された信号処理部10の領域に対しては、電子ビームの照射個所、照射時間、電流量等を変更して、電子ビームを照射する。このような処理を繰り返すことで、信号処理部10の各領域に対して、適切な照射条件で電子ビームを照射することができる。
 図6は、スイッチ16の構造例を示す図である。スイッチ16は、フローティング電極30をゲート電極とするFETであってよい。
 スイッチ16は、半導体基板上に二酸化シリコン等の絶縁性の物質により形成される複数の分離領域115により仕切られた領域に設けられ、ソース領域111、ドレイン領域113、フローティング電極30、ビアホール151、およびガードリング171を含む。
 ソース領域111およびドレイン領域113は、半導体基板の表層部に互いに離間して形成される。ソース領域111およびドレイン領域113は、例えば単結晶シリコンの半導体基板の上面から所定の深さまでリンイオンを注入することにより形成されてよい。スイッチ16がN型のチャネル特性を有する場合、半導体基板はP型の基板であるのに対し、ソース領域111およびドレイン領域113は、N型の領域であってよい。
 フローティング電極30は、半導体基板上に二酸化シリコン等の絶縁性の物質を積層して形成される絶縁膜121を挟んでソース領域111およびドレイン領域113と対向して設けられる。本例において、フローティング電極30は、半導体基板の面方向においてソース領域111とドレイン領域113との間に設けられてよい。
 ビアホール151は、導電材料により形成され、絶縁膜123の表面からフローティング電極30まで貫通して設けられる。本例において、フローティング電極30上には、絶縁性の物質を積層した絶縁膜122および絶縁膜123が形成されており、ビアホール151は、これら絶縁膜122、123を貫通して設けられ、その一端が絶縁膜123の表面に露出する。
 パターン配線161およびパターン配線162は、絶縁膜122と絶縁膜123との間に設けられる。パターン配線161は、半導体基板上に設けられるソース端子とソース領域111とを電気的に接続する。パターン配線162は、ドレイン端子とドレイン領域113とを電気的に接続する。ソース端子は、例えば伝送線路18に接続されてよい。
 ガードリング171は、例えば導電性の金属材料により形成され、絶縁膜123の表面においてビアホール151を囲むように設けられる。本例において、ガードリング171は、基準電位に電気的に接続すされてよい。なお、ガードリング171は、本例のようにビアホール151の周囲に円環状に形成される形態に限定されず、例えば方形あるいは多角形状に形成されてもよい。
 このような構成において、絶縁膜123から表出するビアホール151に対して電子ビームを照射することにより、フローティング電極30には、その照射量に応じた電荷量が蓄積される。このため、スイッチ16を制御することができる。また、スイッチ16のソース端子、または、ドレイン端子には、フローティング電極30に蓄積された電荷量に応じた電圧および電流が生じるので、図1に関連して説明したように、当該電圧または電流に基づいて、信号処理部10の特性を調整してもよい。
 なお、本例において、ビアホール151に対して電子ビームを照射したときに、照射された電子ビームに含まれる電子の一部がビアホール151の周囲に散乱することがある。しかしながら、上記のようにビアホール151の周囲に導電性のガードリング171が設けられているので、散乱した電子はガードリング171によりトラップされる。したがって、スイッチ16において、散乱した電子が例えば絶縁膜123に取り込まれることにより、絶縁膜123に経時的に電荷が蓄積されるのを防ぐことができる。
 図7は、スイッチ16の他の構造例を示す図である。図6に関連して説明したフローティング電極30は、表面の全てが絶縁膜122で覆われていたが、本例のフローティング電極30は、表面の少なくとも一部が表出するように、絶縁膜122で覆われていてよい。例えば、図7に示すように、本例のスイッチ16は、ビアホール151に代えて、貫通孔191を有してよい。他の構造は、図6に関連して説明したスイッチ16と同一であってよい。
 貫通孔191は、絶縁膜122において、絶縁膜122の表面からフローティング電極30まで貫通して形成される。このような構成においても、貫通孔191を介してフローティング電極30に電子ビームを照射することにより、フローティング電極30には、その照射量に応じた電荷量が蓄積される。貫通孔191の直径は、電子ビームの直径よりも大きいことが好ましい。
 図8は、トランジスタ14の構造例を示す図である。トランジスタ14は、半導体基板40上に形成されるFETであってよい。この場合、トランジスタ14のゲート電極44は、絶縁膜42を介して半導体基板40の表面に形成される。また、ゲート電極44の表面の一部にも、絶縁膜46が形成されてよい。
 フローティング電極30は、トランジスタ14のゲート電極44が形成される半導体基板40の表面において、トランジスタ14のゲート電極44と離間して、且つ、トランジスタ14のゲート電極44に沿って形成される。フローティング電極30は、図8に示すように、トランジスタ14のチャネル方向と垂直な方向において、ゲート電極44と離間して形成されてよい。当該垂直方向におけるゲート電極44およびフローティング電極30の距離Dは、フローティング電極30における電荷量により、トランジスタ14の閾値電圧が変化する程度に近接していることが好ましい。また、フローティング電極30およびゲート電極44の間には、誘電材料が設けられてもよい。
 また、フローティング電極30は、絶縁膜42の上に形成されてよい。なお、フローティング電極30の表面には、絶縁膜46が形成されなくともよい。また、図6または図7に示したフローティング電極30と同様に、ビアホール151または貫通孔191を有する絶縁膜46が、フローティング電極30の表面に形成されてもよい。このような構成により、フローティング電極30に容易に電子ビームを照射して、トランジスタ14の特性を調整することができる。
 以上、発明を実施の形態を用いて説明したが、発明の技術的範囲は上記実施の形態に記載の範囲には限定されない。上記実施の形態に、多様な変更または改良を加えることが可能であることが当業者に明らかである。その様な変更または改良を加えた形態も発明の技術的範囲に含まれ得ることが、請求の範囲の記載から明らかである。

Claims (11)

  1.  入力信号に応じた出力信号を生成する電子デバイスであって、
     前記入力信号を受け取り、前記入力信号に応じた前記出力信号を生成する信号処理部と、
     電子ビームが照射されることで電荷を蓄積するフローティング電極と
     を備え、
     前記信号処理部は、前記フローティング電極に蓄積された電荷量に応じて、前記出力信号の電気特性を補正する電子デバイス。
  2.  前記信号処理部は、前記入力信号を受け取る入力端子および前記出力信号を出力する出力端子の間に、半導体基板上に形成されるトランジスタを有し、
     前記フローティング電極は、前記トランジスタのゲート電極と、前記半導体基板との間に形成される
     請求項1に記載の電子デバイス。
  3.  前記信号処理部は、前記入力信号を受け取る入力端子および前記出力信号を出力する出力端子の間に、半導体基板上に形成されるトランジスタを有し、
     前記フローティング電極は、前記トランジスタのゲート電極が形成される前記半導体基板の表面において、前記トランジスタのゲート電極と離間して、且つ、前記トランジスタのゲート電極に沿って形成される
     請求項2に記載の電子デバイス。
  4.  それぞれの前記フローティング電極の表面を覆う絶縁膜と、
     前記絶縁膜の表面から前記フローティング電極まで貫通する導電材料のビアホールと
     を更に備える請求項3に記載の電子デバイス。
  5.  前記絶縁膜の表面において前記ビアホールを囲むように設けられ、基準電位に接続されるガードリングを更に備える
     請求項4に記載の電子デバイス。
  6.  それぞれの前記フローティング電極の表面を覆う絶縁膜を更に備え、
     前記絶縁膜には、前記絶縁膜の表面から前記フローティング電極まで貫通する貫通孔が形成される
     請求項3に記載の電子デバイス。
  7.  それぞれの前記フローティング電極の表面の少なくとも一部が表出するように、前記フローティング電極の表面を覆う絶縁膜を更に備える
     請求項3に記載の電子デバイス。
  8.  入力信号に応じた出力信号を生成する電子デバイスの製造方法であって、
     電子ビームが照射されることで電荷を蓄積するフローティング電極を形成し、
     前記入力信号を受け取り、前記入力信号に応じた前記出力信号を生成し、且つ、前記フローティング電極に蓄積された電荷量に応じて、前記出力信号の電気特性を補正する信号処理部を形成し、
     前記信号処理部の動作を試験し、
     前記信号処理部の試験結果に応じて、前記フローティング電極に電子ビームを照射する製造方法。
  9.  前記フローティング電極に電子ビームを照射した後、前記信号処理部の動作を試験し、
     前記信号処理部の動作が所定の仕様を満たさない場合に、それぞれの前記フローティング電極に、再度、前記電子ビームを照射する
     請求項8に記載の製造方法。
  10.  それぞれの前記フローティング電極に再度、前記電子ビームを照射する前に、前記信号処理部の全面に紫外線を照射する
     請求項9に記載の製造方法。
  11.  それぞれの前記フローティング電極に再度、前記電子ビームを照射する場合、動作が正常と判定された前記信号処理部の領域に対しては、前回と同一の設定で電子ビームを照射する
     請求項10に記載の製造方法。
PCT/JP2008/069374 2008-10-24 2008-10-24 電子デバイスおよび製造方法 Ceased WO2010046997A1 (ja)

Priority Applications (5)

Application Number Priority Date Filing Date Title
JP2010534647A JPWO2010046997A1 (ja) 2008-10-24 2008-10-24 電子デバイスおよび製造方法
PCT/JP2008/069374 WO2010046997A1 (ja) 2008-10-24 2008-10-24 電子デバイスおよび製造方法
KR1020117003751A KR20110042188A (ko) 2008-10-24 2008-10-24 전자 디바이스 및 제조 방법
TW098135805A TWI393345B (zh) 2008-10-24 2009-10-22 電子元件及其製造方法
US13/027,977 US8614465B2 (en) 2008-10-24 2011-02-15 Electronic device and manufacturing method

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
PCT/JP2008/069374 WO2010046997A1 (ja) 2008-10-24 2008-10-24 電子デバイスおよび製造方法

Related Child Applications (1)

Application Number Title Priority Date Filing Date
US13/027,977 Continuation US8614465B2 (en) 2008-10-24 2011-02-15 Electronic device and manufacturing method

Publications (1)

Publication Number Publication Date
WO2010046997A1 true WO2010046997A1 (ja) 2010-04-29

Family

ID=42119057

Family Applications (1)

Application Number Title Priority Date Filing Date
PCT/JP2008/069374 Ceased WO2010046997A1 (ja) 2008-10-24 2008-10-24 電子デバイスおよび製造方法

Country Status (5)

Country Link
US (1) US8614465B2 (ja)
JP (1) JPWO2010046997A1 (ja)
KR (1) KR20110042188A (ja)
TW (1) TWI393345B (ja)
WO (1) WO2010046997A1 (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2016131258A (ja) * 2010-09-03 2016-07-21 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP2023540916A (ja) * 2020-09-08 2023-09-27 マイクロソフト テクノロジー ライセンシング,エルエルシー 不揮発性閾値電圧オフセット補償を備えた低電力クライオcmos回路

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5426637B2 (ja) * 2011-11-09 2014-02-26 株式会社アドバンテスト 半導体装置の製造方法及び半導体製造装置
US11824133B2 (en) * 2021-07-22 2023-11-21 Taiwan Semiconductor Manufacturing Company, Ltd. Detection using semiconductor detector

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH05114699A (ja) * 1991-07-24 1993-05-07 Fujitsu Ltd 半導体抵抗装置とその抵抗値設定方法
JPH07249688A (ja) * 1994-03-11 1995-09-26 Fujitsu Ltd 半導体集積回路装置
JPH1117017A (ja) * 1997-06-26 1999-01-22 Hitachi Ltd 半導体集積回路装置およびその製造方法

Family Cites Families (50)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4646119A (en) * 1971-01-14 1987-02-24 Rca Corporation Charge coupled circuits
AU461729B2 (en) * 1971-01-14 1975-06-05 Rca Corporation Charge coupled circuits
US4292729A (en) * 1977-09-19 1981-10-06 Motorola, Inc. Electron-beam programmable semiconductor device structure
US4317084A (en) * 1979-09-17 1982-02-23 Massachusetts Institute Of Technology Oscillator that includes a charge-flow transistor
US4450537A (en) * 1981-08-19 1984-05-22 Siemens Aktiengesellschaft Monolithically integrated read-only memory
US4672412A (en) * 1983-11-09 1987-06-09 General Electric Company High fill-factor ac-coupled x-y addressable Schottky photodiode array
JPH0512988A (ja) * 1990-10-13 1993-01-22 Canon Inc 半導体電子放出素子
US5360988A (en) * 1991-06-27 1994-11-01 Hitachi, Ltd. Semiconductor integrated circuit device and methods for production thereof
DE69223707T2 (de) * 1991-09-13 1998-05-20 Canon Kk Halbleiter-Elektronenemittierende Einrichtung
US5497146A (en) * 1992-06-03 1996-03-05 Frontec, Incorporated Matrix wiring substrates
DE69316960T2 (de) * 1992-11-12 1998-07-30 Koninkl Philips Electronics Nv Elektronenröhre mit Halbleiterkathode
US5969400A (en) * 1995-03-15 1999-10-19 Kabushiki Kaisha Toshiba High withstand voltage semiconductor device
US5900654A (en) * 1995-07-17 1999-05-04 Spratt; James P. Radiation hardened charge coupled device
JP3171785B2 (ja) * 1996-06-20 2001-06-04 富士通株式会社 薄型表示装置、及びそれに用いる電界放出陰極の製造方法
JP4167313B2 (ja) * 1997-03-18 2008-10-15 株式会社東芝 高耐圧電力用半導体装置
US6512566B1 (en) * 1997-10-24 2003-01-28 Canon Kabushiki Kaisha Matrix substrate, liquid crystal display device using it, and method for producing the matrix substrate
US6686623B2 (en) * 1997-11-18 2004-02-03 Semiconductor Energy Laboratory Co., Ltd. Nonvolatile memory and electronic apparatus
JP4450892B2 (ja) 1999-06-22 2010-04-14 株式会社アドバンテスト アナログ信号処理回路、ad変換装置、半導体デバイス試験装置およびオシロスコープ
US6355493B1 (en) * 1999-07-07 2002-03-12 Silicon Wafer Technologies Inc. Method for forming IC's comprising a highly-resistive or semi-insulating semiconductor substrate having a thin, low resistance active semiconductor layer thereon
US20100276733A1 (en) * 2000-09-27 2010-11-04 Li Choa H Solid-state circuit device
US6599781B1 (en) * 2000-09-27 2003-07-29 Chou H. Li Solid state device
US6900483B2 (en) * 2001-06-04 2005-05-31 Matsushita Electric Industrial Co., Ltd. Semiconductor device and method for manufacturing the same
WO2003017730A1 (fr) * 2001-08-09 2003-02-27 Idemitsu Kosan Co., Ltd. Ecran electroluminescent organique et procede de commande associe
CN100448049C (zh) * 2001-09-25 2008-12-31 独立行政法人科学技术振兴机构 使用固体电解质的电气元件和存储装置及其制造方法
US6859031B2 (en) * 2002-02-01 2005-02-22 Credence Systems Corporation Apparatus and method for dynamic diagnostic testing of integrated circuits
US7075593B2 (en) * 2003-03-26 2006-07-11 Video Display Corporation Electron-beam-addressed active-matrix spatial light modulator
US7358113B2 (en) * 2004-01-28 2008-04-15 Zettacore, Inc. Processing systems and methods for molecular memory
US7495378B2 (en) * 2004-07-15 2009-02-24 Ngk Insulators, Ltd. Dielectric device
EP1626278A3 (en) * 2004-08-03 2006-06-21 OnChip Cellomics Consortium Cellomics system
US7388251B2 (en) * 2004-08-11 2008-06-17 Micron Technology, Inc. Non-planar flash memory array with shielded floating gates on silicon mesas
JP4705771B2 (ja) * 2004-08-30 2011-06-22 三菱電機株式会社 半導体装置の製造方法
WO2006132659A2 (en) * 2005-06-06 2006-12-14 President And Fellows Of Harvard College Nanowire heterostructures
JP4909552B2 (ja) * 2005-09-12 2012-04-04 旭硝子株式会社 電荷保持特性に優れた不揮発性半導体記憶素子の製造方法
US7675796B2 (en) * 2005-12-27 2010-03-09 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
JP4963120B2 (ja) * 2006-02-14 2012-06-27 独立行政法人産業技術総合研究所 光電界効果トランジスタ,及びそれを用いた集積型フォトディテクタ
AU2007238477A1 (en) * 2006-02-17 2007-10-25 Ravenbrick, Llc Quantum dot switching device
JP5142494B2 (ja) * 2006-08-03 2013-02-13 ルネサスエレクトロニクス株式会社 半導体装置の製造方法
KR101427362B1 (ko) * 2006-09-19 2014-08-07 샌디스크 테크놀로지스, 인코포레이티드 기판 트렌치에 스페이서로 형성된 플로팅 게이트를 구비하는 비휘발성 메모리 셀의 어레이
US8058648B2 (en) * 2006-09-20 2011-11-15 Advantest Corporation Switching device and testing apparatus
JP5164357B2 (ja) * 2006-09-27 2013-03-21 キヤノン株式会社 半導体装置及び半導体装置の製造方法
EP4134667B1 (en) * 2006-12-14 2025-11-12 Life Technologies Corporation Apparatus for measuring analytes using fet arrays
US8349167B2 (en) * 2006-12-14 2013-01-08 Life Technologies Corporation Methods and apparatus for detecting molecular interactions using FET arrays
WO2008075615A1 (en) * 2006-12-21 2008-06-26 Semiconductor Energy Laboratory Co., Ltd. Light-emitting element and light-emitting device
JP5525778B2 (ja) * 2008-08-08 2014-06-18 株式会社半導体エネルギー研究所 半導体装置
WO2010029618A1 (ja) * 2008-09-10 2010-03-18 株式会社アドバンテスト メモリデバイス、メモリデバイスの製造方法、およびデータ書込方法
US20100301398A1 (en) * 2009-05-29 2010-12-02 Ion Torrent Systems Incorporated Methods and apparatus for measuring analytes
KR20100130850A (ko) * 2009-06-04 2010-12-14 삼성전자주식회사 박막 트랜지스터 기판 및 이의 제조 방법
JP5333342B2 (ja) * 2009-06-29 2013-11-06 株式会社デンソー 半導体装置
JP5544918B2 (ja) * 2010-02-16 2014-07-09 住友電気工業株式会社 炭化珪素絶縁ゲート型半導体素子およびその製造方法
US20120256193A1 (en) * 2011-04-08 2012-10-11 Intersil Americas Inc. Monolithic integrated capacitors for high-efficiency power converters

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH05114699A (ja) * 1991-07-24 1993-05-07 Fujitsu Ltd 半導体抵抗装置とその抵抗値設定方法
JPH07249688A (ja) * 1994-03-11 1995-09-26 Fujitsu Ltd 半導体集積回路装置
JPH1117017A (ja) * 1997-06-26 1999-01-22 Hitachi Ltd 半導体集積回路装置およびその製造方法

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2016131258A (ja) * 2010-09-03 2016-07-21 株式会社半導体エネルギー研究所 半導体装置の作製方法
US9704960B2 (en) 2010-09-03 2017-07-11 Semiconductor Energy Laboratory Co., Ltd. Field effect transistor and method for manufacturing semiconductor device
JP2023540916A (ja) * 2020-09-08 2023-09-27 マイクロソフト テクノロジー ライセンシング,エルエルシー 不揮発性閾値電圧オフセット補償を備えた低電力クライオcmos回路
JP7670296B2 (ja) 2020-09-08 2025-04-30 マイクロソフト テクノロジー ライセンシング,エルエルシー 不揮発性閾値電圧オフセット補償を備えた低電力クライオcmos回路

Also Published As

Publication number Publication date
KR20110042188A (ko) 2011-04-25
US8614465B2 (en) 2013-12-24
TW201023508A (en) 2010-06-16
US20110193138A1 (en) 2011-08-11
TWI393345B (zh) 2013-04-11
JPWO2010046997A1 (ja) 2012-03-15

Similar Documents

Publication Publication Date Title
KR101373733B1 (ko) 절연물 증착을 사용한 집적 회로 구조 형성 방법 및 절연물갭 필링 기술
US20100270616A1 (en) Semiconductor device and method of manufacturing the same
TWI393345B (zh) 電子元件及其製造方法
TW200506401A (en) Method of inspecting substrate
TWI735556B (zh) 高電子遷移率的電晶體以及用於製造高電子遷移率的電晶體之方法
US3967365A (en) Process for the production of a two-phase charge shift assembly
US7501643B2 (en) Method for controlling charge amount of ion beam and a wafer applied in the method
Sacchettini et al. Plasma antenna charging in CMOS image sensors
US10788525B2 (en) Semiconductor device, measurement device, measurement method, and semiconductor system for plasma induced damage (PID) measurement
JP5426637B2 (ja) 半導体装置の製造方法及び半導体製造装置
US6656752B1 (en) Ion current density measuring method and instrument, and semiconductor device manufacturing method
US20070236237A1 (en) A test structure and method for detecting charge effects during semiconductor processing using a delayed inversion point technique
US7491952B2 (en) Method for controlling charge amount of ion beam and a wafer applied in the method
CN101770964B (zh) 形成钝化层窗口工艺中引入电荷的测试方法
US6709969B1 (en) Method for fabricating a gas insulated gate field effect transistor
JP5433961B2 (ja) 半導体装置の製造方法
US20150041945A1 (en) Pickup device structure within a device isolation region
CN116130461B (zh) 测试结构及测试方法
WO2020121821A1 (ja) 半導体素子および半導体素子の製造方法
JP2020043187A (ja) 半導体素子、電子機器、イメージセンサ、計測装置、半導体素子の製造方法
CN111816540B (zh) 离子注入方法
US8361886B2 (en) Method for programming an anti-fuse element, and semiconductor device
WO2009101870A1 (ja) 半導体装置
US20070212800A1 (en) Methods for detecting charge effects during semiconductor processing
CN109891562B (zh) 化合物半导体器件

Legal Events

Date Code Title Description
121 Ep: the epo has been informed by wipo that ep was designated in this application

Ref document number: 08877563

Country of ref document: EP

Kind code of ref document: A1

WWE Wipo information: entry into national phase

Ref document number: 2010534647

Country of ref document: JP

ENP Entry into the national phase

Ref document number: 20117003751

Country of ref document: KR

Kind code of ref document: A

NENP Non-entry into the national phase

Ref country code: DE

122 Ep: pct application non-entry in european phase

Ref document number: 08877563

Country of ref document: EP

Kind code of ref document: A1