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WO2003093970A3 - Vorrichtung und verfahren zum berechnen eines ganzzahligen quotienten - Google Patents

Vorrichtung und verfahren zum berechnen eines ganzzahligen quotienten Download PDF

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WO2003093970A3
WO2003093970A3 PCT/EP2003/004427 EP0304427W WO03093970A3 WO 2003093970 A3 WO2003093970 A3 WO 2003093970A3 EP 0304427 W EP0304427 W EP 0304427W WO 03093970 A3 WO03093970 A3 WO 03093970A3
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WO
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PCT/EP2003/004427
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Jean-Pierre Seifert
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Infineon Technologies AG
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Infineon Technologies AG
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Abstract

Die Verarbeitungseinrichtung ist ausgebildet, um in einem Verarbeitungsschritt ein bezüglich des Moduls reduziertes Zwischenergebnis (Z) zu berechnen, das von einem oder mehreren Bits Bits des binären Multiplikators abhängt, die in dem Verarbeitungsschritt betrachtet werden. Die Vorrichtung umfasst ferner eine Protokollierungseinrichutung zum Protokollieren von Reduktionsinformationein den jeweiligen Verarbeitungsschritten und von Ordnungsinformationen über durch eine oder mehrere durch den jeweiligen Verarbeitungsschritt betroffene Stellen des ganzzahligen Quotienten, sowie eine Auswertungseinrichtung (14) zum Auswerten der Ordnungsinformationen und der Reduktionsinformationen aus den Verarbeitungsschritten, um den ganzzahligen Quotienten (Q) zu erhalten. Durch Mit-Protokollieren der Reduktionsinformationen und der Ordnungsinformationen in den Verarbeitungsschritten kann ein üblicherweise Hardware-mässig implementierter Befehl zur Durchführung einer modularen Multiplikation dahin gehend ergänzt werden, um auch das Ergebnis der DIV-Operation, also den ganzzahligen Quotienten, auszugeben.
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Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE102006025677B4 (de) 2005-10-28 2020-03-12 Infineon Technologies Ag Vorrichtung und Verfahren zum Berechnen eines Ergebnisses einer Summe mit einem Rechenwerk mit begrenzter Wortlänge
DE102006025713B9 (de) 2005-10-28 2013-10-17 Infineon Technologies Ag Kryptographie-Vorrichtung und Kryptographie-Verfahren zum Berechnen eines Ergebnisses einer modularen Multiplikation
DE102006025569A1 (de) 2005-10-28 2007-05-03 Infineon Technologies Ag Vorrichtung und Verfahren zum Berechnen einer Multiplikations-Additions-Operation und zum Berechnen eines Ergebnisses einer modularen Multiplikation
DE102006025673B9 (de) * 2005-10-28 2010-12-16 Infineon Technologies Ag Rechenwerk zum Reduzieren einer Eingabe-Zahl bezüglich eines Moduls
US20220121424A1 (en) * 2020-10-21 2022-04-21 PUFsecurity Corporation Device and Method of Handling a Modular Multiplication

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3631992A1 (de) * 1986-03-05 1987-11-05 Holger Sedlak Kryptographie-verfahren und kryptographie-prozessor zur durchfuehrung des verfahrens
EP0351829A2 (de) * 1988-07-19 1990-01-24 Nec Corporation Dividierschaltung für ganze Zahlen, versehen mit einer Überlaufdetektionsschaltung
US5710730A (en) * 1995-03-31 1998-01-20 International Business Machines Corporation Divide to integer
WO2002033885A1 (en) * 2000-10-17 2002-04-25 Novacatus Invest Ab Modular multiplication for rsa and other assymetric encryption/decryption

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2768245B1 (fr) * 1997-09-09 1999-10-15 Sgs Thomson Microelectronics Procede de production d'une division entiere avec un coprocesseur d'arithmetique modulaire
FR2777098B1 (fr) * 1998-04-02 2001-04-13 Sgs Thomson Microelectronics Procede de realisation ameliore d'une division entiere

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3631992A1 (de) * 1986-03-05 1987-11-05 Holger Sedlak Kryptographie-verfahren und kryptographie-prozessor zur durchfuehrung des verfahrens
EP0351829A2 (de) * 1988-07-19 1990-01-24 Nec Corporation Dividierschaltung für ganze Zahlen, versehen mit einer Überlaufdetektionsschaltung
US5710730A (en) * 1995-03-31 1998-01-20 International Business Machines Corporation Divide to integer
WO2002033885A1 (en) * 2000-10-17 2002-04-25 Novacatus Invest Ab Modular multiplication for rsa and other assymetric encryption/decryption

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
WALTER C D: "Fast Modular Multiplication Using 2-Power Radix", INTERNATIONAL JOURNAL OF COMPUTER MATHEMATICS, GORDON AND BREACH PUBLISHERS, LONDON,, GB, vol. 3, 1991, pages 21 - 28, XP002272738, ISSN: 0020-7160 *

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Publication number Publication date
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