[go: up one dir, main page]

SU1587585A1 - D-flip-flop - Google Patents

D-flip-flop Download PDF

Info

Publication number
SU1587585A1
SU1587585A1 SU884375969A SU4375969A SU1587585A1 SU 1587585 A1 SU1587585 A1 SU 1587585A1 SU 884375969 A SU884375969 A SU 884375969A SU 4375969 A SU4375969 A SU 4375969A SU 1587585 A1 SU1587585 A1 SU 1587585A1
Authority
SU
USSR - Soviet Union
Prior art keywords
input
trigger
elements
inputs
outputs
Prior art date
Application number
SU884375969A
Other languages
Russian (ru)
Inventor
Владимир Ефимович Дворкин
Людмила Павловна Еременко
Борис Ильяевич Юргаев
Борис Исакович Маковоз
Original Assignee
Предприятие П/Я Г-4677
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Предприятие П/Я Г-4677 filed Critical Предприятие П/Я Г-4677
Priority to SU884375969A priority Critical patent/SU1587585A1/en
Application granted granted Critical
Publication of SU1587585A1 publication Critical patent/SU1587585A1/en

Links

Landscapes

  • Logic Circuits (AREA)

Abstract

Изобретение относитс  к вычислительной технике и может быть использовано дл  построени  цифровых схем со статическим и динамическим управлением и дл  их контрол . Целью изобретени   вл етс  расширение области применени  D-триггера за счет возможности использовани  в последовательностных устройствах со статическим и динамическим управлением. Дл  этого в D-триггер, состо щий из шести элементов И-НЕ 1-6,введены еще четыре элемента И-НЕ 7 - 10 и элемент НЕ 11. Возможно переключать режим управлени  D-триггером со статического на динамический и обратно сигналом на входе 16. 5 ил., 1 табл.The invention relates to computing and can be used to build digital circuits with static and dynamic control and to control them. The aim of the invention is to expand the field of application of the D-flip-flop due to the possibility of its use in sequential devices with static and dynamic control. To do this, the D-flip-flop, consisting of six elements AND-NOT 1-6, includes four more elements, AND-NOT 7 - 10 and the element NOT 11. It is possible to switch the control mode of the D-trigger from static to dynamic and back by the input signal 16. 5 Il., 1 tab.

Description

П р и м е ч а и и е.х - безразличное состо ние на оходе; и/о - ноопределени. на выходе.PRI m e h a and e.x - an indifferent state on the way; and / o - but definitions. at the exit.

. .

ое состо ниеstate of

Фи5.2Phi5.2

Фи5.5Phi5.5

7373

7 1.7 1.

3g3g

Фиг.FIG.

СчвтчихShchvtchih

у////////.//Аu ////////.// A

Pesucrnf)Pesucrnf)

vewv-vAфцг .vewv-vAfzg.

Claims (6)

Формула изобретенияClaim 5 D-триггер, содержащий шесть элементов И-НЕ, причем выходы первого и второго элементов И-НЕ соединены с первыми входами второго и первого элементов И-НЕ и являются прямым и инверсным выходами D-триггера, выход третьего элемента И-НЕ ' соединен с первым входом шестого элемента И-НЕ, выход которого соединен с первыми выходами третьего и четвертого и с вторым входом первого элементов И-НЕ, выход четвертого элемента И-НЕ соединен с вторым 15 входом второго элемента И-НЕ и первым входом пятого элемента И-НЕ, выход которого соединен с вторыми входами третьего и четвертого элементов И-НЕ, третьи входы первого и третьего элементов И-НЕ являются S-входом D-триггера, а вторые входы пятого и шестого и третий вход второго элементов И-НЕ являются /^-входами D-триггера, отличающийся тем, что, с целью расширения области применения D-триггера за счет возможности использования в после25 довательностных устройствах со статическим и динамическим управлением, в него введены седьмой, восьмой, девятый и десятый*1 элементы И-НЕ и элемент НЕ, причем выходы седьмого и восьмого элементов И-НЕ соединены соответственно с третьими входами 30 шестого и четвертого элементов И-НЕ, первые входы являются С-входом D-триггера, а вторые входы соединены соответственно с выходами девятого и десятого элементов И-НЕ, первые входы которых являются входом переключения режима управления 35 D-триггера, второй вход десятого элемента И-НЕ соединен с выходом элемента НЕ, вход которого соединен с вторым входом девятого, третьим входом пятого элементов И-НЕ и является D-входом D-триггера.5 D-trigger containing six AND-NOT elements, the outputs of the first and second AND-NOT elements connected to the first inputs of the second and first AND-NOT elements and are direct and inverse outputs of the D-trigger, the output of the third AND-NOT element with the first input of the sixth AND-NOT element, the output of which is connected to the first outputs of the third and fourth and the second input of the first AND-NOT elements, the output of the fourth AND-NOT element is connected to the second 15 input of the second AND-NOT element and the first input of the fifth AND element -NOT whose output is connected to the second inputs of the third and fourth AND-NOT elements, the third inputs of the first and third AND-NOT elements are the S-input of the D-trigger, and the second inputs of the fifth and sixth and the third input of the second AND-NOT elements are the / ^ - inputs of the D-trigger, characterized in that, in order to expand the scope of the D-flip-flop due to the possibility of using in sequential devices with static and dynamic control, the seventh, eighth, ninth and tenth * 1 AND-elements and the NOT element are introduced into it, and the outputs of the seventh and eighth elements are NOT connected respectively with the third inputs 30 of the sixth and fourth AND-NOT elements, the first inputs are the C-input of the D-trigger, and the second inputs are connected respectively to the outputs of the ninth and tenth AND-NOT elements, the first inputs of which are the control mode switching input 35 of the D-trigger , the second input of the tenth AND-NOT element is connected to the output of the NOT element, whose input is connected to the second input of the ninth, third input of the fifth AND-NOT elements and is the D-input of the D-trigger. Стро- ка Stro- ka Входы Inputs Выходы Outputs - - г------------ Выполняемая функция -Режим работы - - g ------------ Function to be performed - Work mode 1 6 16 17 17 18 18 15 fifteen 12 12 13 thirteen 14 14 Е E S S R R С FROM D D Q Q Q Q __ __
1 о1 o
2 020 3 0thirty 4 04 0 5 0fifty 6 06 0 0 0 0 10 0 0 1 1 010 1 1eleven 1 1eleven 1 1eleven 0 0 X X н/о but н/о but Запрещенная комбинация Prohibited Combination Работает как Works like 0 0 X X 1 1 0 0 Установка в ”1 Setting to ”1 RS-триггер RS trigger 0 0 X X 0 0 1 1 Установка в ”0 Setting to ”0 0 0 X X Q Q Q Q Хранение Storage Хранение Storage 1 0 1 0 1 0 1 0 0 0 Установка информации Setting information Работает как Works like 1 1 по фронту сигнала С along the edge of signal C D-триггер.чувствительный к фронту 1/0 сигнала на С-входе D-trigger, edge sensitive 1/0 signal at C input 1 1 1 0 1 0 1 1 0 0 Установка информации Setting information Работает кстк Kstk works 1 0 1 0 0 0 1 1 по уровню сигнала С by signal level C D-триггер,чув- D-trigger, chuv X X Q Q Q Q Хранение Storage ствительный к fixed to
уровню сигнала на С-входе Прозрачный· При С = 1Signal level at C-input Transparent · At C = 1 П р и м е ч а пие.я- безразличное состояние на входе; и/о - неопределенное состояние на выходе.N ote Pie. I - indifferent state at the input; and / o is an undefined state at the output. 79 79 )5 ) 5 т t -----1 75 ----- 1 75 с from п P 72 72 η η 7B iJ Е iJ E 21 21 £<>- £ <> - во{ in { г— g— к to
Фи8.5Fi8.5 Фиг. кFIG. to 1ПППППППППП 1PPPPPPPPPP (П п п п · * ( P p p p * * и and 2g Тригге- ра 29.1 Trigger Ra 29.1 Π П П| Π P P | п п , n n ^73 ^ 73 Тригге- ра 29.2 Trigger Ra 29.2 1 Г~1 1-------1 г1 1 G ~ 1 1 ------- 1 g 1 —1ПГ~', -1HPG ~ ', U73 U73 Тригге- ров 29 Trigger Moat 29 пп пп pp pp U90 U90 >> Us2 U s2 Счетчик Counter Регистр <---------> Register <---------> Счетчик <_____________ Counter <_____________
Фи3.5Fi3.5
SU884375969A 1988-02-08 1988-02-08 D-flip-flop SU1587585A1 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
SU884375969A SU1587585A1 (en) 1988-02-08 1988-02-08 D-flip-flop

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
SU884375969A SU1587585A1 (en) 1988-02-08 1988-02-08 D-flip-flop

Publications (1)

Publication Number Publication Date
SU1587585A1 true SU1587585A1 (en) 1990-08-23

Family

ID=21354662

Family Applications (1)

Application Number Title Priority Date Filing Date
SU884375969A SU1587585A1 (en) 1988-02-08 1988-02-08 D-flip-flop

Country Status (1)

Country Link
SU (1) SU1587585A1 (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO1998037539A1 (en) * 1997-02-21 1998-08-27 Nikolai Anatolievich Bogatov A method for driving an ac plasma display panel

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
Электроника, 1979, № 6, с. 35-39. Применение интегральных микросхем в электронной вычислительной технике. Справочник. -М.: Радио и св зь, 1987, с 32 *

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO1998037539A1 (en) * 1997-02-21 1998-08-27 Nikolai Anatolievich Bogatov A method for driving an ac plasma display panel

Similar Documents

Publication Publication Date Title
JPS63246919A (en) Power-on reset pulse generation circuit
KR940017216A (en) Integrated circuits and systems with output switching methods and multiplexers
SU1587585A1 (en) D-flip-flop
KR880000880A (en) Comparator
JPH0736708B2 (en) Inverter control circuit
KR920018640A (en) LCD driving circuit
JPH0373234B2 (en)
KR100331793B1 (en) Pulse Width Modulation (PWM) Signal Generator
SU1580534A1 (en) Ternary counting device
KR970008878A (en) Clock switching circuit
SU1262723A1 (en) Input logic device
RU2012133C1 (en) Unipolar-delta code converter
SU1190520A1 (en) Synchronous counter
JPH0429248B2 (en)
SU1176440A1 (en) D-flip-flor
SU826554A1 (en) Dynamic flip-flop
KR0177756B1 (en) Noise reduction circuit
SU900412A1 (en) Current element with arresting trigger
SU894876A1 (en) N-digit binary counter
RU1803917C (en) Data output device
SU1003146A1 (en) Unitary code shift register
SU1700553A1 (en) Output device
SU818017A1 (en) Logic &#39;&#39;m from n&#39;&#39;device
SU843249A1 (en) Frequency divider
SU1162040A1 (en) Digital accumalator