KR20030041281A - Method for carrying out utopia protocol with sequential number - Google Patents
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Abstract
본 발명은 물리 라인에서의 ATM 셀을 송수신하는 유토피아 프로토콜 구현 방법에 있어서, 클럭 동기 신호를 송신함과 동시에 순번 정보가 부가된 송신셀을 전송하는 송신 단계와; 클럭 동기 신호를 수신함과 동시에 수신된 셀의 순번을 체크하여 순서가 맞지 않을 경우 에러 발생을 판단하는 수신 단계로 구성된 것을 특징으로 하는 순번을 가진 유토피아 프로토콜 구현 방법을 제공한다. 따라서, 본 발명은 물리 라인에서의 셀의 유실에 따른 에러 발생을 감지할 수 있는 장점이 있다.A method for implementing a utopia protocol for transmitting and receiving ATM cells on a physical line, the method comprising: a transmitting step of transmitting a clock synchronization signal and transmitting a transmission cell to which sequence information is added; The present invention provides a method for implementing a utopia protocol having a sequence number comprising receiving a clock synchronizing signal and checking a sequence number of a received cell and determining an error occurrence if the sequence does not match. Accordingly, the present invention has an advantage of detecting an error caused by the loss of cells in a physical line.
Description
본 발명은 유토피아 프로토콜에 관한 것으로, 특히 유토피아 프로토콜에 순번 정보를 추가하여 물리 링크에서 발생하는 에러에 대한 검증을 쉽게 할 수 있도록 구현된 순번을 가진 유토피아 프로토콜 구현 방법에 관한 것이다.The present invention relates to a utopia protocol, and more particularly, to a method for implementing a utopia protocol having a sequence number which is implemented to easily verify error occurring in a physical link by adding sequence information to the utopia protocol.
도 1은 종래 기술에 따른 유토피아 스케줄도이다.1 is a utopia schedule diagram according to the prior art.
유토피아 방식은 데이터를 물리 라인으로 송수신할 때 쓰이는 프로토콜로서 여기에 필요한 신호들은 송신 방향으로는 송신 클럭 신호(Txclk), 송신 클레브 신호(TxClav), 송신 인에이블 신호(TxEnd), 송신 데이터(TxData), 송신 클럭 동기 신호(TxSOC)가 있으며, 수신 방향으로는 수신 클럭 신호(Rxclk), 수신 클레브 신호(RxClav), 수신 인에이블 신호(RxEnb), 수신 데이터(RxData), 수신 클럭 동기 신호(RxSOC)의 신호가 있으며, 이들 신호들은 버스 중재자가 실제적인 데이터를 송수신하는 데 쓰인다.Utopia is a protocol used for transmitting and receiving data on a physical line, and the signals required for the transmission are transmitted in the transmission direction (Txclk), transmission cleave signal (TxClav), transmission enable signal (TxEnd), and transmission data (TxData). ), There is a transmission clock synchronization signal TxSOC, and a reception clock signal Rxclk, a reception cleb signal RxClav, a reception enable signal RxEnb, a reception data RxData, a reception clock synchronization signal RxSOC), and these signals are used by the bus arbiter to send and receive the actual data.
각 송신단 및 수신단에는 유토피아 프로토콜을 지원하는 전용칩이 구비되어, 도 1에 도시된 것과 같은 신호을 입출력하게 된다.Each transmitter and receiver are equipped with a dedicated chip that supports the utopia protocol, and input and output signals as shown in FIG.
송신단에서 송신할 데이터가 있을 경우 먼저 수신단에서 받은 준비가 되어 있는지를 확인해야 하는데, 이는 TxClav라는 신호가 하이 레벨인지의 여부에 따라 판단된다.When there is data to be transmitted by the transmitter, it is necessary to first check whether the receiver is ready, which is determined by whether the signal TxClav is at a high level.
TxClav라는 신호가 하이 레벨인 경우, 데이터를 송신하고, TxClav라는 신호가 하이 레벨이 아닐 경우, TxClav 신호가 하이 레벨이 될 때까지 기다린 후에 송신한다.If the signal TxClav is at the high level, data is transmitted. If the signal TxClav is not at the high level, it waits until the TxClav signal is at the high level before transmitting.
이 때, 송신 셀의 처음 부분을 알려주기 위해 Txclk에 동기를 맞추어 하나의 전송 클럭동안 SOC라는 신호를 하이 레벨로 유지시켜 주어야하며 나머지 부분은 로우 레벨로 유지시켜 준다.At this time, in order to inform the first part of the transmitting cell, the SOC signal should be kept at high level during one transmission clock in synchronization with Txclk, and the other part is kept at low level.
송신단은 송신 데이터 버스에서 Soc신호와 함께 처음 데이터를 실어준다.The transmitter carries the first data along with the Soc signal on the transmit data bus.
이 때, 1셀이 끝까지 전송할 때까지 송신 인에이블이라는 신호를 로우로 유지시켜 주어서 지금이 송신중임을 나타낸다.At this time, a signal called transmit enable is kept low until one cell transmits to the end, indicating that it is transmitting.
수신단일 경우 송신과 유사한 점이 많은데 수신하는 쪽에서 수신할 수 있는 준비가 되어 RxClav 신호를 하이 레벨로 유지시키고 있으면 수신할 수가 있는데, 수신하는 처음의 셀을 판단하기 위하여 수신 클럭에 동기가 맞는 Rx Soc신호가 1 클럭 동안에 하이 레벨로 유지되어야 하며 그렇지 않으면 에러로 처리한다.In the case of the receiving end, there are many similarities to the transmission. If the receiving side is ready to receive and keeps the RxClav signal at a high level, it can receive the Rx Soc signal that is synchronized with the reception clock to determine the first cell to receive. Must be held at a high level for one clock or it is treated as an error.
Rx Soc신호가 처음 들어왔을 경우 이를 정당한 셀로 판단하여 수신을 시작하는데 Rx Soc가 시작된 시점부터 데이터 버스에 송신 데이터가 실리기 시작하며 수신단에서는 송신 데이터를 수신할 수가 있다.When the Rx Soc signal is first received, it is judged as a legitimate cell and reception starts. From the time when the Rx Soc starts, transmission data starts to be loaded on the data bus, and the receiving end can receive the transmission data.
이 때 수신 동작을 나타내기 위해서 수신 인에이블 신호가 수신 동작중에 로우 상태로 유지된다.At this time, the reception enable signal is kept low during the reception operation to indicate the reception operation.
이러한 방식으로 유토피아 방식에서 송수신 동작이 수행된다.In this manner, transmission and reception operations are performed in the utopia method.
그러나, 상술한 종래 기술에 있어서, 송신단에서 송신을 하였으나 물리 라인에 에러가 발생하여 1 셀이 모두 사라졌을 경우 이를 판단할 수가 없다는 문제점이있다.However, in the above-described conventional technique, there is a problem in that, when the transmitting end transmits but one cell disappears due to an error in the physical line, it cannot be determined.
따라서, 본 발명은 종래 기술의 문제점을 해결하기 위한 것으로, 송신 데이터의 선두에 순번 정보를 추가하여 전송하여 에러 체크를 할 수 있는 순번을 가진 유토피아 프로토콜 구현 방법을 제공함에 그 목적이 있다.Accordingly, an object of the present invention is to provide a method for implementing a utopia protocol having an order of error checking by adding order information to the head of transmission data and transmitting the error information.
상기의 목적을 달성하기 위한 본 발명의 일 실시 예는, 물리 라인에서의 ATM 셀을 송수신하는 유토피아 프로토콜 구현 방법에 있어서, 클럭 동기 신호를 송신함과 동시에 순번 정보가 부가된 송신셀을 전송하는 송신 단계와; 클럭 동기 신호를 수신함과 동시에 수신된 셀의 순번을 체크하여 순서가 맞지 않을 경우 에러 발생을 판단하는 수신 단계로 구성된 것을 특징으로 한다.According to an embodiment of the present invention for achieving the above object, in the Utopia protocol implementation method for transmitting and receiving ATM cells on a physical line, a transmission for transmitting a transmission cell to which the sequence information is added while transmitting a clock synchronization signal Steps; Receiving a clock synchronization signal and at the same time checks the order of the received cells characterized in that the step of determining the occurrence of an error if the order is not correct.
도 1은 종래 기술에 따른 유토피아 스케줄도.1 is a utopia schedule diagram according to the prior art.
도 2는 본 발명에 따른 순번을 가진 유토피아 스케줄도.Figure 2 is a utopia schedule with a sequence according to the present invention.
도 3a 및 도 3b는 본 발명에 따른 순번을 가진 유토피아 프로토콜 구현 방법을 설명하기 위한 플로우차트.3A and 3B are flowcharts illustrating a method for implementing a utopia protocol having a sequence number according to the present invention.
이하, 본 발명에 따른 일 실시예를 첨부한 도면을 참조하여 상세히 설명하기로 한다.Hereinafter, with reference to the accompanying drawings an embodiment according to the present invention will be described in detail.
도 2는 본 발명에 따른 순번을 가진 유토피아 스케줄도이다.2 is a utopia schedule diagram with a turn in accordance with the present invention.
도 3a 및 도 3b는 본 발명에 따른 순번을 가진 유토피아 프로토콜 구현 방법을 설명하기 위한 플로우차트이다.3A and 3B are flowcharts illustrating a method for implementing a utopia protocol having a sequence number according to the present invention.
도 2 및 도 3a 및 도 3b를 참조하면, 본 발명에 따른 방법은 클럭 동기 신호를 송신함과 동시에 순번 정보가 부가된 송신셀을 전송하는 송신 단계(S10~S30)와; 클럭 동기 신호를 수신함과 동시에 수신된 셀의 순번을 체크하여 순서가 맞지 않을 경우 에러 발생을 판단하는 수신 단계(S40~S70)로 이루어진다.2 and 3A and 3B, the method according to the present invention includes a transmission step (S10 to S30) for transmitting a transmission cell to which the sequence information is added while transmitting a clock synchronizing signal; Receiving a clock synchronizing signal and at the same time checks the order of the received cell and if the order is not correct is made in the receiving step (S40 ~ S70) to determine the occurrence of an error.
상기 방법은 종래 기술에서 상술한 유토피아 프로토콜 전용 칩에서 구현된다.The method is implemented in a chip dedicated to the utopia protocol described above in the prior art.
우선 송신 단계를 살펴보면, 종래 기술과 동일하므로 상세한 설명은 생략하고 종래 기술과의 차이점만을 언급하면, 즉 53 바이트의 셀 선두에 순번 정보가 기록된 1바이트를 부가하여 54 바이트를 생성하고(S10), 송신 SOC를 전송함과 동시에 상기 54 바이트 셀을 송신한다(S20~S30).First, the transmission step is the same as the prior art, and thus, the detailed description is omitted and only the difference with the prior art is mentioned. That is, 54 bytes are generated by adding 1 byte in which the sequence information is recorded at the head of the 53 bytes (S10). The 54-byte cell is transmitted at the same time as the transmission SOC is transmitted (S20 to S30).
상기 순번을 만들어주는 방법은 8비트 데이터 라인을 사용한다고 했을 때, 8비트이므로 0부터 시작하여 28개까지 번호를 매길 수 있으며, 1셀이 보내어질 때마다 1씩 증가하는 방법으로 순번를 매긴다.When the sequence number is made of 8-bit data lines, 8-bit data lines can be numbered starting from 0 and up to 2 8 , and the sequence number is incremented by 1 each time a cell is sent.
그리고, 순번이 28개까지 갔을 경우, 다시 0으로 시작하여 1씩 증가시키면된다.And, if the sequence number goes up to 2 8 , start again with 0 and increase by 1.
수신 단계 또한 상술한 종래 기술과 같으므로 생략하고, 차이점만 언급하면 셀 수신에 따라(S40) 맨 처음 1 바이트를 순번 정보로 인식하여, 순번이 순차적인가를 판단한다(S50).Since the reception step is also the same as the above-described prior art, it will be omitted. When only the difference is mentioned (S40), the first 1 byte is recognized as sequence information according to cell reception, and it is determined whether the sequence is sequential (S50).
예를 들어, 선두 셀의 순번이 0이었는데, 다음에 수신된 셀의 순번이 1이면 정상이므로 서비스를 수행하고(S60), 그렇지 않은 경우에는 예를 들어 2인 경우에는 1번 셀이 소실된 것으로 판단하여 중간에 에러가 발생한 것으로 판단한다(S70).For example, if the sequence number of the first cell was 0, and if the sequence number of the next received cell is 1, the service is normal since it is normal (S60). Otherwise, for example, if the number 2 is lost, the cell 1 is lost. It is determined that an error occurs in the middle (S70).
이상의 본 발명은 상기에 기술된 실시예들에 의해 한정되지 않고, 당업자들에 의해 다양한 변형 및 변경을 가져올 수 있으며, 이는 첨부된 청구항에서 정의되는 본 발명의 취지와 범위에 포함된다.The present invention is not limited to the embodiments described above, and various modifications and changes can be made by those skilled in the art, which are included in the spirit and scope of the present invention as defined in the appended claims.
상기에서 살펴본 본 발명은 순번 정보를 포함한 유토피아 방식을 사용함으로써 송수신 도중에 셀 유실 여부를 판단하여 에러 발생을 쉽게 감지할 수 있다는 이점이 있다.The present invention as described above has an advantage that the occurrence of an error can be easily detected by determining whether a cell is lost during transmission and reception by using a utopia method including sequence information.
Claims (2)
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| KR1020010071922A KR20030041281A (en) | 2001-11-19 | 2001-11-19 | Method for carrying out utopia protocol with sequential number |
Applications Claiming Priority (1)
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| KR1020010071922A KR20030041281A (en) | 2001-11-19 | 2001-11-19 | Method for carrying out utopia protocol with sequential number |
Publications (1)
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| KR20030041281A true KR20030041281A (en) | 2003-05-27 |
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Family Applications (1)
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| KR1020010071922A Withdrawn KR20030041281A (en) | 2001-11-19 | 2001-11-19 | Method for carrying out utopia protocol with sequential number |
Country Status (1)
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|---|---|
| KR (1) | KR20030041281A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR101041370B1 (en) * | 2004-04-16 | 2011-06-15 | 쌘디스크 코포레이션 | Memory card with two standard sets of contacts and contact cover mechanism |
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2001
- 2001-11-19 KR KR1020010071922A patent/KR20030041281A/en not_active Withdrawn
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Legal Events
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| PA0109 | Patent application |
Patent event code: PA01091R01D Comment text: Patent Application Patent event date: 20011119 |
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