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KR20000021115A - Method for driving plasma display panel - Google Patents

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KR20000021115A
KR20000021115A KR1019980040055A KR19980040055A KR20000021115A KR 20000021115 A KR20000021115 A KR 20000021115A KR 1019980040055 A KR1019980040055 A KR 1019980040055A KR 19980040055 A KR19980040055 A KR 19980040055A KR 20000021115 A KR20000021115 A KR 20000021115A
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KR
South Korea
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discharge
sustain
pulse
display panel
address
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Withdrawn
Application number
KR1019980040055A
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Korean (ko)
Inventor
이은철
Original Assignee
구자홍
엘지전자 주식회사
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Publication date
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Abstract

본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것으로, 일측 기판에 형성된 복수개의 어드레스전극과, 상기 기판에 대향하는 타측 기판에 상기 어드레스전극과 직교하도록 형성된 복수개의 서스테인전극과, 상기 어드레스전극과 서스테인전극의 교차부에 형성된 방전셀을 포함하는 AC형 플라즈마 디스플레이 패널구조와, 상호교번으로 펄스를 인가하여 상기 방전셀의 벽전하를 균일하게 하는 리세트단계; 상기 복수개의 서스테인전극에 스캔펄스가 인가되고 상기 스캔펄스가 인가될 때마다 상기 복수개의 어드레스전극에 인가되는 데이터펄스에 의해서 화소를 지정하는 어드레스단계; 상호 교번으로 펄스를 인가하여 방전을 유지시켜 화상을 구현하는 유지방전단계로 이루어진 구동방법에 있어서, 상기 유지방전단계에서 상호교번으로 인가되는 펄스가 폭이 서로 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.를 포함하여 이루어진 것이 특징으로서, 컬러 플라즈마 디스플레이 패널의 화질이 개선되고, 수명이 연장되며, 소비전력이 감소되는 효과가 있다.The present invention relates to a method of driving a plasma display panel, comprising: a plurality of address electrodes formed on one substrate, a plurality of sustain electrodes formed on the other substrate facing the substrate so as to be orthogonal to the address electrodes, and the address electrodes and the sustain electrodes An AC-type plasma display panel structure including discharge cells formed at intersections of the reset cells and alternately applying pulses alternately to uniform wall charges of the discharge cells; An address step of specifying a pixel by data pulses applied to the plurality of address electrodes whenever scan pulses are applied to the plurality of sustain electrodes and the scan pulses are applied; A driving method comprising a sustain discharge step of applying an alternating pulse to maintain a discharge to implement an image, wherein the pulses applied alternately in the sustain discharge step have different widths. It is characterized in that the made, including, the image quality of the color plasma display panel is improved, the life is extended, the power consumption is reduced.

Description

플라즈마 디스플레이 패널의 구동방법Driving Method of Plasma Display Panel

본 발명은 플라즈마 디스플레이 패널(이하 피디피 : Plasma Display Panel)에 관한 것으로, 특히 피디피의 구동방법에 관한 것이다.The present invention relates to a plasma display panel (hereinafter referred to as a plasma display panel), and more particularly to a method for driving a PD.

피디피와 액정표시장치(LCD)는 평판형 표시장치 중에서 가장 고안성이 높은 차세대 표시장치로 각광받고 있다. 특히 피디피는 액정표시장치보다 휘도가 높고 시야각이 넓어 옥외 광고탑 또는, 벽걸이 티브이, 극장용 디스플레이와 같이 박형의 대형 디스플레이로서 응용성이 넓다.PD and LCD are spotlighted as next generation display devices with the highest design among flat panel displays. In particular, PDP has higher luminance and wider viewing angle than LCD, and thus has wide applicability as a thin, large display such as an outdoor advertising tower, a wall-mounted TV, or a theater display.

피디피는 가스방전을 이용하여 표시발광시키는 방식을 이용하고 있으며, 그 구성에 있어서 전극표면에 유전층이 구성된 AC형 피디피와 전극의 표면이 방전공간에 노출된 DC형 피디피로 구분된다. AC형 피디피는 유전층 위에 형광체가 구성되어 있고, DC형 피디피는 전극 위에 형광체가 구성되어 있다. 피디피는 가스방전에 의해 발생된 자외선을 형광체에 조사하여 형광체를 발광시킨다.The PD is used to display and emit light using gas discharge. In the configuration, the PD is classified into an AC PD with a dielectric layer formed on the surface of the electrode and a DC PD with the surface of the electrode exposed to the discharge space. In the AC type PD, the phosphor is formed on the dielectric layer, and in the DC type PD, the phosphor is formed on the electrode. PDPD emits the phosphor by irradiating the phosphor with ultraviolet rays generated by gas discharge.

일반적인 AC형 대향방전방식의 피디피의 구조는 도 1에 도시된 것과 같이 복수개의 매트릭스전극으로 구성되어 있다. 대향방전방식의 피디피는 전면기판(10) 위에 구성된 서스테인 전극(11)과, 그 위에 형성된 유전층(12)과, 유전층의 표면을 이온충격으로 토호하기 위해 산화마그네슘(MgO) 등으로 구성된 보호층(13)과, 배면기판(20) 위에 구성된 어드레스 전극(21), 그 위에 형성된 유전층(22)과, 유전층 위에 구성된 격벽(23) 및, 격벽 사이에 도포된 형광체(24)로 구성되어 있다.The structure of a typical AC type counter discharge PDPD is composed of a plurality of matrix electrodes as shown in FIG. The opposite discharge type PDP includes a sustain electrode 11 formed on the front substrate 10, a dielectric layer 12 formed thereon, and a protective layer made of magnesium oxide (MgO) or the like to protect the surface of the dielectric layer with ion shock ( 13), the address electrode 21 formed on the back substrate 20, the dielectric layer 22 formed thereon, the partition 23 formed on the dielectric layer, and the phosphor 24 coated between the partition walls.

도 1에 도시된 일반적인 피디피의 구동을 위해 각 전극에 인가되는 펄스는 도 2에 도시된 것과 같다. 일반적인 피디피의 구동펄스는 피디피의 방전셀을 선택하고 발광을 지속시키기 위해 리셋방전기간과, 어드레스방전기간, 그리고 유지방전기간으로 구분된다.The pulse applied to each electrode for driving the general PD shown in FIG. 1 is the same as that shown in FIG. 2. The driving pulse of a typical PD is divided into a reset discharge period, an address discharge period, and a sustain discharge period in order to select a discharge cell of the PD PD and to sustain light emission.

리셋방전기간은 어드레스 전극과 서스테인 전극에 방전을 일으켜 방전셀 내의 벽전하를 소거하여 셀을 초기화한다.In the reset discharge period, the address electrodes and the sustain electrodes are discharged to erase wall charges in the discharge cells to initialize the cells.

어드레스방전기간은 서스테인 전극에 스캔펄스(30)를 인가하고, 어드레스 전극에 데이터펄스(40)를 인가하여 방전시킬 셀을 선택하여 그 셀에 벽전하를 형성시킨다. 도 2는 어드레스 전극에 정전압(positive voltage)의 데이터펄스(40)가 인가되고, 서스테인 전극에 부전압(negative voltage)의 스캔펄스(30)가 인가되는 것을 도시한 파형도이다. 그 결과, 어드레스 전극에 정전하가 발생되고 서스테인 전극에 부전하가 발생된다. 이 때, 발생된 정전하와 부전하는 모두 벽전하(wall charge)이다.In the address discharge period, a scan pulse 30 is applied to the sustain electrode, a data pulse 40 is applied to the address electrode, and a cell to be discharged is selected to form wall charges in the cell. FIG. 2 is a waveform diagram illustrating that a positive voltage data pulse 40 is applied to an address electrode and a negative voltage scan pulse 30 is applied to a sustain electrode. As a result, electrostatic charges are generated at the address electrodes and negative charges are generated at the sustain electrodes. At this time, both the generated static charge and the negative charge are wall charges.

유지방전기간은 대향하고 있는 모든 어드레스 전극과 모든 서스테인 전극에 서로 위상이 반대인 서스테인펄스(31, 41)를 지속적으로 인가한다. 이 때, 상술한 어드레스방전기간에 벽전하가 발생된 방전셀은 일정 수준의 벽전압(Wall Voltage)이 유지되고 있어 이 벽전압(Vw)과 서스테인펄스에 의한 방전유지전압(Vs)이 중첩되어 방전셀 내에 방전임계전압(Vb) 이상의 전위차가 발생된다. 결국, 모든 어드레스 전극과 모든 서스테인 전극에 동시에 서스테인펄스를 인가하더라도 모든 방전셀에 방전이 유지되는 것이 아니라, 어드레스방전기간에 벽전하가 발생된 방전셀에만 방전이 유지되는 것이다. 이러한 원리를 이용하여 AC형 피디피에서 화면의 각 셀이 선택적으로 발광되는 것이다.In the sustain discharge period, sustain pulses 31 and 41 which are out of phase with each other are continuously applied to all of the address electrodes and all the sustain electrodes that are opposed to each other. At this time, the discharge cells in which the wall charges are generated in the above-described address discharge period are kept at a predetermined wall voltage, so that the wall voltage Vw and the discharge sustain voltage Vs due to the sustain pulse are overlapped. A potential difference equal to or greater than the discharge threshold voltage Vb is generated in the discharge cell. As a result, even when sustain pulses are simultaneously applied to all address electrodes and all sustain electrodes, the discharge is not maintained in all the discharge cells, but only in the discharge cells in which wall charges are generated during the address discharge period. Using this principle, each cell of the screen selectively emits light in an AC PD.

이러한 AC형 피디피 외에 전극을 방전공간 중에 노출시켜 구성한 DC형 피디피가 있다. DC형 피디피 패널의 구조는 도 3에 도시된 것과 같이 복수개의 매트릭스 전극들로 구성되는데, 복수개의 캐소드(50)와 캐소드에 직교하는 복수개의 표시애노드(60), 그리고 복수개의 보조캐소드(70)로 구성된다.In addition to the AC type PD, there is a DC type PD formed by exposing an electrode in a discharge space. As shown in FIG. 3, the structure of the DC PD panel includes a plurality of matrix electrodes, a plurality of cathodes 50, a plurality of display anodes 60 orthogonal to the cathodes, and a plurality of auxiliary cathodes 70. It consists of.

캐소드(50)와 애노드(60, 70)는 격벽(23)에 의해 구분되며, 표시방전셀(80)의 공간과 보조방전셀(80')의 공간이 각각 구성된다. 대부분의 격벽(23)과 유리기판(10, 20) 사이는 일정한 거리의 공간으로 구성되어 프라이밍 경로(priming path)를 형성한다. 이 프라이밍 경로는 보조방전셀(80')에서 발생된 보조방전을 표시방전셀(80)로 유입시킨다.The cathode 50 and the anodes 60 and 70 are divided by the partition wall 23, and the space of the display discharge cell 80 and the space of the auxiliary discharge cell 80 ′ are respectively configured. Most barrier ribs 23 and the glass substrates 10 and 20 are composed of a space of a predetermined distance to form a priming path. The priming path flows the auxiliary discharge generated in the auxiliary discharge cell 80 'into the display discharge cell 80.

이러한 구조의 DC형 피디피는 펄스메모리시스템(pulse memory system)을 이용하는데, 펄스메모리시스템을 구동하기 위한 방법은 도 4에 도시된 것과 같다. 도 5의 유지방전펄스(90)는 항상 캐소드로 인가되고, 주사펄스(95)가 첫번째 캐소드로부터 차례로 인가된다.The DC type PD of this structure uses a pulse memory system, and a method for driving the pulse memory system is as shown in FIG. The sustain discharge pulse 90 of Fig. 5 is always applied to the cathode, and the scanning pulse 95 is applied in turn from the first cathode.

보조방전은 항상 보조방전셀(80')에 주사펄스(95')가 인가될 때마다 일어난다. 그리고, 이 보조방전셀(80')의 방전은 연속적으로 인접한 보조방전셀로 이동하게 된다. 이 때, 인접한 보조방전셀(80')로 이동된 방전은 하전입자들을 발생시키고, 그 하전입자들은 프라이밍 경로를 통해 인접한 표시방전셀(80)로 확산되어 표시방전셀의 점화에 걸리는 지연시간을 감소시킨다.The secondary discharge always occurs whenever the scan pulse 95 'is applied to the secondary discharge cell 80'. Then, the discharge of the auxiliary discharge cell 80 'continuously moves to adjacent adjacent discharge cells. At this time, the discharge moved to the adjacent secondary discharge cell 80 'generates charged particles, and the charged particles diffuse through the priming path to the adjacent display discharge cell 80 to delay the ignition of the display discharge cell. Decrease.

주사펄스(95)가 캐소드(50)에 인가되는 중에 표시애노드(60)에 인가된 데이터펄스(93)는 표시방전을 일으키기 위한 보조방전, 즉 프라이밍 경로의 도움을 받는다. 따라서, 표시방전셀(80)의 방전전압이 낮아지므로, 한번 어드레스된 셀은 유지방전펄스(90)의 인가만으로 방전을 지속하게 된다.While the scan pulse 95 is applied to the cathode 50, the data pulse 93 applied to the display anode 60 is assisted by an auxiliary discharge, that is, a priming path, to cause a display discharge. Therefore, since the discharge voltage of the display discharge cell 80 is lowered, the once addressed cell continues to be discharged only by applying the sustain discharge pulse 90.

그런데, 종래의 AC형 대향방전 피디피는 유지방전기간 중에 양전극에 인가되는 유지방전파형이 서로 반대의 위상을 가지고 있어, 방전이 지속되는 동안에 양전극은 이온으로 인한 충격을 받는 문제가 있다. 이러한 충격으로 인해 종래의 AC형 대향방전 피디피는 전극과 유전층이 손상되고, 형광체의 열화로 인해 제품의 수명이 짧아지는 문제점이 있다.However, in the conventional AC type opposite discharge PD, the sustain discharge waveforms applied to the positive electrodes during the sustain discharge period have opposite phases, so that the positive electrodes are impacted by ions while the discharge is sustained. Due to such a shock, the conventional AC type opposite discharge PD has a problem that the electrode and the dielectric layer are damaged, and the life of the product is shortened due to deterioration of the phosphor.

또, 종래의 DC형 피디피는 보조방전셀로 인해 표시방전셀의 면적비율이 줄어, 피디피의 휘도가 저하되고 화소의 개수가 감소하여 고해상도를 구현하기 어려운 문제점을 갖고 있다. 또, 전극이 방전공간에 노출되어 있어 전극과 형광체에 이온이 직접 충돌하므로, 수명이 짧아지는 문제점도 가지고 있다.In addition, the conventional DC-type PDPD has a problem in that the area ratio of the display discharge cell is reduced due to the auxiliary discharge cell, the luminance of the PD is reduced, and the number of pixels is reduced, making it difficult to realize high resolution. In addition, since the electrode is exposed to the discharge space and ions collide directly with the electrode and the phosphor, there is a problem in that the lifetime is shortened.

본 발명은 이러한 문제점을 해결하기 위한 것으로, 피디피의 화질을 개선하고 피디피의 수명을 종래보다 더 연장시키기 위한 피디피 구동방법을 제공하는 데에 그 목적이 있다.SUMMARY OF THE INVENTION The present invention has been made to solve such a problem, and an object thereof is to provide a PDP driving method for improving the image quality of a PD and extending the life of the PD.

도 1은 일반적인 AC형 플라즈마 디스플레이 패널의 개략적인 구조를 도시한 도면.1 is a view showing a schematic structure of a typical AC plasma display panel.

도 2는 상기 도 1의 플라즈마 디스플레이 패널의 각 전극에 인가되는 펄스의 파형을 도시한 도면.2 illustrates waveforms of pulses applied to the electrodes of the plasma display panel of FIG.

도 3는 DC형 플라즈마 디스플레이 패널의 개략적인 구조를 도시한 도면.3 shows a schematic structure of a DC plasma display panel;

도 4는 상기 도 3에 도시된 DC형 플라즈마 디스플레이 패널의 각 전극에 인가되는 펄스의 파형을 도시한 도면.4 illustrates waveforms of pulses applied to the electrodes of the DC plasma display panel shown in FIG. 3;

도 5은 본 발명이 실시되는 플라즈마 디스플레이 패널의 구조를 도시한 것으로서, 두 장의 유리기판이 합착되고 전극이 대향하도록 형성된 것을 도시한 도면.FIG. 5 illustrates a structure of a plasma display panel in which the present invention is implemented, in which two glass substrates are bonded to each other and electrodes are formed to face each other.

도 6은 본 발명의 구동방법을 도시한 것으로서, 플라즈마 디스플레이 패널의 각 전극에 인가되는 펄스의 파형을 도시한 도면.FIG. 6 is a diagram showing a driving method of the present invention, showing waveforms of pulses applied to respective electrodes of a plasma display panel; FIG.

도 7은 상기 도 6에 도시된 펄스에 의해 플라즈마 디스플레이 패널의 각 방전셀에 유지되는 전위차를 도시한 도면.FIG. 7 is a diagram showing a potential difference held in each discharge cell of the plasma display panel by the pulse shown in FIG.

도 8a 내지 도 8d는 상기 도 7에 의해 동작하는 방전셀의 상태를 도시한 도면.8A to 8D are diagrams showing the state of the discharge cell operated by FIG.

도면의 주요부분에 대한 부호의 설명Explanation of symbols for main parts of the drawings

100 : 상판 110 : 서스테인 전극100: top plate 110: sustain electrode

200 : 하판 210 : 어드레스 전극200: lower plate 210: address electrode

300 : 제 1 전압펄스 310 : 제 2 전압펄스300: first voltage pulse 310: second voltage pulse

320 : 스캔펄스 330 : 데이터펄스320: scan pulse 330: data pulse

340 : 제 3 전압펄스 350 : 제 4 전압펄스340: third voltage pulse 350: fourth voltage pulse

400 : 음의 벽전하 410 : 양의 벽전하400: negative wall charge 410: positive wall charge

430 : 공간전하 440 : 준안정원자430: space charge 440: metastable garden

본 발명의 피디피 구동방법은 하나의 서브필드의 방전기간 중에 어드레스 전극에 인가되는 전압과 서스테인 전극에 인가되는 전압의 인가시점을 다르게 하여 어드레스 전극과 서스테인 전극 사이의 방전에 의해 발생된 이온의 충격을 최소화하는 것이 특징이다.In the PDP driving method of the present invention, an impact point of ions generated by the discharge between the address electrode and the sustain electrode is different from the time point at which the voltage applied to the address electrode and the voltage applied to the sustain electrode are applied during the discharge period of one subfield. It is characterized by minimizing.

본 발명의 구동방법이 실시되는 피디피는 도 5에 도시된 것과 같이 하판(200)과 상판(100)이 합착된 구조로 되어 있다. 하판(200)에는 어드레스 전극(210)이 연속하여 형성되어 있고, 상판(100)에는 서스테인 전극(110)이 하판의 어드레스 전극에 직교하는 방향으로 연속하여 형성되어 있다. 그리고, 어드레스 전극과 서스테인 전극의 교차부에 방전셀(220)이 격벽으로 구분되어 형성되어 있고, 그 방전셀 내부에는 네온(Ne), 아르곤(Ar), 제논(Xe) 등의 불활성가스가 혼합되어 봉입되어 있다. 본 발명의 구동방법이 실시되는 피디피의 구조는 종래의 피디피와 동일하므로, 피디피의 구조에 대한 상세한 설명은 생략하도록 한다.The PDP in which the driving method of the present invention is implemented has a structure in which the lower plate 200 and the upper plate 100 are bonded as shown in FIG. 5. The address electrode 210 is continuously formed in the lower plate 200, and the sustain electrode 110 is formed continuously in the direction perpendicular to the address electrode of the lower plate in the upper plate 100. Discharge cells 220 are divided into partitions at the intersections of the address electrodes and the sustain electrodes, and inert gases such as neon (Ne), argon (Ar), and xenon (Xe) are mixed in the discharge cells. It is sealed. Since the structure of the PDP to which the driving method of the present invention is implemented is the same as that of the conventional PDP, a detailed description of the structure of the PDIP will be omitted.

본 발명의 플라즈마 디스플레이 패널의 구동방법에서 가장 바람직한 실시예는 방전셀의 방전을 유지시키기 위해 어드레스 전극에 인가하는 제 3 펄스의 턴온기간을 서스테인 전극에 인가하는 제 4 펄스의 턴온기간보다 짧게 하는 것이다. 즉, 본 발명에 의해 어드레스 전극에 인가되는 제 3 펄스의 펄스폭이 서스테인 전극에 인가되는 제 4 펄스의 펄스폭보다 좁다.The most preferred embodiment of the method of driving the plasma display panel of the present invention is to make the turn-on period of the third pulse applied to the address electrode shorter than the turn-on period of the fourth pulse applied to the sustain electrode in order to maintain the discharge of the discharge cells. . That is, according to the present invention, the pulse width of the third pulse applied to the address electrode is smaller than the pulse width of the fourth pulse applied to the sustain electrode.

그리고, 본 발명에 의해 어드레스 전극에 인가되는 제 3 전압펄스가 턴온되는 시점이 서스테인 전극에 인가되는 제 4 전압펄스가 턴온되는 시점보다 빠르다. 이 때, 제 3 전압펄스의 턴온기간은 1.5 마이크로 초 이내이고, 제 3 전압펄스가 턴오프되는 시점과 제 4 전압펄스가 턴오프되는 시점의 시간차이는 2 마이크로 초 내외이다. 따라서, 본 발명은 피디피의 유지방전기간 중에 유지방전펄스가 도 7에 도시된 것과 같이 나타난다.Further, according to the present invention, the time point at which the third voltage pulse applied to the address electrode is turned on is earlier than the time point at which the fourth voltage pulse applied to the sustain electrode is turned on. At this time, the turn-on period of the third voltage pulse is within 1.5 microseconds, and the time difference between the time when the third voltage pulse is turned off and the time when the fourth voltage pulse is turned off is about 2 micro seconds. Therefore, the present invention shows the sustain discharge pulse as shown in FIG. 7 during the sustain discharge period of the PD.

이하, 본 발명의 바람직한 일 실시예를 통해 본 발명에 의한 피디피의 구동방법에 대해 상세히 설명하도록 한다.Hereinafter, a method of driving PDIP according to the present invention will be described in detail with reference to a preferred embodiment of the present invention.

(실시예)(Example)

본 발명의 실시예는 어드레스 전극에 제 1 전압펄스를 인가하고 제 1 전압펄스가 하이(high)를 유지하는 기간 중에 서스테인 전극에 제 2 전압펄스를 인가하는 단계와, 서스테인 전극의 일부에 스캔펄스를 인가하고 스캔펄스가 인가될 때마다 어드레스 전극에 데이터펄스를 인가하는 단계, 그리고 어드레스 전극에 제 1 전압펄스보다 낮은 전위의 제 3 전압펄스를 인가하고 제 3 전압펄스가 하이(high)를 유지하는 기간 중에 서스테인 전극에 제 4 전압펄스를 인가하는 단계를 포함하여 이루어져 있다.An embodiment of the present invention provides a method of applying a first voltage pulse to an address electrode and applying a second voltage pulse to the sustain electrode during a period in which the first voltage pulse is kept high, and a scan pulse to a portion of the sustain electrode. And applying a data pulse to the address electrode each time a scan pulse is applied, and applying a third voltage pulse having a lower potential than the first voltage pulse to the address electrode and keeping the third voltage pulse high. And applying a fourth voltage pulse to the sustain electrode during the period of time.

이하, 본 발명의 실시예의 피디피 구동방법에 대하여 첨부된 도 6과 도 7을 참조하여 설명하도록 한다. 본 발명의 실시예의 피디피 구동방법은 도 6에 도시된 것과 같이 하나의 서브필드를 리셋방전기간과, 어드레스 방전기간, 그리고 유지방전기간으로 구분하고, 유지방전기간 중에 서스테인 전극에 인가되는 펄스의 폭과 어드레스 전극에 인가되는 펄스의 폭을 다르게 한다. 즉, 본 발명은 피디피의 유지방전기간 중에 상호교번으로 인가되는 펄스의 폭이 서로 다른 것이 특징이다.Hereinafter, a PDP driving method of an embodiment of the present invention will be described with reference to FIGS. 6 and 7. In the PDD driving method according to the embodiment of the present invention, as shown in FIG. 6, one subfield is divided into a reset discharge period, an address discharge period, and a sustain discharge period, and a width of a pulse applied to the sustain electrode during the sustain discharge period. And widths of pulses applied to the address electrodes are varied. That is, the present invention is characterized in that the widths of the pulses applied to each other alternately during the sustain discharge period of the PD.

먼저, 리셋방전기간에 본 발명의 실시예에 의한 피디피 구동회로는 피디피의 모든 어드레스 전극에 소정의 제 1 전압펄스(300)를 동시에 인가하고, 제 1 전압펄스의 온(on) 기간 동안에 피디피의 모든 서스테인 전극에 제 1 전압펄스보다 펄스폭이 큰 제 2 전압펄스(310)를 인가한다. 이 때, 제 1 전압펄스의 상승시점과 제 2 전압펄스의 상승시점은 도 7에 도시된 것과 같이 약간의 시차를 갖는다. 즉, 제 1 전압펄스의 하이(high)구간 중에 제 2 전압펄스가 상승하고, 제 2 전압펄스의 하이(high)구간 중에 제 1 전압펄스가 하강하는 것이다. 그 결과, 피디피의 모든 방전셀에 방전이 발생되어 각 전극의 표면에 벽전하가 형성된다. 이 때, 모든 방전셀의 벽전하가 균일하게 형성된다.First, in the reset discharge period, the PDP driving circuit according to the embodiment of the present invention simultaneously applies a predetermined first voltage pulse 300 to all the address electrodes of the PD, and during the ON period of the first voltage pulse, The second voltage pulse 310 having a larger pulse width than the first voltage pulse is applied to all the sustain electrodes. At this time, the rising time of the first voltage pulse and the rising time of the second voltage pulse have a slight time difference as shown in FIG. That is, the second voltage pulse rises during the high section of the first voltage pulse, and the first voltage pulse falls during the high section of the second voltage pulse. As a result, discharge is generated in all the discharge cells of the PD, and wall charges are formed on the surface of each electrode. At this time, wall charges of all the discharge cells are uniformly formed.

그리고, 어드레스 방전기간에 본 발명의 실시예에 의한 피디피 구동회로는 피디피의 서스테인 전극 중, 벽전하를 소거할 서스테인 전극에 차례로 스캔펄스(320)를 인가하고, 서스테인 전극에 스캔펄스가 인가될 때마다 피디피의 발광시킬 셀을 제외한 모든 셀에 스캔펄스 위상의 반대 위상의 데이터펄스(330)를 인가한다. 그 결과, 스캔펄스가 인가된 서스테인 전극과 데이터펄스가 인가된 어드레스 전극의 교차부에 이루어진 방전셀에 형성된 벽전하가 소거된다. 이 때, 선택적으로 하이(high) 값을 갖는 데이터펄스와 스캔펄스에 의해 방전셀이 선택적으로 방전한다. 따라서, 이러한 선택적인 방전 동작으로 이해 피디피의 화소의 발광여부가 선택된다.In the PD discharge driving circuit according to the embodiment of the present invention, the scan pulse 320 is sequentially applied to the sustain electrodes of the PD electrodes in which the wall charges are to be erased, and the scan pulses are applied to the sustain electrodes. The data pulse 330 of a phase opposite to that of the scan pulse phase is applied to all cells except for cells to emit light of the PD. As a result, the wall charges formed in the discharge cells formed at the intersections of the sustain electrodes to which the scan pulses are applied and the address electrodes to which the data pulses are applied are erased. At this time, the discharge cells are selectively discharged by data pulses and scan pulses having a selectively high value. Therefore, the light emission of the pixel of the PDP is selected by this selective discharge operation.

그 후, 유지방전기간에 본 발명의 실시예에 의한 피디피 구동회로는 피디피의 모든 어드레스 전극에 동시에 제 3 전압펄스(340)를 인가하고, 제 3 전압펄스의 온(on) 기간 동안에 피디피의 모든 서스테인 전극에 제 3 전압펄스보다 펄스폭이 큰 제 4 전압펄스(350)를 동시에 인가한다. 이 때에도 리셋방전기간과 마찬가지로 제 3 전압펄스의 상승시점과 제 4 전압펄스의 상승시점은 도 7에 도시된 것과 같이 약간의 시차를 갖는다. 즉, 제 3 전압펄스의 하이(high)구간 중에 제 4 전압펄스가 상승하고, 제 4 전압펄스의 하이(high)구간 중에 제 3 전압펄스가 하강하는 것이다. 그 결과, 어드레스 방전기간에 지정된 화소의 방전이 지속적으로 유지된다.Then, in the sustain discharge period, the PDP drive circuit according to the embodiment of the present invention applies the third voltage pulse 340 to all the address electrodes of the PDP at the same time, and during the on period of the third voltage pulse, The fourth voltage pulse 350 having a larger pulse width than the third voltage pulse is simultaneously applied to the sustain electrode. At this time, as in the reset discharge period, the rise time of the third voltage pulse and the rise time of the fourth voltage pulse have a slight time difference as shown in FIG. That is, the fourth voltage pulse rises during the high section of the third voltage pulse, and the third voltage pulse falls during the high section of the fourth voltage pulse. As a result, the discharge of the pixel specified in the address discharge period is maintained continuously.

이 때, 제 3 전압펄스(340)의 전위(Vs)는 제 1 전압펄스(300)의 전위(Vr)보다 일반적으로 낮다. 그 이유는 제 1 전압펄스가 인가되는 시점의 방전셀 내부에 벽전하가 형성되어 있지 않기 때문이다. 제 3 전압펄스가 인가되는 시점의 방전셀 내부에는 제 1 전압펄스에 의한 벽전하가 형성되어 있으므로, 방전에 필요한 전압이 제 1 전압펄스가 인가되는 시점보다 낮다.At this time, the potential Vs of the third voltage pulse 340 is generally lower than the potential Vr of the first voltage pulse 300. This is because no wall charge is formed inside the discharge cell at the time when the first voltage pulse is applied. Since the wall charges by the first voltage pulse are formed inside the discharge cell at the time when the third voltage pulse is applied, the voltage required for discharge is lower than the time when the first voltage pulse is applied.

본 발명의 실시예의 피디피 구동방법이 종래의 피디피 구동방법에 비해 개선된 점은 유지방전기간에 서스테인 전극에 인가되는 펄스의 전위를 낮출 수 있고, 방전과정에서 전극과 유전체 및 형광체에 가해지는 이온충격이 감소되는 점이다. 이하, 그 이유와 본 발명의 실시예의 동작원리 및 동작과정을 첨부된 도 7와 도 8을 참조하여 설명하도록 한다.The improvement of the PDP driving method according to the embodiment of the present invention over the conventional PDP driving method can lower the potential of the pulse applied to the sustain electrode during the sustain discharge period, and the ion shock applied to the electrode, the dielectric, and the phosphor during the discharge process. This is the point that is reduced. Hereinafter, the reason and the operation principle and operation of the embodiment of the present invention will be described with reference to FIGS. 7 and 8.

먼저, 피디피에서 발광되는 셀은 리셋방전기간과 어드레스 방전기간을 거치면서 벽전하가 형성되어 도 8a와 같은 상태가 된다. 즉, 어드레스 전극(210)과 서스테인 전극(110)에 서로 반대의 극성을 띤 벽전하(400, 410)가 축적된다. 따라서, 어드레스 전극(210)과 서스테인 전극(110) 사이의 방전영역에 벽전하에 의한 벽전압 Vw가 유지된다.First, the cell that emits light in the PD is formed with wall charges through the reset discharge period and the address discharge period, thereby bringing a state as shown in FIG. 8A. That is, wall charges 400 and 410 having opposite polarities are accumulated in the address electrode 210 and the sustain electrode 110. Therefore, the wall voltage Vw due to wall charge is maintained in the discharge region between the address electrode 210 and the sustain electrode 110.

그 후, 도 7의 t1 과 t2 사이 구간 동안, 어드레스 전극(210)에 제 3 전압펄스(340) 즉, 유지전압 Vs가 인가되면, 유지전압과 벽전압이 중첩되어 방전영역에 인가된다. 그 결과, 방전영역은 유지전압과 벽전압의 중첩된 전압에 의해 도 8b에 도시된 것과 같이 1차 방전이 발생되고, 1차 방전이 실시된 방전영역에 공간전하와 준안정원자들이 다수 발생한다.Thereafter, when the third voltage pulse 340, that is, the sustain voltage Vs is applied to the address electrode 210 during the period between t1 and t2 of FIG. 7, the sustain voltage and the wall voltage are overlapped and applied to the discharge region. As a result, primary discharge is generated in the discharge region as shown in FIG. 8B by the overlapping voltage of the sustain voltage and the wall voltage, and a large number of space charges and metastable atoms are generated in the discharge region where the primary discharge is performed. .

그리고, 도 7의 t2 와 t3 사이 구간에 서스테인 전극에 어드레스 전압과 방전이 발생하지 않도록 전압을 조절하는 제 4 전압펄스(350)가 인가되면, 어드레스 전극(210)과 서스테인 전극(110) 사이에 전위차가 발생하지 않아 도 8c에 도시된 것과 같이 준안정원자(440)와 공간전하(430)들이 지속적으로 유지된다. 따라서, 방전셀은 t2 와 t3 사이 구간에서 전기적으로 도통된 상태를 유지한다.In addition, when a fourth voltage pulse 350 is applied to adjust the voltage so that the address voltage and the discharge are not generated in the sustain electrode in the interval between t2 and t3 of FIG. 7, between the address electrode 210 and the sustain electrode 110. Since the potential difference does not occur, the metastable atoms 440 and the space charges 430 are continuously maintained as shown in FIG. 8C. Therefore, the discharge cell maintains an electrically conducting state in the interval between t2 and t3.

도 7의 t3 와 t4 사이 구간은 서스테인 전극에 제 4 전압펄스(350)가 계속 인가되어 t3에서 2차방전이 발생된다. 이 구간은 t1 과 t2 사이의 구간에서 발생된 방전에 의해 생성된 공간전하와 준안정원자들에 의해 t1 과 t2 사이 구간에서 발생된 방전보다 훨씬 낮은 전압에서 방전이 발생되는 효과가 있다. 즉, 1차 방전시 전극 양단에 인가된 전위차보다 2차 방전 시 전극 양단에 인가된 전위차가 훨씬 낮다는 것이다. 이러한 효과가 바로 프라이밍 효과(priming effect)이다.In the section between t3 and t4 of FIG. 7, the fourth voltage pulse 350 is continuously applied to the sustain electrode to generate a secondary discharge at t3. This section has the effect that the discharge occurs at a voltage much lower than the discharge generated in the section between t1 and t2 by the space charge and metastable atoms generated by the discharge generated in the section between t1 and t2. That is, the potential difference applied to the both ends of the electrode during the secondary discharge is much lower than the potential difference applied to the both ends of the electrode during the primary discharge. This effect is the priming effect.

프라이밍 효과는 도 8b에 도시된 것과 같이 벽전하에 의한 1차 방전 후에 발생된 다수개의 준안정원자(440)과 공간전하(430) 들이 소정의 전위차를 유지함으로써, 2차 방전을 일으키기 위해 외부 구동회로에서 인가하는 방전유지전압을 낮추는 효과이다. 즉, 준안정원자와 공간전하들이 유지하는 전위차가 Vp 이고, 2차 방전을 일으키기 위해 어드레스 전극과 서스테인 전극 사이에 유지되야할 전압이 Vb 라면, 1차 방전을 일으키기 위해 외부 구동회로는 최소 Vb 이상의 전위를 갖는 방전개시전압(Vs)을 인가해야 했으나, 2차 방전을 일으키기 위해서는 Vb-Vp 의 전위 이상을 갖는 방전유지전압을 인가하면 된다. 따라서, 1차 방전을 일으키기 위해 외부 구동회로가 인가하는 방전개시전압보다 2차 방전을 일으키기 위해 외부 구동회로가 인가하는 방전유지전압이 더 낮다.As shown in FIG. 8B, the priming effect is achieved by driving the external driving circuit to generate the secondary discharge by maintaining the predetermined potential difference between the plurality of metastable atoms 440 and the space charges 430 generated after the primary discharge by the wall charge. This is the effect of lowering the discharge holding voltage applied in the furnace. That is, if the potential difference held by the metastable atoms and the space charges is Vp, and the voltage to be maintained between the address electrode and the sustain electrode to cause the secondary discharge is Vb, the external drive circuit must be at least Vb to generate the primary discharge. A discharge start voltage Vs having a potential was to be applied, but a discharge holding voltage having a potential higher than or equal to Vb-Vp may be applied to cause secondary discharge. Therefore, the discharge holding voltage applied by the external drive circuit to generate the secondary discharge is lower than the discharge start voltage applied by the external drive circuit to cause the primary discharge.

그 후, 도 8d에 도시된 것과 같이 방전셀 내의 어드레스 전극(210)과 서스테인 전극(110) 표면에는 서로 반대의 극성을 띤 벽전하(400, 410)가 다시 발생되고, 이 벽전하는 다시 방전영역에 벽전압을 유지시킨다. t5 이후 구간은 t1 과 t4 사이의 구간의 현상이 계속 반복된다. 그 결과, 본 발명의 실시예의 피디피 구동방법은 각 전극의 이온충격을 감소시키고, 형광체의 열화를 방지할 수 있으므로, 피디피의 수명이 종래보다 연장된다.Thereafter, as shown in FIG. 8D, wall charges 400 and 410 having opposite polarities are again generated on the surface of the address electrode 210 and the sustain electrode 110 in the discharge cell, and the wall charges are discharged again. Maintain wall voltage at In the interval after t5, the phenomenon of the interval between t1 and t4 is repeated. As a result, the PDP driving method of the embodiment of the present invention can reduce the ion impact of each electrode and prevent the degradation of the phosphor, so that the PDIP life is extended than before.

이 때, 각 전극에 인가되는 펄스의 폭은 전극의 면적이나, 격벽의 구조, 방전가스의 특성 등, 다양한 주변환경에 따라 다르지만, t1 구간에서 t2 구간 사이 시간은 플라즈마 및 준안정원자가 소거되지 않는 범위 내의 시간으로 설정되도록 어드레스 전극과 서스테인 전극의 펄스폭을 조절한다. 그리고, t3 구간에서 t4 구간 사이 시간은 벽전하를 안정적으로 형성할 수 있는 범위의 시간으로 설정되도록 어드레스 전극과 서스테인 전극의 펄스폭을 조절한다. 대략, t1 구간과 t2 구간 사이의 시간은 통상 1.5 마이크로 초 이내로 하고, t3 구간과 t4 구간 사이의 시간은 통상 2 마이크로 초 이상으로 한다.At this time, the width of the pulse applied to each electrode varies depending on the area of the electrode, the structure of the barrier rib, the characteristics of the discharge gas, etc., but the time between the t1 and t2 sections does not eliminate plasma and metastable atoms. The pulse widths of the address electrode and the sustain electrode are adjusted to be set to a time within the range. Then, the time period between the period t3 and t4 is adjusted to the time of the range in which the wall charge can be formed stably to adjust the pulse width of the address electrode and the sustain electrode. In general, the time between the t1 and t2 sections is usually within 1.5 microseconds, and the time between the t3 and t4 sections is usually 2 microseconds or more.

방전전압이 낮아지면, 전극, 유전체 및 형광체에 대한 이온충격이 감소되어 피디피의 수명이 길어진다. 그 이유는 다음과 같다.When the discharge voltage is lowered, the ion impact on the electrode, the dielectric, and the phosphor is reduced, and the lifetime of the PD is extended. The reason for this is as follows.

먼저, 방전공간 내의 데이터전극과 서스테인전극 사이에서 인가전압에 의해 이동하는 이온의 이동속도는 다음의 수학식 1과 같다.First, the moving speed of the ions moving by the applied voltage between the data electrode and the sustain electrode in the discharge space is expressed by the following equation (1).

그리고, 이 때 이온의 이동거리는 수학식 2와 같다.At this time, the moving distance of the ions is shown in Equation (2).

또, 다음의 수학식 3이 성립한다.In addition, the following equation (3) holds.

따라서, 거리 s 만큼 이동한 이온의 운동에너지는 수학식 4에 나타낸 것과 같다.Therefore, the kinetic energy of the ions moved by the distance s is as shown in equation (4).

이 때, 이므로, 수학식 4는 수학식 5로 다시 표현된다.At this time, Equation 4 is represented by Equation 5 again.

수학식 5는 속도를 기준으로 수학식 6으로 표현된다.Equation 5 is expressed by Equation 6 based on the speed.

수학식 6에 표현된 바와 같이 이온의 속도는 외부에서 인가된 전압에 비례한다. 그리고, 이 때 전극과 형광체가 이온의 운동에너지에 의해 받는 충격량은 수학식 7과 같다.As expressed in Equation 6, the velocity of the ions is proportional to the voltage applied from the outside. At this time, the amount of impact the electrode and the phosphor receive by the kinetic energy of ions is expressed by Equation (7).

FΔt=mVFΔt = mV

수학식 6에 표현된 바와 같이 이온이 이동하는 속도는 외부에서 인가된 전압에 비례하고, 수학식 7에 표현된 바와 같이 전극과 형광체가 받는 충격량은 이온의 속도에 비례한다.As shown in Equation 6, the speed at which ions move is proportional to the voltage applied from the outside, and as shown in Equation 7, the amount of impact received by the electrode and the phosphor is proportional to the speed of the ions.

그 결과, 본 발명은 프라이밍 효과에 의해 낮은 전압으로 2차방전을 일으킬 수 있다. 낮은 전압에 의한 방전은 전극과 유전층 및 형광체에 가해지는 이온의 충격을 감소시키므로, 피디피의 수명이 길어지는 효과가 있다.As a result, the present invention can cause secondary discharge at low voltage by the priming effect. The discharge by the low voltage reduces the impact of ions applied to the electrode, the dielectric layer and the phosphor, and thus has an effect of extending the life of the PD.

본 발명의 실시예에 의한 피디피 구동방법은 유지방전기간 동안에 어드레스 전극과 서스테인 전극에 인가되는 펄스를 리셋방전기간일 때에도 동일하게 인가할 수도 있다.In the PDP driving method according to the embodiment of the present invention, pulses applied to the address electrode and the sustain electrode during the sustain discharge period may be applied in the same manner during the reset discharge period.

그리고, 본 발명의 유지방전단계에서 서로 다른 폭의 펄스를 인가하는 효과는 대향방전방식의 피디피 뿐만 아니라, 다른 형태의 AC 피디피의 유지방전기간에도 적용할 수 있다. 따라서, 본 발명의 유지방전단계는 여러 형태의 피디피에서 문제가 되던 전극, 형광체, 그리고 유전체층의 열화문제를 해결할 수 있는 효과가 있다.In addition, the effect of applying pulses having different widths in the sustain discharge step of the present invention can be applied not only to the PD of the opposite discharge type but also to the sustain discharge period of other types of AC PDs. Therefore, the sustain discharge step of the present invention can solve the problem of deterioration of the electrode, the phosphor, and the dielectric layer, which is a problem in various types of PD.

본 발명의 피디피 구동방법은 종래의 피디피 구동방법에 비해 전극에 가해지는 이온충격이 줄고, 형광체의 열화가 방지되어 컬러 피디피의 화질을 개선할 수 있으며, 피디피의 수명을 연장시키는 효과가 있다. 그리고, 종래의 피디피 구동방법에 비해 더 낮은 유지방전펄스를 인가함으로써 소비전력이 줄어드는 효과가 있다.Compared to the conventional PDP driving method, the PDP driving method of the present invention reduces the ion impact applied to the electrode, prevents deterioration of the phosphor, and improves the image quality of the color PD, and has an effect of extending the life of the PD. In addition, power consumption is reduced by applying a lower sustain discharge pulse than the conventional PD drive method.

Claims (7)

일측 기판에 형성된 복수개의 어드레스전극과, 상기 기판에 대향하는 타측 기판에 상기 어드레스전극과 직교하도록 형성된 복수개의 서스테인전극과, 상기 어드레스전극과 서스테인전극의 교차부에 형성된 방전셀을 포함하는 AC형 플라즈마 디스플레이 패널구조와, 상호교번으로 펄스를 인가하여 상기 방전셀의 벽전하를 균일하게 하는 리세트단계; 상기 복수개의 서스테인전극에 스캔펄스가 인가되고 상기 스캔펄스가 인가될 때마다 상기 복수개의 어드레스전극에 인가되는 데이터펄스에 의해서 화소를 지정하는 어드레스단계; 상호 교번으로 펄스를 인가하여 방전을 유지시켜 화상을 구현하는 유지방전단계로 이루어진 구동방법에 있어서,An AC plasma including a plurality of address electrodes formed on one substrate, a plurality of sustain electrodes formed on the other substrate facing the substrate so as to be orthogonal to the address electrodes, and discharge cells formed at intersections of the address electrodes and the sustain electrodes; A reset step of applying a pulse to the display panel structure alternately to make the wall charges of the discharge cells uniform; An address step of specifying a pixel by data pulses applied to the plurality of address electrodes whenever scan pulses are applied to the plurality of sustain electrodes and the scan pulses are applied; In the driving method comprising a sustain discharge step of implementing an image by applying a pulse alternately to maintain a discharge, 상기 유지방전단계에서 상호교번으로 인가되는 펄스가 폭이 서로 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.And the pulses applied alternately in the sustain discharge step have different widths. 제 1 항에 있어서, 상기 유지방전단계에서 상호교번으로 인가되는 펄스 중 하나의 펄스가 온(on)되고, 소정의 시간 후에 다른 하나의 펄스가 온(on)되어 방전을 유지하는 단계를 포함하여 이루어진 플라즈마 디스플레이 패널의 구동방법.The method of claim 1, further comprising: maintaining one of the pulses that are alternately applied in the sustain discharge step, and the other pulse is turned on after a predetermined time to maintain the discharge. A method of driving a plasma display panel. 제 2 항에 있어서, 상기 하나의 펄스폭이 다른 하나의 펄스폭보다 작거나 같은 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.The method of claim 2, wherein the one pulse width is less than or equal to the other pulse width. 제 1 항에 있어서, 상기 리세트 단계에서 상호교번으로 인가되는 펄스 중 하나의 펄스가 온(on)되고, 소정의 시간 후에 다른 하나의 펄스가 온(on)되어 방전을 유지하는 단계를 포함하여 이루어진 플라즈마 디스플레이 패널의 구동방법.The method of claim 1, further comprising the steps of: one of the pulses applied alternately in the reset step is turned on, and after a predetermined time, the other pulse is turned on to maintain the discharge; A method of driving a plasma display panel. 제 4 항에 있어서, 상기 하나의 펄스폭이 다른 하나의 펄스 폭보다 작거나 같은 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.The method of claim 4, wherein the one pulse width is less than or equal to the other pulse width. 제 2 항, 제 3 항, 그리고 제 4 항 중 어느 한 항에 있어서, 상기 소정의 시간은 1.5 마이크로 초 이내인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.5. A method for driving a plasma display panel according to any one of claims 2, 3 and 4, wherein the predetermined time is within 1.5 microseconds. 제 2 항, 제 3 항, 그리고 제 4 항 중 어느 한 항에 있어서, 상기 하나의 펄스가 하강하는 시점과 다른 하나의 펄스가 하강하는 시점의 시간차이는 2 마이크로 초 이상인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.5. The plasma display according to any one of claims 2, 3, and 4, wherein a time difference between the time at which the one pulse falls and the time at which the other pulse falls is at least 2 microseconds. How to drive the panel.
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KR100472372B1 (en) * 2002-08-01 2005-02-21 엘지전자 주식회사 Method Of Driving Plasma Display Panel
KR100740095B1 (en) 2005-10-21 2007-07-16 삼성에스디아이 주식회사 Plasma display device and driving method thereof

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