KR19990047260A - Pad array structure of liquid crystal display - Google Patents
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Abstract
본 발명은 패드가 긁혀져서 발생되는 찌꺼기에 의한 인접 패드간의 쇼트를 방지할 수 있는 액정 표시 장치의 패드 배열 구조를 개시한다.The present invention discloses a pad arrangement structure of a liquid crystal display device capable of preventing a short between adjacent pads due to debris generated by scratching a pad.
개시된 본 발명은, 액정 기판의 가장자리에 다수개가 배열되어, 주사선 또는 신호선과 외부 신호 전달체계를 이루는 액정 표시 장치의 패드 배열 구조로서, 상기 패드는 일정 간격으로 이격 배치됨과 아울러, 인접하는 패드와는 서로 교대로 상이한 열에 배치되는 것을 특징으로 한다.Disclosed is a pad arrangement structure of a liquid crystal display device in which a plurality of liquid crystal substrates are arranged at edges of the liquid crystal substrate to form an external signal transmission system with a scan line or a signal line, wherein the pads are spaced at regular intervals and are adjacent to adjacent pads. It is characterized by being arranged in different rows alternately with each other.
Description
본 발명은 액정 표시 소자의 패드 배열 구조에 관한 것으로, 보다 구체적으로는, 액정 기판의 가장자리에 다수개가 배열되어, 주사선 또는 신호선과 외부 신호 전달체계를 이루는 액정 표시 장치의 패드 배열 구조에 관한 것이다.The present invention relates to a pad arrangement structure of a liquid crystal display device, and more particularly, to a pad arrangement structure of a liquid crystal display device, in which a plurality of liquid crystal substrates are arranged at an edge of a liquid crystal substrate to form an external signal transmission system with a scan line or a signal line.
일반적으로 패드는 외부의 전기적 신호를 회로내의 전극에 전달하는 경로로서, 전도 특성이 우수한 물질 예를들어, 알루미늄 금속이 이용된다. 이러한 패드에서 액정 표시 소자의 하부 기판 가장자리에 배열된다. 즉, 4각 형상의 하부 기판에는, 하부 기판의 장방향으로 연장된 다수개의 주사선과, 이와 수직으로 교차되는 다수개의 신호선이 배치된다. 그리고, 하부 기판의 1변에 주사선과 연결되는 제 1 패드들이 일정 간격으로 동일 선상에 배치되고, 제 1 패드들이 배치된 변과 수직으로 만나는 변들중 어느 하나에 신호선과 연결되는 제 2 패드들이 일정 간격으로 동일 선상에 배치된다.In general, a pad is a path for transmitting an external electrical signal to an electrode in a circuit, and a material having excellent conductive properties, for example, aluminum metal is used. In such a pad is arranged at the edge of the lower substrate of the liquid crystal display element. That is, a plurality of scanning lines extending in the longitudinal direction of the lower substrate and a plurality of signal lines perpendicular to the lower substrate are disposed on the quadrangular lower substrate. The first pads connected to the scan line on one side of the lower substrate are disposed on the same line at regular intervals, and the second pads connected to the signal line on any one of the sides perpendicular to the side where the first pads are disposed are constant. It is arranged on the same line at intervals.
이와같이 제 1 및 제 2 패드들은 외부로부터 즉, 인쇄 회로 기판으로부터 인가되는 신호를 각각의 주사선과 신호선에 전달하는 전달 경로가 된다.In this way, the first and second pads are transfer paths for transmitting signals applied from the outside, that is, from the printed circuit board, to the respective scan lines and the signal lines.
상기와 같은 패드는 제품화하기 이전에, 그 성능을 테스트하기 위하여, 소정의 테스트 공정이 진행되어야 한다. 이와같은 테스트 공정은 프로브 스테이션(probe station)과 같은 장치에 하부 기판을 로딩한 후, 프로브(probe)를 패드에 콘택시키어, 그 전기적 성능을 테스트 하게 된다.Before such a pad is manufactured, a predetermined test process must be performed to test its performance. This test process loads the lower substrate into a device, such as a probe station, and then contacts the probe to the pad to test its electrical performance.
그러나 이와같은 과정에서, 도 1에 도시된 바와 같이, 패드(Pn)는 프로브에 의하여 일부 긁히게 되어, 긁혀진 패드 찌꺼기(3)가 발생된다. 이때, 패드 찌꺼기(3)들은 인접하는 다른 패드(Pn+1)에 걸쳐 배치될 수 있다. (도면에서 미설명 부호 1은 하부 기판이고, 2는 주사선 또는 신호선이다.)However, in this process, as shown in FIG. 1, the pad Pn is partially scratched by the probe, so that the scraped pad dreg 3 is generated. In this case, the pad remnants 3 may be disposed over other adjacent pads Pn + 1. (In the drawing, reference numeral 1 denotes a lower substrate, and 2 denotes a scan line or a signal line.)
여기서, 상기 패드 찌꺼기(3) 또한 전기를 도통시키는 금속 물질이므로, 패드 Pn과 Pn+1간의 쇼트를 유발시키게 되는 문제점이 발생된다.Here, since the pad dreg 3 is also a metal material which conducts electricity, a problem occurs that causes a short between the pads Pn and Pn + 1.
도 1은 종래의 액정 표시 장치의 패드 배열 구조를 나타낸 평면도.1 is a plan view showing a pad arrangement structure of a conventional liquid crystal display.
도 2는 본 발명에 따른 액정 표시 장치의 패드 배열 구조를 나타낸 평면도.2 is a plan view showing a pad arrangement structure of the liquid crystal display according to the present invention.
(도면의 주요 부분에 대한 부호의 설명)(Explanation of symbols for the main parts of the drawing)
11 : 하부 기판 12 : 주사선11 lower substrate 12 scanning line
13 : 패드 찌꺼기 P : 패드13: pad residue P: pad
상기한 본 발명의 목적을 달성하기 위하여, 본 발명은 액정 기판의 가장자리에 다수개가 배열되어, 주사선 또는 신호선과 외부 신호 전달체계를 이루는 액정 표시 장치의 패드 배열 구조로서, 상기 패드는 일정 간격으로 이격 배치됨과 아울러, 인접하는 패드와는 서로 교대로 상이한 열에 배치되는 것을 특징으로 한다.In order to achieve the above object of the present invention, the present invention is a pad array structure of a liquid crystal display device having a plurality arranged on the edge of the liquid crystal substrate, forming a scanning line or a signal line and an external signal transmission system, the pads are spaced at regular intervals In addition to the arrangement, adjacent pads are alternately arranged in different rows.
본 발명에 의하면, 기판의 가장자리에 패드들을 교대로 상이한 열에 배치시키므로써, 동일선상에는 인접한 패드가 나란하게 놓이지 않다록 한다. 따라서, 테스트 공정시, 인접하는 패드간의 쇼트를 방지할 수 있다.According to the present invention, by arranging pads alternately in different rows at the edge of the substrate, adjacent pads are not placed side by side on the same line. Therefore, a short between adjacent pads can be prevented at the time of a test process.
이하 첨부한 도면에 의거하여 본 발명의 바람직한 실시예를 자세히 설명하도록 한다.Hereinafter, preferred embodiments of the present invention will be described in detail with reference to the accompanying drawings.
첨부한 도면 도 2는 본 발명에 따른 액정 표시 소자의 패드 배열 구조를 나타낸 평면도이다. 본 실시예에서는 예를들어, 주사선 측의 패드를 예를들어 설명한다.2 is a plan view illustrating a pad arrangement structure of a liquid crystal display according to the present invention. In the present embodiment, for example, the pad on the scanning line side will be described by way of example.
도 2를 참조하여, 본 발명에 따른 패드(PP)는 기판(11)의 일측 가장자리 부근에 일정 간격으로 배치된다. 이때, 패드(PP)는 인접하는 패드와 동일선상에 배치되지 않고, 교대로 상이한 열에 배치된다. 여기서, 상기 패드(PP) 즉, 주사선 연결용 패드(PP)와 신호선 연결용 패드(도시되지 않음)들은 모두 기판(11) 표면에 배치되고, 주사선(12) 또한 기판(11) 표면에 형성된다. 그리고 패드(PP) 및 주사선이 형성된 기판상에 게이트 절연막(도시되지 않음)이 피복된다. 또한, 신호선(도시되지 않음)은 주사선과 수직으로 배치되며, 게이트 절연막 상부에 형성된다.Referring to FIG. 2, the pads PP according to the present invention are disposed at regular intervals near one edge of the substrate 11. At this time, the pads PP are not arranged on the same line as the adjacent pads, but are alternately arranged in different rows. Here, the pad PP, that is, the scan line connecting pad PP and the signal line connecting pads (not shown) are both disposed on the surface of the substrate 11, and the scan line 12 is also formed on the surface of the substrate 11. . A gate insulating film (not shown) is coated on the substrate on which the pad PP and the scan line are formed. In addition, the signal line (not shown) is disposed perpendicular to the scan line and is formed on the gate insulating film.
상기한 패드 배열 구조를 보다 구체적으로 설명하면, 패드(P2, P4, P6)의 단부 중 인쇄 회로 기판(도시되지 않음)에 인접한 단부(이하, 제 1 단부:x1)는 기판(11)의 가장자리와 나란하게 배치된다. 이들 패드(P2,P4,P6)와 인접한 패드(P1, P3, P5)의 제 1 단부(x1)는 패드(P2,P4,P6)의 제 2 단부(x2: 주사선과 가장 인접한 단부)들을 연장시킨 선과 일치될 수 있도록 배치된다. 이때, 패드(P1,P2,P3, P4,P5,P6)들 각각은 주사선(12)과 일대일로 연결되어 있으며, 주사선(12)는 도면에 도시되지 않았지만, 게이트 절연막(도시되지 않음)에 묻혀있다. 즉, 패드(P1, P3, P5)는 패드의 장방향의 길이만큼, 기판의 가장자리로부터 내측으로 이격되어 배치된다.The pad arrangement structure described above will be described in more detail. Among the ends of the pads P2, P4, and P6, an end adjacent to a printed circuit board (not shown) (hereinafter, a first end: x1) is an edge of the substrate 11. Are placed side by side with The first end x1 of the pads P1, P3, P5 adjacent to these pads P2, P4, P6 extends the second end (x2: the end closest to the scan line) of the pads P2, P4, P6. It is arranged so that it can be matched to the line. In this case, each of the pads P1, P2, P3, P4, P5, and P6 is connected to the scan line 12 in a one-to-one manner, and the scan line 12 is not shown in the figure, but is buried in a gate insulating film (not shown). have. That is, the pads P1, P3, and P5 are spaced inward from the edge of the substrate by the length of the pad in the longitudinal direction.
이와같이 인접하는 패드들이 나란하지 않게 서로 다른 열에 배치하면, 테스트 공정시, 프로브에 의하여 패드가 긁히게 되더라도, 긁혀서 발생되는 찌꺼기(13)가 인접셀에 영향을 주지 않는다. 즉, 해당 패드의 양옆에는 패드가 구비되어 있지 않으므로, 패드와 패드 사이의 쇼프가 발생되지 않고, 인접하는 주사선(12)상에 패드 찌꺼기(13)가 존재하다라도, 찌꺼기 하부에는 게이트 절연막이 배치되어 있으므로, 전기적으로 쇼트가 발생되지 않는다.In this way, if the adjacent pads are arranged in different rows so as not to be parallel to each other, even if the pads are scratched by the probe during the test process, the scraps generated by scratching do not affect the adjacent cells. That is, since pads are not provided on both sides of the pads, there is no shock between the pads and the pads, and even if the pad dregs 13 are present on the adjacent scanning lines 12, the gate insulating film is disposed under the dregs. Therefore, no short is generated electrically.
본 발명은 상기한 실시예에 한정되는 것만은 아니다.The present invention is not limited to the above embodiment.
예를들어, 본 발명에서는 주사선과 연결되는 패드를 예를들어 설명하였지만, 그 밖의 신호선과 연결되는 패드또한 동일하게 구성할 수 있다.For example, in the present invention, the pad connected to the scan line has been described as an example, but the pad connected to the other signal lines can be configured in the same manner.
이상에서 자세히 설명된 바와 같이, 본 발명에 의하면, 기판의 가장자리에 패드들을 교대로 상이한 열에 배치시키므로써, 동일선상에는 인접한 패드가 나란하게 놓이지 않다록 한다. 따라서, 테스트 공정시, 인접하는 패드간의 쇼트를 방지할 수 있다.As described in detail above, according to the present invention, by arranging pads alternately at different edges at the edge of the substrate, adjacent pads are not placed side by side on the same line. Therefore, a short between adjacent pads can be prevented at the time of a test process.
기타, 본 발명은 그 요지를 일탈하지 않는 범위에서 다양하게 변경하여 실시할 수 있다.In addition, this invention can be implemented in various changes within the range which does not deviate from the summary.
Claims (3)
Priority Applications (1)
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| KR1019970065596A KR19990047260A (en) | 1997-12-03 | 1997-12-03 | Pad array structure of liquid crystal display |
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| KR1019970065596A KR19990047260A (en) | 1997-12-03 | 1997-12-03 | Pad array structure of liquid crystal display |
Publications (1)
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| KR19990047260A true KR19990047260A (en) | 1999-07-05 |
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| KR (1) | KR19990047260A (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100456390B1 (en) * | 2001-01-17 | 2004-11-10 | 미쓰이 가가쿠 가부시키가이샤 | Injection molding soft resin composition and uses thereof |
| KR100709712B1 (en) * | 2001-02-07 | 2007-04-19 | 삼성전자주식회사 | Pad structure of liquid crystal display |
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1997
- 1997-12-03 KR KR1019970065596A patent/KR19990047260A/en not_active Withdrawn
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Legal Events
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