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KR101391399B1 - Ｃｒｌｈ 구조의 대역저지 여파기 및 그 제조 방법 - Google Patents

Ｃｒｌｈ 구조의 대역저지 여파기 및 그 제조 방법 Download PDF

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KR101391399B1
KR101391399B1 KR1020100062126A KR20100062126A KR101391399B1 KR 101391399 B1 KR101391399 B1 KR 101391399B1 KR 1020100062126 A KR1020100062126 A KR 1020100062126A KR 20100062126 A KR20100062126 A KR 20100062126A KR 101391399 B1 KR101391399 B1 KR 101391399B1
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양승인
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숭실대학교산학협력단
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Abstract

본 발명은 CRLH 구조의 대역저지 여파기 및 그 제조 방법에 대하여 개시한다. 본 발명의 일면에 따른 CRLH 구조의 대역저지 여파기는, 기판에 형성된 마이크로스트립 전송선; 및 상기 마이크로스크립 전송선에 병렬로 연결되는 제1 스터브(Stub)와 제1 커패시터를 포함하고, 상기 마이크로스트립 전송선을 통과하는 제1 주파수 대역의 신호를 저지하는 RHM(Right Handed Material) 영역; 및 상기 제1 스터브와 상기 제1 커패시터 사이에 추가되어, 상기 마이크로스트립 전송선을 통과하는 제2 주파수 대역의 신호를 차단하는 LHM(Left Handed Material) 영역을 포함하는 것을 특징으로 한다.

Description

ＣＲＬＨ 구조의 대역저지 여파기 및 그 제조 방법{Band Stop Filter of Composite Right/Left Handed Structure and the Manufacturing Method thereof}
본 발명은 대역저지 여파기에 관한 것으로서, 더 구체적으로는 임의의 주파수에서 저지특성을 갖는 CRLH 구조의 대역저지 여파기 및 그 제조 방법에 관한 것이다.
본 발명은 지식경제부의 메타 전자파 구조를 이용한 전파(RF)스펙트럼 개선 기술 연구사업의 일환으로 수행한 연구로부터 도출된 것이다[과제관리번호: KI002071, 과제명: 메타 전자파 구조를 이용한 전파(RF)스펙트럼 개선 기술 연구].
최근, 무선 통신 시스템은 복수의 서로 다른 주파수를 혼용하여 사용하기 때문에, 인접한 주파수를 이용하는 서비스들끼리 종종 혼선이 일어난다.
이를 방지하기 위해서, 무선 통신 시스템에는 하나의 서비스의 주파수를 송출할 때에는 다른 서비스의 주파수를 저지함으로써, 이들 간의 혼선을 줄일 수 있는 대역저지 여파기를 적용하고 있다.
종래의 대역저지 여파기는 마이크로스트립만으로 설계되는 단락된 병렬 스터브(Short Parallel Stub)가 있었다.
그런데, 이러한 형태의 여파기는 주기적인 주파수응답특성 및 위상응답특성을 갖기 때문에 180도로 위상천이가 발생하는 부위에서 불필요한 공진이 발생하는 문제가 있으며, λ/4 길이의 스터브를 이용하므로, 공진주파수가 낮아질수록 스터브의 크기도 커지는 단점이 있다.
때문에, 이러한 단점을 보완하기 위해서, 다양한 구조의 여파기가 제안되고 있다. 특히 LHM(Left Handed Material)과 RHM(Right Handed Material)을 혼합한 CRLH(Composite Right/Left Handed) 구조의 전송선을 이용한 연구가 진행중이나, 아직까지는 특정 주파수에 대해서만 제한적으로 적용되고 있을 뿐이다.
또한, 무선 통신 시스템에 적용되는 휴대용 기기가 발달함에 따라, 대역저지 여파기를 포함하는 소자를 소형화하려는 요구가 많아지고 있는데, 종래의 여파기는 이러한 수요를 만족시킬 수 없다.
본 발명은 전술한 바와 같은 기술적 배경에서 안출된 것으로서, CRLH 구조의 전송선으로 구성될 수 있는 CRLH 구조의 대역저지 여파기 및 그 제조 방법을 제공하는 것을 그 목적으로 한다.
본 발명은 마이크로스트립에 집중소자를 추가하여 비교적 작은 크기로 구성될 수 있는 CRLH 구조의 대역저지 여파기 및 그 제조 방법을 제공하는 것을 다른 목적으로 한다.
본 발명은 CRLH 구조로 구성되어, 임의의 복수 주파수 대역을 차단하는 비주기적 특성을 제공할 수 있는 CRLH 구조의 대역저지 여파기 및 그 제조 방법을 제공하는 것을 다른 목적으로 한다.
본 발명의 일면에 따른 CRLH 구조의 대역저지 여파기는, 기판에 형성된 마이크로스트립 전송선; 및 상기 마이크로스크립 전송선에 병렬로 연결되는 제1 스터브(Stub)와 제1 커패시터를 포함하고, 상기 마이크로스트립 전송선을 통과하는 제1 주파수 대역의 신호를 저지하는 RHM(Right Handed Material) 영역; 및 상기 제1 스터브와 상기 제1 커패시터 사이에 추가되어, 상기 마이크로스트립 전송선을 통과하는 제2 주파수 대역의 신호를 차단하는 LHM(Left Handed Material) 영역을 포함하는 것을 특징으로 한다.
본 발명의 다른 면에 따른 CRLH 구조의 대역저지 여파기 제조 방법은, 기판에 마이크로스트립 전송선을 형성하는 단계; 상기 기판의 상기 마이크로스트립 전송선에 제1 스터브 및 제1 커패시터로 구성되어, 상기 전송선을 통과하는 제1 주파수 대역의 신호를 차단하는 RHM 영역을 병렬로 연결하는 단계; 및 상기 제1 스터브와 상기 제1 커패시터 사이에, 상기 전송선을 통과하는 제2 주파수 대역의 신호를 차단하는 LHM 영역을 추가하는 단계를 포함하는 것을 특징으로 한다.
본 발명의 또 다른 면에 따른 CRLH 구조의 대역저지 여파기 제조 방법은, 차단하고자하는 주파수 대역인 제1 및 제2 주파수 대역을 결정하는 단계; 상기 결정에 따라, 제1 스터브, 제2 스터브, 제1 커패시터 및 제2 커패시터를 설계하는 단계; 기판에서, 마이크로스트립 전송선, 상기 마이크로스트립 전송선과 병렬로 연결된 제1 스터브 및 상기 제1 스터브와 소정간격 이격되어 형성된 제2 스터브를 제외한 영역을 식각하는 단계; 상기 제1 스터브의 타단과 상기 제2 스터브의 일단 사이에 제1 커패시터를 추가하여 연결하는 단계; 상기 제2 스터브의 일단과 제2 커패시터의 일단을 연결하는 단계; 및 상기 제2 스터브의 타단과 상기 제2 커패시터의 타단을 접지와 연결하는 단계를 포함하는 것을 특징으로 한다.
본 발명에 따르면, 한 개의 CRLH 구조의 여파기를 이용하여 복수의 주파수 대역을 차단할 수 있으며, LH(Left Handed) 특성을 가지므로 비주기적인 특성을 가지므로 임의의 복수 주파수 대역에서 저지특성을 가질 수 있는 효과가 있다.
또한, 본 발명은 마이크로스트립 전송선과 집중소자를 혼용하여 구성하여 종래의 마이크로스트립만으로 구성된 여파기에 대비할 때 그 크기가 크게 개선될 수 있다.
도 1은 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기의 회로도이며, 도 2는 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기의 설계 예이다.
도 3은 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)의 제1 커패시터(CR)의 변화에 따라 주파수응답특성의 변화를 도시한 그래프이며, 도 4는 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)의 제2 커패시터(CL)의 변화에 따른 주파수응답특성의 변화를 도시한 그래프이다.
도 5는 제1 주파수 대역과 제2 주파수 대역이 각기 GPS 대역과 ISM 대역인 CRLH 구조의 대역저지 여파기(10)에 대한 S(1, 1) 위상특성을 도시한 그래프이고, 도 4는 제1 주파수 대역은 GPS 대역이고, 제2 주파수 대역은 ISM 대역으로 설정된 CRLH 구조의 대역저지 여파기(10)에 대한 분산특성을 도시한 그래프이다.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다. 한편, 본 명세서에서 사용된 용어는 실시예들을 설명하기 위한 것이며 본 발명을 제한하고자 하는 것은 아니다. 본 명세서에서, 단수형은 문구에서 특별히 언급하지 않는 한 복수형도 포함한다. 명세서에서 사용되는 "포함한다(comprises)" 및/또는 "포함하는(comprising)"은 언급된 구성소자, 단계, 동작 및/또는 소자는 하나 이상의 다른 구성소자, 단계, 동작 및/또는 소자의 존재 또는 추가를 배제하지 않는다.
이제 본 발명의 바람직한 실시예에 대하여 첨부한 도면을 참조하여 상세히 설명하기로 한다.
도 1은 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기의 회로도이며, 도 2는 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기의 설계 예이다.
도 1 및 도 2에 도시된 바와 같이, 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)는 기판(BD), 마이크로스트립 전송선(ML), RHM(Right Handed Material) 영역(LR, CR) 및 LHM(Left Handed Material) 영역(LL, CL)을 포함한다.
기판(BD)은 일면에 마이크로스트립 전송선(ML), 제1 스터브(LR), 제2 스터브(LL), 제1 커패시터(CR), 제2 커패시터(CL), 제1 급전단자(PORT1) 및 제2 급전단자(PORT2)를 실장한다. 이때, 기판(BD)에서 마이크로스트립으로 설계되는 마이크로스트립 전송선(ML), 제1 스터브(LR) 및 제2 스터브(LL)를 제외한 나머지 구조는 식각(Etching)으로 형성된다.
마이크로스트립 전송선(ML)은 기판(BD)의 일면에 형성되며, 양단은 급전단자(PORT1) 및 제2 급전단자(PORT2)와 연결되고, RHM 영역(LR, CR)과 병렬로 연결된다. 이때, 마이크로스트립 전송선(ML)은 전송손실을 줄일 수 있도록 50Ω으로 임피던스 매칭(Impedence Matching)된다.
RHM 영역(LR, CR)은 일단이 마이크로스트립 전송선(ML)과 병렬로 연결되는 제1 스터브(LR), 일단이 LHM 영역(LL, CL)과 연결되는 제1 커패시터(CR)를 포함하고, 마이크로스트립 전송선(ML)을 통과하는 신호 중에서 제1 주파수 대역의 신호를 차단한다.
LHM 영역(LL, CL)은 일단이 제1 스터브(LR)의 타단에 연결되고 타단은 제2 커패시터(CL)의 일단에 연결되는 제2 커패시터(CL), 일단이 제2 커패시터(CL)의 타단과 연결되는 제2 스터브(LL)를 포함하고, 마이크로스트립 전송선(ML)을 통과하는 신호 중에서 제2 주파수 대역의 신호를 차단한다.
이때, 제1 커패시터(CR)와 제2 커패시터(CL)는 집중소자일 수 있으며, 예컨대 버렉터 다이오드와 같이 커패시턴스가 변화하는 형태일 수 있다. 이 경우, 커패시턴스에 따라 제1 및 제2 주파수 대역도 가변한다.
제1 스터브(LR)와 제2 스터브(LL)는 임피던스 매칭을 위한 용도로 마이크로스트립 전송선(ML)에 부가적으로 연결되는 마이크로스트립 선로이며, 하기의 수학식 1에 따른 인덕턴스(L), 너비(W) 및 길이(l)로 구성된다. 하기의 수학식 1에서, t는 제1 및 제2 스터브(LR, LL)를 구성하는 동판의 두께이며, h는 유전체의 두께이다.
Figure 112013098552052-pat00030
Figure 112013098552052-pat00031
예컨대, 제1 주파수 대역과 제2 주파수 대역이 각기 GPS(Global Positioning System) 주파수 대역과 ISM(Industrial Scientific and Medical) 주파수 대역일 때, 최종적으로 설계된 여파기 구조는 도 2와 같으며, 수학식 1에 따라 W1은 0.3㎜, l1은 3.2㎜, W2는 0.5㎜, l2는 2.8㎜일 수 있다.
또한, 제1 스터브(LR)와 제2 스터브(LL)의 인덕턴스 및 제1 커패시터(CR)와 제2 커패시터(CL)의 커패시턴스는 하기의 수학식 2에 의하여 산출될 수 있다. 여기서, ω1는 2πf1(이때, f1은 제1 주파수 대역의 중심주파수)이며, ω2는 2πf2(이때, f1은 제2 주파수 대역의 중심주파수)이며, Zt는 종단 임피던스로서 50Ω이며, N은 스터브의 개수로서 1이다.
Figure 112013098552052-pat00032
Figure 112013098552052-pat00033
Figure 112013098552052-pat00034
Figure 112013098552052-pat00035
예를 들어, 제1 주파수 대역이 GPS 주파수 대역이고, 제2 주파수 대역이 ISM 주파수 대역인 경우, f1은 1.575GHz, f2는 2.45GHz이므로, 상기의 수학식 2에 따라 LR은 6.2nH, CR은 2.2pF, LL은 1.2nH이고 CL은 2.7pF이다.
본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)는 CRLH 특성을 가지므로, 하기의 수학식 3에 의하여 산출된 β가 0 또는 음의 값이다.
Figure 112010042027460-pat00007
여기서, ω1는 2πf1(이때, f1은 제1 주파수 대역의 중심주파수)이며, ω2는 2πf2(이때, f1은 제2 주파수 대역의 중심주파수)이다.
한편, 제1 스터브(LR)와 제2 스터브(LL)는 개방 스터브(Open Stub)나, 단락 스터브(Short Stub)일 수 있으나, 본 명세서에서는 제1 스터브(LR)와 제2 스터브(LL)가 단락 스터브인 경우를 예로 들어 설명한다.
그리고, 제1 스터브(LR)와 제2 스터브(LL)는 수학식 2의 연산결과에 따른 인덕턴스를 갖는 인덕터로 대체될 수 있음은 물론이다.
이하, 도 3 및 도 4를 참조하여 RHM 영역(LR, CR)과 LHM 영역(LL, CL)의 값을 변화시킴에 따른 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)의 주파수특성변화에 대하여 살펴본다.
도 3은 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)의 제1 커패시터(CR)의 변화에 따라 주파수응답특성의 변화를 도시한 그래프이며, 도 4는 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)의 제2 커패시터(CL)의 변화에 따른 주파수응답특성의 변화를 도시한 그래프이다. 도 3 및 도 4에서는, 유전율은 3.12, 손실 탄젠트는 0.0018, 유전체 두께는 0.767㎜을 사용하였다.
도 3을 통해서, 제1 커패시터(CR)가 변화하면, 제1 및 제2 주파수 대역 중에서, 상대적으로 높은 주파수 대역의 변화폭이 낮은 주파수 대역의 변화폭보다 큰 것을 알 수 있다.
도 4를 통해서, 제2 커패시터(CL)가 변화하면, 제1 및 제2 주파수 대역 중에서, 제1 및 제2 주파수 대역 중에서, 상대적으로 낮은 주파수 대역의 변화폭이 높은 주파수 대역의 변화폭보다 큰 것을 알 수 있다.
이 같이, 도 3과 도 4를 통해, 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)는 제1 및 제2 커패시터(CR, CL)의 값을 조절함으로써, 차단하고자 하는 제1 주파수 대역과 제2 주파수 대역을 각기 조절할 수 있음을 알 수 있다.
이하, 도 5 및 도 6을 참조하여 제1 주파수 대역과 제2 주파수 대역이 각기 GPS 대역과 ISM 대역인 CRLH 구조의 대역저지 여파기(10)의 특성에 대하여 살펴본다.
도 5는 제1 주파수 대역과 제2 주파수 대역이 각기 GPS 대역과 ISM 대역인 CRLH 구조의 대역저지 여파기(10)에 대한 S(1, 1) 위상특성을 도시한 그래프이고, 도 4는 제1 주파수 대역은 GPS 대역이고, 제2 주파수 대역은 ISM 대역으로 설정된 CRLH 구조의 대역저지 여파기(10)에 대한 분산특성을 도시한 그래프이다.
도 5의 그래프에서, 제1 주파수 대역과 제2 주파수 대역이 각기 GPS 대역과 ISM 대역인 CRLH 구조의 대역저지 여파기(10)는 제1 급전단자(PORT1)로 입력되는 신호 중에서, GPS 대역과 ISM 대역의 신호를 차단함을 해석할 수 있다.
도 6의 그래프에서, 제1 주파수 대역과 제2 주파수 대역이 각기 GPS 대역과 ISM 대역인 CRLH 구조의 대역저지 여파기(10)는 β값이 음수 영역인 Left-Handed 특성을 갖는 것을 해석할 수 있다.
이하, 도 7을 참조하여 제1 주파수 대역과 제2 주파수 대역이 각기 GPS 대역과 ISM 대역인 CRLH 구조의 대역저지 여파기(10)의 주파수응답특성에 대하여 살펴본다. 도 7은 제1 주파수 대역과 제2 주파수 대역이 각기 GPS 대역과 ISM 대역인 CRLH 구조의 대역저지 여파기(10)의 주파수응답특성의 주파수응답특성을 도시한 그래프이다.
도 7에서, 제1 주파수 대역과 제2 주파수 대역이 각기 GPS 대역과 ISM 대역인 CRLH 구조의 대역저지 여파기(10)는 GPS 주파수 대역에서는 약 -35dB의 저지특성을 가지며, ISM 주파수 대역에서는 약 -29dB의 저지특성을 갖는 것을 해석할 수 있다.
이하, 도 8을 참조하여 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)의 형태에 대하여 살펴본다. 도 8은 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기와 동전을 비교하여 도시한 도면이다.
도 8에서, 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)는 약 10㎜×15㎜로 50원 동전과 비교할 수 있을 정도로 매우 작은 크기임을 알 수 있다.
이는 종래의 마이크로스트립 전송선만을 이용하는 여파기인 경우, GPS 주파수 대역을 저지하는 경우 47.7㎜(=λ/4)의 크기로 구성되며, ISM 주파수 대역을 저지하는 경우 31.2㎜(=λ/4)의 크기로 구성되는 경우 것과 비교할 때, 사이즈 면이 현저히 개선된 것이다.
이와 같이, CRLH 구조의 대역저지 여파기(10)는 신호를 송수신하는 급전선로 사이에 추가되어, 급전선로를 통과하는 송수신신호 중에서 변동가능한 임의의 제1 및 제2 주파수 대역의 신호를 차단할 수 있으며, 마이크로스트립 전송선과 집중소자를 혼용하므로 소형화할 수 있다.
이하, 도 9를 참조하여 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기 제조 방법에 대하여 설명한다. 도 9는 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기 제조 방법을 도시한 흐름도이다.
도 9를 참조하면, 제1 및 제2 주파수 대역을 결정하고(S910), 그에 따라 제1 스터브(LR) 및 제2 스터브(LL)의 폭과 길이, 그리고 제1 커패시터(CR) 및 제2 커패시터(CL)의 커패시턴스 등을 결정한다(S920).
이어서, 기판(BD)에 마이크로스트립 전송선(ML), 제1 스터브(LR) 및 제2 스터브(LL)를 제외한 영역을 식각하여 형성한다(S930).
그리고, 제1 스터브(LR)의 타단과 제2 스터브(LL)의 일단 사이에 제1 커패시터(CR)의 일단을 납땜하고, 제1 커패시터(CR)의 타단을 접지와 연결한다(S940).
또한, 제1 커패시터(CR)의 일단과 제2 커패시터(CL)의 일단을 상호 연결하고, 제2 커패시터(CL)의 타단을 접지와 연결한다(S950).
그 다음으로, 마이크로스트립 전송선(ML)의 양단에 제1 급전단자(PORT1)와 제2 급전단자(PORT2)를 각기 실장한다(S960).
이후, 급전선로와 직렬로 제1 급전단자(PORT1)와 제2 급전단자(PORT2)를 연결함으로써, 마이크로스트립 전송선(ML)을 통과하는 신호 중에서, 제1 및 제2 주파수 대역의 신호가 차단될 수 있다.
한편, 본 명세서에서는 본 발명의 실시예에 따른 CRLH 구조의 대역저지 여파기(10)가 두 개의 주파수 대역만을 차단하는 경우를 예로 들어 설명하였으나, 마이크로스트립 전송선(ML), 제1 스터브(LR), 제2 스터브(LL), 제1 커패시터(CR), 제2 커패시터(CL) 중 적어도 하나에 제3 주파수 대역을 차단하는 필터(미도시)를 추가로 연결하여 필터(미도시)를 이용하여 마이크로스트립 전송선(ML)을 통과하는 제3 주파수 대역을 추가로 차단할 수 있음은 물론이다.
이상, 본 발명의 구성에 대하여 첨부 도면을 참조하여 상세히 설명하였으나, 이는 예시에 불과한 것으로서, 본 발명이 속하는 기술분야에 통상의 지식을 가진자라면 본 발명의 기술적 사상의 범위 내에서 다양한 변형과 변경이 가능함은 물론이다. 따라서 본 발명의 보호 범위는 전술한 실시예에 국한되어서는 아니되며 이하의 특허청구범위의 기재에 의하여 정해져야 할 것이다.

Claims (20)

  1. 기판에 형성된 마이크로스트립 전송선; 및
    상기 마이크로스트립 전송선에 병렬로 연결되는 제1 스터브(Stub)와 제1 커패시터를 포함하고, 상기 마이크로스트립 전송선을 통과하는 제1 주파수 대역의 신호를 저지하는 RHM(Right Handed Material) 영역; 및
    상기 제1 스터브와 상기 제1 커패시터 사이에 추가되어, 상기 마이크로스트립 전송선을 통과하는 제2 주파수 대역의 신호를 차단하고, 제2 커패시터와 제2 스터브를 포함하는 LHM(Left Handed Material) 영역을 포함하고,
    Figure 112013098552052-pat00036

    Figure 112013098552052-pat00037

    (여기서, ω1는 2πf1(f1은 제1 주파수 대역의 중심주파수)이며, ω2는 2πf2(f2는 제2 주파수 대역의 중심주파수), Zτ는 50Ω이며, N은 1임)
    상기 제1 스터브(LR)와 상기 제1 커패시터(CR)는,
    상기 제1 주파수 대역과 상기의 수학식에 의해서 결정되며,
    상기 제2 커패시터(CL)와 상기 제2 스터브(LL)는,
    상기 제2 주파수 대역과 하기의 수학식
    Figure 112013098552052-pat00038

    Figure 112013098552052-pat00039

    에 의해 결정되는 것인 CRLH 구조의 대역저지 여파기.
  2. 삭제
  3. 삭제
  4. 제1항에 있어서, 상기 RHM 영역과 상기 LHM 영역은,
    전압을 포함하는 제어에 따라 그 값이 가변되며, 이 경우 상기 제1 주파수 대역과 상기 제2 주파수 대역도 가변하는 것인 CRLH 구조의 대역저지 여파기.
  5. 삭제
  6. 제1항에 있어서, 상기 제1 스터브와 상기 제2 스터브는,
    마이크로스트립 또는 인덕터로 구성되는 것인 CRLH 구조의 대역저지 여파기.
  7. 제1항에 있어서,
    상기 대역저지 여파기의 β값이 0 또는 음수인 LH(Left Handed) 특성을 갖는 것인 CRLH 구조의 대역저지 여파기.
  8. 제1항에 있어서,
    상기 기판의 일면에 형성되는 CRLH 구조의 대역저지 여파기.
  9. 제1항에 있어서,
    상기 마이크로스트립 전송선의 양단은 급전단자에 직렬로 연결되는 것인 CRLH 구조의 대역저지 여파기.
  10. 제1항에 있어서,
    상기 마이크로스트립 전송선, 상기 제1 스터브, 상기 제2 스터브, 상기 제1 커패시터, 상기 제2 커패시터 중 적어도 하나와 제3 주파수 대역을 차단하는 필터를 연결하는 것인 CRLH 구조의 대역저지 여파기.
  11. 기판에 마이크로스트립 전송선을 형성하는 단계;
    상기 기판의 상기 마이크로스트립 전송선에 제1 스터브 및 제1 커패시터로 구성되어, 상기 전송선을 통과하는 제1 주파수 대역의 신호를 차단하는 RHM 영역을 병렬로 연결하는 단계;
    상기 제1 스터브와 상기 제1 커패시터 사이에, 상기 전송선을 통과하는 제2 주파수 대역의 신호를 차단하고, 제2 스터브 및 제2 커패시터를 포함하는 LHM 영역을 추가하는 단계;
    Figure 112013098552052-pat00040

    Figure 112013098552052-pat00041


    (여기서, ω1는 2πf1(f1은 제1 주파수 대역의 중심주파수)이며, ω2는 2πf2(f2는 제2 주파수 대역의 중심주파수), Zτ는 50Ω이며, N은 1임)
    상기의 수학식에 상기 제1 주파수 대역을 적용하여 상기 제1 스터브(LR) 및 제1 커패시터(CR)를 결정하는 단계; 및
    하기의 수학식에 상기 제2 주파수 대역을 적용하여 상기 제2 스터브(LL) 및 제2 커패시터(CL)를 결정하는 단계
    Figure 112013098552052-pat00042

    Figure 112013098552052-pat00043

    를 포함하는 CRLH 구조의 대역저지 여파기 제조 방법.
  12. 삭제
  13. 삭제
  14. 제11항에 있어서,
    상기 마이크로스트립 전송선의 양단에 급전단자를 실장하는 단계; 및
    상기 급전단자를 이용하여 상기 마이크로스트립 전송선을 급전선로와 직렬로 연결하는 단계
    를 더 포함하는 CRLH 구조의 대역저지 여파기 제조 방법.
  15. 제11항에 있어서,
    하기의 수학식에 의해서 산출되는 β값이 음수인지를 확인하는 단계
    Figure 112010042027460-pat00016

    를 더 포함하는 CRLH 구조의 대역저지 여파기 제조 방법.
    (여기서, ω1는 2πf1(f1은 제1 주파수 대역의 중심주파수)이며, ω2는 2πf2(f2는 제2 주파수 대역의 중심주파수), LR은 상기 제1 스터브, CR은 상기 제1 커패시터, LL은 상기 제2 스터브, CL은 상기 제2 커패시터임)
  16. 제15항에 있어서,
    상기 확인결과 음수가 아니면, 상기 제1 커패시터 및 상기 제2 커패시터 중 적어도 하나의 값을 변경하는 단계
    를 더 포함하는 것인 CRLH 구조의 대역저지 여파기 제조 방법.
  17. 제11항에 있어서,
    전압을 포함하는 제어에 따라 상기 LHM 영역 및 상기 RHM 영역 중 적어도 하나의 값을 가변하는 단계; 및
    상기 가변에 따라 상기 제1 주파수 대역과 상기 제2 주파수 대역이 가변되는 단계
    를 더 포함하는 CRLH 구조의 대역저지 여파기 제조 방법.
  18. 삭제
  19. 삭제
  20. 삭제
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