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JP5020425B2 - 微細溝をシリカ質材料で埋封する方法 - Google Patents

微細溝をシリカ質材料で埋封する方法 Download PDF

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Description

【0001】
【発明の属する技術分野】
本発明は、半導体装置等の電子デバイスに用いられる微細な溝を有する基材の溝をシリカ質材料で均質に埋封する方法、及び当該方法により得られるシリカ質膜付き基材に関する。
【0002】
【従来の技術】
半導体装置等の電子デバイスの製作には、PMD(Premetal Dielectrics)と呼ばれるトランジスター素子とビット線間、トランジスター素子とキャパシター間、ビット線間とキャパシター間又はキャパシターと金属配線間の絶縁膜やIMD(Intermetal Dielectrics)と呼ばれる金属配線間の絶縁膜の形成、或いはアイソレーション溝の埋封、といった工程が含まれる。かかる絶縁膜の形成や埋封には一般にシリカ質材料が用いられ、その形成方法として高密度プラズマCVD法、ゾルゲル法、シロキサン系ポリマー溶液塗布法、等がある。
【0003】
電子デバイスの高集積度化により、基板上の溝は一層微細化されつつある。このような微細溝の埋封を従来法で行うと、以下のような問題がある。
高密度プラズマCVD法により、溝幅が0.2μm以下でその幅に対する深さの比(以下「アスペクト比」ともいう。)が2以上である微細溝をシリカ質材料で埋封した場合、CVD法固有のコンフォーマル性のため、微細溝の内部にボイドが発生しやすいという問題がある。このようなボイドの発生を抑える方法として、プラズマによるエッチング速度を高めて成膜する方法があるが、基材の溝の上肩部も同時にエッチングされるため、溝形状が変形してしまう。
【0004】
このようなCVD法固有の問題を解決する方法として、微細溝を有する基材にゾルゲル液やシロキサン系ポリマー溶液を塗布、乾燥することにより微細溝を埋封し、その後加熱によりシリカ質材料へ転化するゾルゲル法やシロキサン系ポリマー溶液塗布法がある。しかし、一般にゾルゲル液やシロキサン系ポリマーは加熱時に脱水、脱アルコール縮合反応を伴うため、シリカ質材料への転化時に大きな体積収縮が発生する。このため、これらの方法により溝幅が0.2μm以下でアスペクト比が2以上である微細溝をシリカ質材料で埋封した場合、溝壁面による拘束の影響のため、微細溝内部のシリカ質材料の密度が溝外部の表面付近の密度よりも大幅に低下するという問題がある。すなわち、ゾルゲル法やシロキサン系ポリマー溶液塗布法では、膜表面から微細溝の底部に向かって密度が均一となるように微細溝を埋封することが困難である。
【0005】
このような縮合反応を伴わないでシリカ質へ転化させることができる方法としてポリシラザン溶液を塗布、乾燥することにより微細溝を埋封し、その後加熱する方法がある。しかし、炭化水素基やアルコキシ基等の有機基を含むポリシラザンは加熱時に有機基が分解するため、シリカ質への転化時に体積収縮が発生する。このため、有機基を含むポリシラザンを用いた方法により溝幅が0.2μm以下でアスペクト比が2以上である微細溝をシリカ質材料で埋封した場合、溝壁面による拘束の影響のため、上述のゾルゲル法と同様、微細溝内部のシリカ質材料の密度が溝外部の表面付近の密度よりも低くなるという問題がある。
【0006】
【発明が解決しようとする課題】
微細溝内部のシリカ質材料の密度が不均一であると、後続のスルーホールめっき工程における貫通孔の形成が困難となり、また絶縁材料としての特性にもばらつきが生じる。このような密度の不均一性は、微細溝の内外間のみならず、溝壁面による拘束の影響が大きいために一般に溝が微細になればなるほど密度も低くなることから、溝幅の異なる複数の微細溝間においても問題となる。今後、電子デバイスの高集積度化により基板の溝が一層微細化されることに鑑み、かかる微細溝を、溝の内外、広狭を問わず、できる限り均質に埋封することができる方法が望まれる。したがって、本発明は、上述の従来法では困難であるシリカ質材料による微細溝の均質埋封を可能とする方法を提供することを目的とする。
【0007】
【課題を解決するための手段】
上記目的を達成するため、本発明は、ポリスチレン換算重量平均分子量が3000〜20000の範囲にあるペルヒドロポリシラザンの溶液を、最深部の幅が0.2μm以下であってその幅に対する深さの比が2以上である溝を少なくとも一つ有する基材に塗布して乾燥することにより当該溝を当該ペルヒドロポリシラザンで埋封し、その後当該ペルヒドロポリシラザンを水蒸気を含む雰囲気において加熱することによりシリカ質材料に転化することを特徴とする、微細溝をシリカ質材料で埋封する方法を提供するものである。
さらに、本発明は、最深部の幅が0.2μm以下であってその幅に対する深さの比が2以上である溝を少なくとも一つ有する基材と、当該溝を埋封するように設けられたシリカ質膜とを含んでなるシリカ質膜付き基材であって、当該シリカ質膜は、当該溝の内部において実質的にボイドを含まず且つ、当該溝の最深部におけるエッチングレートが当該シリカ質膜の表面におけるエッチングレートの3倍以下であることを特徴とするシリカ質膜付き基材を提供するものでもある。
【0008】
【発明の実施の形態】
本発明の方法では、ポリスチレン換算重量平均分子量が3000〜20000の範囲にあるペルヒドロポリシラザンの溶液を使用する。ここで、ペルヒドロポリシラザンとは、Si−N結合を除き、Si,Nに結合する元素がすべてHであるポリマーをさす。ペルヒドロポリシラザンの最も単純な構造は、下記の繰り返し単位を有する鎖状構造である。
【0009】
【化1】
Figure 0005020425
【0010】
本発明では、分子内に鎖状構造と環状構造を有するペルヒドロポリシラザンを使用してもよく、例えば、磯田ら特公昭63−16325号公報、D. Seyferth らCommunication of Am. Cer. Soc., C-13, January 1983、等に報告されている、分子内に鎖状部分と環状部分を含む下記一般式で表されるペルヒドロポリシラザンが挙げられる。
【0011】
【化2】
Figure 0005020425
【0012】
上記一般式で表されるペルヒドロポリシラザンの具体例として、以下のような部分構造を有するものが挙げられる。
【0013】
【化3】
Figure 0005020425
【0014】
このようなペルヒドロポリシラザンは、一般に、ジハロシランと塩基とを反応させてジハロシランのアダクトを形成させた後、当該アダクトとアンモニアとを反応させることにより合成される。ペルヒドロポリシラザンの合成方法は公知であり、上記特公昭63−16325号公報の他、特開平1−138107号、特開平1−138108号、特開平3−170533号、等の各公報に詳しく記載されている。
【0015】
本発明によるペルヒドロポリシラザンはポリスチレン換算重量平均分子量が3000〜20000の範囲にある。ポリスチレン換算重量平均分子量の測定方法は周知であり、一般にゲル浸透クロマトグラフィー(GPC)によって測定することができる。ペルヒドロポリシラザンのポリスチレン換算重量平均分子量が3000未満であると、シリカ質へ転化させるための加熱時に飛散(蒸発)する低分子が増加し、これによる体積収縮、ひいては微細溝内部の低密度化が無視できなくなる。したがって、本発明によるペルヒドロポリシラザンのポリスチレン換算重量平均分子量の下限値は3000、好ましくは4000、より好ましくは5000である。反対に、ペルヒドロポリシラザンのポリスチレン換算重量平均分子量が20000を超えると、塗布液の粘度が高く且つ塗布時の硬化速度が速いため、微細溝への溶液の浸透性が低くなる。したがって、本発明によるペルヒドロポリシラザンのポリスチレン換算重量平均分子量の上限値は20000、好ましくは15000、より好ましくは10000である。
【0016】
本発明によるペルヒドロポリシラザンは溶液として基材に塗布される。この塗布液を調製するために用いられる溶媒としては、ベンゼン、トルエン、キシレン、エチルベンゼン、ジエチルベンゼン、トリメチルベンゼン、トリエチルベンゼン、等の芳香族化合物;シクロヘキサン;シクロヘキセン;デカヒドロナフタレン;ジペンテン;n−ペンタン、i−ペンタン、n−ヘキサン、i−ヘキサン、n−ヘプタン、i−ヘプタン、n−オクタン、i−オクタン、n−ノナン、i−ノナン、n−デカン、等の飽和炭化水素化合物;エチルシクロヘキサン;メチルシクロヘキサン;シクロヘキサン;シクロヘキセン;p−メンタン;ジプロピルエーテル、ジブチルエーテル、アニソール、等のエーテル類;酢酸n−ブチル、酢酸i−ブチル、酢酸n−アミル、酢酸i−アミル、等のエステル類;メチルイソブチルケトン(MIBK)、等のケトン類、が挙げられるが、これらに限定はされない。また、複数種の溶媒を使用することにより、ペルヒドロポリシラザンの溶解度や溶媒の蒸発速度を調節することもできる。
【0017】
溶媒の使用量(割合)は、採用する塗布方法により作業性がよくなるように、また微細溝内への溶液の浸透性や微細溝外部において必要とされる膜厚を考慮して、用いるペルヒドロポリシラザンの平均分子量、その分布及び構造に応じて適宜選定することができる。本発明によるペルヒドロポリシラザンは、塗布溶液中0.1質量%〜70質量%、好ましくは1質量%〜30質量%の範囲で使用することができる。
【0018】
本発明によると、このようにして調製したペルヒドロポリシラザン溶液を、最深部の幅が0.2μm以下でそのアスペクト比が2以上である溝を少なくとも一つ有する基材に塗布する。微細溝の形状に特に限定はなく、図1に示したような長方形溝、順テーパー形状溝、逆テーパー形状溝、曲面形状溝、等いずれの形状についても本発明は適用し得る。また、微細溝の両端部分は開放されていても閉じていてもよい。
【0019】
従来法では、最深部の幅が0.2μm以下でそのアスペクト比が2以上である微細溝をシリカ質材料で埋封しようとしても、シリカ質への転化時の体積収縮が大きいために溝内部が溝外部よりも低密度化し、溝の内外で材質が均質となるように溝を埋封することができなかった。本発明によると、このような微細溝を有する基材を用いた場合に、得られるシリカ質材料の溝外部に対する溝内部の低密度化が抑えられるという効果が顕在化する。このような本発明の効果は、最深部の幅が0.1μm以下、さらには0.08μm以下でそのアスペクト比が4以上、さらには5以上であるような非常に微細な溝を有する基材を用いた場合により一層顕著なものとなる。
なお、本明細書では用語「埋封」を、主として図1に示したように溝を埋めると共に溝外部の表面に塗膜を形成させる形態を表すものとして使用するが、このような塗膜を設けずに溝を埋めるだけの形態を表すものとして使用することも意図するものである。
【0020】
最深部の幅が0.2μm以下でそのアスペクト比が2以上である溝を少なくとも一つ有する基材の代表例として、トランジスター素子、ビット線、キャパシター、等を具備した電子デバイス用基板が挙げられる。このような電子デバイスの製作には、PMDと呼ばれるトランジスター素子とビット線間、トランジスター素子とキャパシター間、ビット線間とキャパシター間又はキャパシターと金属配線間の絶縁膜やIMDと呼ばれる金属配線間の絶縁膜の形成、或いはアイソレーション溝の埋封、といった工程に続き、微細溝の埋封材料を上下に貫通する孔を形成するスルーホールめっき工程が含まれる場合がある。既述のCVD法やゾルゲル液またはシロキサンポリマー溶液塗布法では、微細溝内部のシリカ質材料の密度が不均一となり、後続のスルーホールめっき工程における貫通孔の形成が困難である。また、PMDを形成する主な従来法としてBPSG膜が挙げられる。これはシリコン基板にトランジスター素子、ビット線を加工した後、B(ホウ素)及びP(リン)を含有したSiO2 膜をCVD法で形成し、続いて800〜900℃に加熱することにより溶融して凹凸のある素子の平坦化を行うものである。しかし、本発明による方法は、大がかりなCVD装置を使用する必要がなく、しかも後述するように比較的低温で高純度シリカ質膜が得られる点でBPSG法よりもはるかに有利である。
【0021】
本発明は、最深部の幅が0.2μm以下でそのアスペクト比が2以上である溝を少なくとも一つ有する基材に対し、その溝の内外で均質なシリカ質材料による埋封が必要とされる他のいずれの用途にも適している。このような用途として、例えば、液晶ガラスのアンダーコート(Na等パッシベーション膜)、液晶カラーフィルターのオーバーコート(絶縁平坦化膜)、フィルム液晶のガスバリヤ;基材(金属、ガラス)のハードコーティング、耐熱・耐酸化コーティング、防汚コーティング、撥水コーティング、親水コーティング;ガラス、プラスチックの紫外線カットコーティング、着色コーティング、が挙げられる。
【0022】
このような基材へのペルヒドロポリシラザン溶液の塗布方法に特に制限はなく、通常の塗布方法、例えば、スピンコート法、浸漬法、スプレー法、転写法、等が挙げられる。
ペルヒドロポリシラザン溶液の塗布後、塗膜の乾燥又は予備硬化の目的で、大気中、不活性ガス中又は酸素ガス中で50〜400℃の温度で10秒〜30分の処理条件による乾燥工程を行う。乾燥により溶媒は除去され、微細溝は実質的にペルヒドロポリシラザンによって埋封されることになる。
【0023】
本発明によると、微細溝内外に含まれるペルヒドロポリシラザンを、水蒸気を含む雰囲気において加熱することによりシリカ質材料に転化する。
水蒸気を含む雰囲気とは、水蒸気分圧が0.5〜101 kPaの範囲内にある雰囲気をいい、好ましくは1〜90 kPa、より好ましくは1.5〜80 kPaの範囲の水蒸気分圧を有する。加熱は400〜1200℃の温度範囲で行うことができる。
なお、水蒸気を含む雰囲気において高温で、例えば600℃を超える温度で、加熱すると、同時に加熱処理に晒される電子デバイス等の他の要素が存在する場合に当該他の要素への悪影響が懸念されることがある。このような場合には、シリカ転化工程を二段階以上に分け、最初に水蒸気を含む雰囲気において比較的低温で、例えば400〜600℃の温度範囲で加熱し、次いで水蒸気を含まない雰囲気においてより高温で、例えば500〜1200℃の温度範囲で加熱することができる。
【0024】
水蒸気を含む雰囲気における水蒸気以外の成分(以下、希釈ガスという。)としては任意のガスを使用することができ、具体例として空気、酸素、窒素、ヘリウム、アルゴン、等が挙げられる。希釈ガスは、得られるシリカ質材料の膜質の点では酸素を使用することが好ましい。しかしながら、希釈ガスは、当該加熱処理に晒される電子デバイス等の他の要素への影響をも考慮して適宜選択される。なお、上述の二段階加熱方式における水蒸気を含まない雰囲気としては、上記希釈ガスのいずれかを含む雰囲気の他、1.0 kPa未満の減圧または真空雰囲気を採用することもできる。
【0025】
これらの事情を勘案して設定される好適な加熱条件の例を挙げる。
(1)本発明によるペルヒドロポリシラザン溶液を所定の基材に塗布、乾燥後、温度が400〜600℃の範囲、水蒸気分圧が0.5〜101 kPaの範囲の雰囲気中で加熱し、引き続き温度が500〜1200℃の範囲で、酸素分圧が0.5〜101 kPaの範囲の雰囲気中で加熱すること;
(2)本発明によるペルヒドロポリシラザン溶液を所定の基材に塗布、乾燥後、温度が400〜600℃の範囲、水蒸気分圧が0.5〜101 kPaの範囲の雰囲気中で加熱し、引き続き温度が500〜1200℃の範囲で、窒素、ヘリウム及びアルゴンの中から選ばれる一種又は二種以上の不活性ガス雰囲気中で加熱すること;並びに
(3)本発明によるペルヒドロポリシラザン溶液を所定の基材に塗布、乾燥後、温度が400〜600℃の範囲、水蒸気分圧が0.5〜101 kPaの範囲の雰囲気中で加熱し、引き続き温度が500〜1200℃の範囲で、1.0 kPa未満の減圧または真空雰囲気中で加熱すること。
【0026】
加熱の際の目標温度までの昇温速度及び降温速度に特に制限はないが、一般に1℃〜100℃/分の範囲とすることができる。また、目標温度到達後の加熱保持時間にも特に制限はなく、一般に1分〜10時間の範囲とすることができる。
【0027】
上記の加熱工程により、ペルヒドロポリシラザンが水蒸気による加水分解反応を経てSi−O結合を主体とするシリカ質材料へ転化する。この転化反応は、脱水反応のような縮合反応を伴わず、また有機基の分解もないため、反応前後での体積変化が非常に小さい。このため、本発明により溝幅が0.2μm以下でアスペクト比が2以上である微細溝をシリカ質材料で埋封した場合には、溝壁面による拘束のためにシリカ質材料の密度が微細溝内部において一層低くなるという影響が極めて小さく、微細溝を、溝の内外、広狭を問わず、より均質に埋封することができる。また、本発明の方法によると、CVD法のようなコンフォーマル性がないため、微細溝内部にボイドや空洞部が発生することもない。さらに、本発明の方法によると、シリカ質転化時の体積収縮が小さいため、膜厚が0.5μm以上となる場合でもクラックが生じない。
【0028】
このように微細溝が比較的均質に埋封されたシリカ質膜付き基材は新規に提供されるものである。すなわち、本発明によると、最深部の幅が0.2μm以下であってその幅に対する深さの比が2以上である溝を少なくとも一つ有する基材と、当該溝を埋封するように設けられたシリカ質膜とを含んでなるシリカ質膜付き基材であって、当該シリカ質膜は、当該溝の内部において実質的にボイドを含まず且つ、当該溝の最深部におけるエッチングレートが当該シリカ質膜の表面におけるエッチングレートの3倍以下であることを特徴とするシリカ質膜付き基材が提供される。
【0029】
上述したように、本発明によるシリカ質膜はペルヒドロポリシラザンの加水分解反応により得られるため、Si−O結合を主体とするが、転化の程度によって多少のSi−N結合をも含有している。すなわち、シリカ質材料にSi−N結合が含まれているということは、その材料がポリシラザンに由来することを示すものである。具体的には、本発明によるシリカ質膜は、窒素を転化の程度により原子百分率で0.005〜5%の範囲で含有する。実際、この窒素含有量を0.005%よりも少なくすることは困難である。窒素の原子百分率は原子吸光分析法で測定することができる。
【0030】
本発明によるシリカ質膜は微細溝の内部に実質的にボイドを含まない。「ボイド」とは、一般にシリカ質材料中の空隙を意味し、その典型的なものとして直径約0.01μm以上の球形空隙が意図される。もちろん、「ボイド」は特定の形態を意図するものではなく、一般には不規則な形態となる。本明細書では、このようなボイドが溝に沿ってある程度連なって延びている状態を「空洞化」しているともいう。
従来の高密度プラズマCVD法では、CVD法固有のコンフォーマル性のため、溝幅が0.2μm以下でアスペクト比が2以上である微細溝を、このようなボイドを発生させずにシリカ質材料で埋封することは本質的に困難であり、CVD法で得られたシリカ質材料は微細溝内部が不連続となる。本発明によるシリカ質膜は、流動性の高いペルヒドロポリシラザン溶液を基材に塗布することにより得られるので、コンフォーマル性によるボイドの発生はなく、微細溝内部のシリカ質材料は連続したものとなる。
【0031】
本発明によるシリカ質膜は、溝の最深部におけるエッチングレートがシリカ質膜の表面におけるエッチングレートの3倍以下である。エッチングレートは、当該技術分野で周知であるように、材料の密度を定量化する測定値である。ある材料のエッチングレートが小さいほど、その材料の密度は高くなる。また、ある材料間においてエッチングレートの差が小さいほど、密度の差も小さいこととなる。溝の最深部におけるエッチングレートがシリカ質膜の表面におけるエッチングレートの3倍以下であるということは、本発明によるシリカ質膜は、溝の最深部とシリカ質膜の表面とで密度に3倍以上の差がないということである。本発明によるシリカ質膜は、溝の最深部におけるエッチングレートがシリカ質膜の表面におけるエッチングレートの好ましくは2倍以下、より好ましくは1.6倍以下である。
【0032】
従来のゾルゲル法やシロキサン系ポリマー溶液塗布法、或いは有機基を含むポリシラザンを用いた方法では、シリカ質材料への転化時に大きな体積収縮が発生するため、これらの方法により溝幅が0.2μm以下でアスペクト比が2以上である微細溝をシリカ質材料で埋封した場合には微細溝内部のシリカ質材料が密度に関して不均質となる。本発明によるシリカ質膜は、シリカ質材料への転化時に体積収縮がほとんどなく、シリカ質材料は溝の内外でより均質となる。
また、溝幅の異なる複数の微細溝間では、シリカ質材料への転化時に体積収縮が発生する場合には、溝が微細になればなるほど溝壁面による拘束の影響が大きくなり、本質的に溝内のシリカ質材料の密度は低くなる。本発明によるシリカ質膜は、シリカ質材料への転化時に体積収縮がほとんどないため、溝幅の異なる複数の微細溝間においても密度が均一化される。
【0033】
溝外部の表面に形成された塗膜の厚みに特に制限はなく、一般にはシリカ質材料への転化時に膜にクラックが生じない範囲の任意の厚さとすることができる。上述したように、本発明の方法によると膜厚が0.5μm以上となる場合でもクラックが生じないので、溝外部の表面には少なくとも0.5μmの厚さの塗膜を形成させることができる。
【0034】
【実施例】
以下、本発明を実施例によってさらに詳述する。
エッチングレートの測定方法
シリカ質材料の溝の最深部におけるエッチングレート(溝内部)と膜表面におけるエッチングレート(溝外部)とを以下のように測定した。
評価対象のポリマー40gを分取し、これを120gのキシレンに溶解させ、濾過精度0.1μmのPTFE製フィルターで濾過した。得られたポリマー溶液2mLを、表面が膜厚0.05μmのSi3 4 薄膜によって覆われ、深さが0.4μmで一定であり、幅が0.08μm、0.1μm、0.2μm、0.4μmの4種類(アスペクト比はそれぞれ5.0、4.0、2.0、1.0となる)である縦断面が長方形の溝を表面に有する直径101.6mm(4インチ)のシリコンウェハー(基材)上に滴下し、回転数2000 rpm、保持時間20秒の条件でスピンコートした。次いで、150℃のホットプレート上で3分間乾燥させた後、後述の各種方法で加熱してシリカ質膜を形成した。
得られたシリカ質膜付き基材を、溝の長手方向に対して直角の方向で切断し、断面の溝部分を、日立製作所製モデルS-5000の走査型電子顕微鏡(SEM)により倍率150000倍で断面に垂直な方向から観察し、図2に示すエッチング前の長さ(a)を測定した。
【0035】
次いで、溝の長手方向に対して直角の方向で切断したシリカ質膜付き基材を、0.5質量%のフッ化水素酸と40質量%のフッ化アンモニウムを含有する水溶液に20℃で1分間浸漬し、その後純水でよく洗浄して乾燥させた。そして、断面の溝部分を、同様に上記のSEMにより倍率150000倍で、まず断面に垂直な方向から観察し、図3に示すエッチング後の長さ(b)を測定した。続いて、断面の溝部分を、上記のSEMにより倍率300000倍で、断面に垂直な方向の仰角40度上方から溝最深部を観察して写真撮影し、写真上の長さから三角法により図4に示すエッチング後の長さ(c)を算出した。
なお、溝最深部のエッチング後の長さ(c)は溝の幅(アスペクト比)によって異なるので、4種類の幅の各溝について測定した。
【0036】
このようにして得られたa〜cを用いて、溝内部のエッチングレート(A)及び溝外部のエッチングレート(B)を以下のように求めた。
A=c
B=a−b
また、溝内部のエッチング後の界面(図4中の斜線部分)の状態を、上記SEM写真によって目視観察し、平滑であるもの、ボイドを有するもの、又は空洞化しているものに分類した。エッチング界面の状態は溝の幅(アスペクト比)によって異なるので、4種類の幅の各溝について評価した。
【0037】
比較例1
ポリスチレン換算重量平均分子量5000のメチルシロキサンポリマーを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度800℃、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定しようとしたが、溝内部がすべてのアスペクト比において空洞化していたため、測定不能であった。
【0038】
比較例2
ポリスチレン換算重量平均分子量5000の水素化シルセスキオキサンポリマーを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度800℃、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定しようとしたが、アスペクト比2以上の溝の内部には不均一なボイドが生成していたため、これらについては測定不能であった。アスペクト比1の溝については、溝内部のエッチングレート(A)が溝外部のエッチングレート(B)の8.5倍であった。なお、アスペクト比1の溝のエッチング界面の状態は平滑であった。
【0039】
比較例3
内容積2Lの四つ口フラスコにガス吹き込み管、メカニカルスターラー、ジュワーコンデンサーを装着した。反応器内部を乾燥窒素で置換した後、四つ口フラスコに乾燥ピリジン1500mL入れ、これをオイルバスにおいて40℃に保温した。次に、メチルヒドロジクロロシラン100gをゆっくりと加えた。反応混合物を氷冷し、攪拌しながらこれにゆっくりとアンモニア70gを吹き込んだ。引き続き乾燥窒素を液層に30分間吹き込み、過剰のアンモニアを除去した。
得られた生成物をブッフナーロートを用いて乾燥窒素雰囲気下で減圧濾過し、濾液1200mLを得た。エバポレーターを用いてピリジンを留去したところ、45gのポリメチルヒドロポリシラザンを得た。
【0040】
得られたポリメチルヒドロポリシラザンの重量平均分子量をGPC(展開液:CHCl3 )により測定したところ、ポリスチレン換算で5000であった。
このポリメチルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度800℃、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定しようとしたが、すべてのアスペクト比において溝内部に不均一なボイドが生成していたため、測定不能であった。
【0041】
比較例4
内容積2Lの四つ口フラスコにガス吹き込み管、メカニカルスターラー、ジュワーコンデンサーを装着した。反応器内部を乾燥窒素で置換した後、四つ口フラスコに乾燥ピリジン1500mL入れ、これを氷冷した。次いでジクロロシラン100gを加えると白色固体状のアダクト(SiH2 Cl2 ・2C5 5 N)が生成した。反応混合物を氷冷し、攪拌しながらこれにゆっくりとアンモニア70gを吹き込んだ。引き続き乾燥窒素を液層に30分間吹き込み、過剰のアンモニアを除去した。
得られた生成物をブッフナーロートを用いて乾燥窒素雰囲気下で減圧濾過し、濾液1200mLを得た。エバポレーターを用いてピリジンを留去したところ、40gのペルヒドロポリシラザンを得た。
【0042】
得られたペルヒドロポリシラザンの重量平均分子量をGPC(展開液:CHCl3 )により測定したところ、ポリスチレン換算で1500であった。
このペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度800℃で、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、アスペクト比2.0以上の溝内部のエッチングレートは溝外部のエッチングレートの3倍以上となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0043】
比較例5
内容積2Lの四つ口フラスコにガス吹き込み管、メカニカルスターラー、ジュワーコンデンサーを装着した。反応器内部を乾燥窒素で置換した後、四つ口フラスコに乾燥ピリジン1500mL入れ、これをオイルバスにおいて60℃に保温した。次いでジクロロシラン100gを加えると白色固体状のアダクト(SiH2 Cl2 ・2C5 5 N)が生成した。反応混合物を氷冷し、攪拌しながらこれにゆっくりとアンモニア70gを吹き込んだ。引き続き乾燥窒素を液層に30分間吹き込み、過剰のアンモニアを除去した。
得られた生成物をブッフナーロートを用いて乾燥窒素雰囲気下で減圧濾過し、濾液1200mLを得た。エバポレーターを用いてピリジンを留去したところ、45gのペルヒドロポリシラザンを得た。
【0044】
得られたペルヒドロポリシラザンの重量平均分子量をGPC(展開液:CHCl3 )により測定したところ、ポリスチレン換算で30000であった。
このペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度800℃で、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチング前のSEM観察を行ったところ、アスペクト比2.0以上の溝の内部に直径0.01〜0.05μmの円形の空洞が認められた。
【0045】
実施例1
内容積2Lの四つ口フラスコにガス吹き込み管、メカニカルスターラー、ジュワーコンデンサーを装着した。反応器内部を乾燥窒素で置換した後、四つ口フラスコに乾燥ピリジン1500mL入れ、これをオイルバスにおいて20℃に保温した。次いでジクロロシラン100gを加えると白色固体状のアダクト(SiH2 Cl2 ・2C5 5 N)が生成した。反応混合物を氷冷し、攪拌しながらこれにゆっくりとアンモニア70gを吹き込んだ。引き続き乾燥窒素を液層に30分間吹き込み、過剰のアンモニアを除去した。
得られた生成物をブッフナーロートを用いて乾燥窒素雰囲気下で減圧濾過し、濾液1200mLを得た。エバポレーターを用いてピリジンを留去したところ、45gのペルヒドロポリシラザンを得た。
【0046】
得られたペルヒドロポリシラザンの重量平均分子量をGPC(展開液:CHCl3 )により測定したところ、ポリスチレン換算で4000であった。
このペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度800℃で、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0047】
実施例2
内容積2Lの四つ口フラスコにガス吹き込み管、メカニカルスターラー、ジュワーコンデンサーを装着した。反応器内部を乾燥窒素で置換した後、四つ口フラスコに乾燥ピリジン1500mL入れ、これをオイルバスにおいて40℃に保温した。次いでジクロロシラン100gを加えると白色固体状のアダクト(SiH2 Cl2 ・2C5 5 N)が生成した。反応混合物を氷冷し、攪拌しながらこれにゆっくりとアンモニア70gを吹き込んだ。引き続き乾燥窒素を液層に30分間吹き込み、過剰のアンモニアを除去した。
得られた生成物をブッフナーロートを用いて乾燥窒素雰囲気下で減圧濾過し、濾液1200mLを得た。エバポレーターを用いてピリジンを留去したところ、45gのペルヒドロポリシラザンを得た。
【0048】
得られたペルヒドロポリシラザンの重量平均分子量をGPC(展開液:CHCl3 )により測定したところ、ポリスチレン換算で10000であった。
このペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度800℃で、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0049】
実施例3
実施例2で得られたペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度400℃で、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0050】
実施例4
実施例2で得られたペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度600℃で、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0051】
実施例5
実施例2で得られたペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度1000℃で、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0052】
実施例6
実施例2で得られたペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度1150℃で、水蒸気分圧5 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0053】
実施例7
実施例2で得られたペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度700℃で、水蒸気分圧50 kPaを含む酸素雰囲気(酸素分圧96 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0054】
実施例8
実施例2で得られたペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度500℃、水蒸気分圧5 kPaを含む雰囲気(酸素分圧96 kPa)中で1時間加熱し、引き続き温度600℃の酸素雰囲気(酸素分圧101 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0055】
実施例9
実施例2で得られたペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度500℃、水蒸気分圧5 kPaを含む雰囲気中で1時間加熱し、引き続き温度700℃の窒素雰囲気(窒素分圧101 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0056】
実施例10
実施例2で得られたペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜を温度500℃、水蒸気分圧5 kPaを含む雰囲気(酸素分圧96 kPa)中で1時間加熱し、引き続き温度1150℃の窒素雰囲気(窒素分圧101 kPa)中で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
【0057】
実施例11
実施例2で得られたペルヒドロポリシラザンを上記方法により上記基材上に塗布して乾燥させた。この塗膜をシリカ質膜へ転化させるため、温度500℃、水蒸気分圧5 kPaを含む雰囲気(酸素分圧96 kPa)中で1時間加熱し、引き続き約1.33Pa(0.01Torr)の真空下、温度700℃で1時間加熱した。上記方法でエッチングレートを測定したところ、すべてのアスペクト比において溝内部のエッチングレートが溝外部のエッチングレートの3倍以下となった。溝のエッチング界面の状態はすべてのアスペクト比において平滑であった。
比較例(1〜5)及び実施例(1〜11)の結果を表1にまとめる。
【0058】
【表1】
Figure 0005020425
【0059】
上記の結果より、本発明の方法により得られたシリカ質膜(実施例1〜11)は、アスペクト比1〜5の範囲にわたり溝内部エッチングレート/溝外部エッチングレートの比率が3以下であり、この比率が最大で5.5となった比較例4や、ボイド又は空洞を有する他の比較例よりも、埋封材料の緻密性に関する溝の内外差が小さいことがわかる。
また、溝幅の異なる複数の微細溝間(アスペクト比1と5の溝)については、本発明によるシリカ質膜では緻密性に最大でも約1.6倍の差(実施例4、11)しかないが、比較例4では緻密性に3倍以上の差が認められた。
さらに、本発明によると、緻密性に関する溝の内外差がシリカ質膜の密度の大小に関わらないことがわかる。例えば、実施例3と実施例6とを比較すると、溝のエッチングレートの内外比率はほとんど同じであるが、溝外部のエッチングレート値から、実施例6のシリカ質膜は実施例3のものよりも約26倍も緻密であることがわかる。このように本発明によると、低密度のシリカ質膜を形成しても、高密度のシリカ質膜を形成しても、これらの微細溝の内外差にはほとんど影響がない。
【0060】
【発明の効果】
本発明によると、最深部の幅が0.2μm以下であってその幅に対する深さの比が2以上であるような微細溝を、シリカ質材料によって、溝の内外、広狭に関わらず、緻密性に関してより均質に埋封することができる。
【図面の簡単な説明】
【図1】本発明を適用し得る溝の形状の例を示した略縦断面図である。
【図2】本発明によるエッチングレートの測定方法を説明するためのシリカ質膜付き基材の略縦断面図である。
【図3】本発明によるエッチングレートの測定方法を説明するためのシリカ質膜付き基材の略縦断面図である。
【図4】本発明によるエッチングレートの測定方法を説明するためのシリカ質膜付き基材の略斜視図である。

Claims (1)

  1. ポリスチレン換算重量平均分子量が3000〜20000の範囲にあるペルヒドロポリシラザンの溶液を、最深部の幅が0.2μm以下であってその幅に対する深さの比が2以上である溝を少なくとも一つ有する基材に塗布して乾燥することにより前記溝を前記ペルヒドロポリシラザンで埋封し、その後前記ペルヒドロポリシラザンを水蒸気分圧が5〜50kPaの範囲にある雰囲気において400〜600℃の温度範囲で加熱することによりシリカ質材料に転化することを特徴とする、微細溝をシリカ質材料で埋封する方法。
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Families Citing this family (56)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7053005B2 (en) 2000-05-02 2006-05-30 Samsung Electronics Co., Ltd. Method of forming a silicon oxide layer in a semiconductor manufacturing process
KR100362834B1 (ko) * 2000-05-02 2002-11-29 삼성전자 주식회사 반도체 장치의 산화막 형성 방법 및 이에 의하여 제조된 반도체 장치
JP4018596B2 (ja) 2002-10-02 2007-12-05 株式会社東芝 半導体装置の製造方法
KR100508861B1 (ko) * 2003-01-30 2005-08-17 동부아남반도체 주식회사 박막 커패시터 및 그 제조 방법
KR100503527B1 (ko) 2003-02-12 2005-07-26 삼성전자주식회사 퍼하이드로 폴리실라잔을 포함하는 반도체 소자 제조용조성물 및 이를 이용한 반도체 소자의 제조방법
JP2004273519A (ja) * 2003-03-05 2004-09-30 Clariant (Japan) Kk トレンチ・アイソレーション構造の形成方法
US6869860B2 (en) * 2003-06-03 2005-03-22 International Business Machines Corporation Filling high aspect ratio isolation structures with polysilazane based material
TWI326114B (en) * 2003-07-18 2010-06-11 Az Electronic Materials Japan A phosphorous-containing silazane composition, a phosphorous-containing siliceous film, a phosphorous-containing siliceous filing material, a production method of a siliceous film and semiconductor device
JP4342895B2 (ja) * 2003-10-06 2009-10-14 東京エレクトロン株式会社 熱処理方法及び熱処理装置
JP2005166700A (ja) 2003-11-28 2005-06-23 Toshiba Corp 半導体装置及びその製造方法
JP2005347636A (ja) * 2004-06-04 2005-12-15 Az Electronic Materials Kk トレンチ・アイソレーション構造の形成方法
CN101080282B (zh) * 2004-12-17 2010-05-12 国立大学法人德岛大学 基材表面的改性方法、具有改性表面的基材及其制造方法
JP4607613B2 (ja) * 2005-02-09 2011-01-05 株式会社東芝 半導体装置の製造方法
US7682927B2 (en) 2005-03-25 2010-03-23 Kabushiki Kaisha Toshiba Method of manufacturing semiconductor device
JP4331133B2 (ja) * 2005-03-25 2009-09-16 株式会社東芝 半導体装置の製造方法
JP4901221B2 (ja) * 2006-01-17 2012-03-21 株式会社東芝 半導体装置の製造方法
DE102006008308A1 (de) * 2006-02-23 2007-08-30 Clariant International Limited Polysilazane enthaltende Beschichtungen zur Vermeidung von Zunderbildung und Korrosion
KR101412453B1 (ko) 2006-09-08 2014-06-30 에이제토 엘렉토로닉 마티리알즈 아이피 (재팬) 가부시키가이샤 실리카질 막 형성용 조성물 및 이를 사용한 실리카질 막의 제조법
JP2008101206A (ja) * 2006-09-21 2008-05-01 Jsr Corp シリコーン樹脂、シリコーン樹脂組成物およびトレンチアイソレーションの形成方法
US20100029057A1 (en) * 2006-09-21 2010-02-04 Jsr Corporation Silicone resin composition and method of forming a trench isolation
JP2008266119A (ja) * 2006-11-24 2008-11-06 Jsr Corp シリコーン樹脂、シリコーン樹脂組成物およびトレンチアイソレーションの形成方法
JP5058733B2 (ja) * 2007-09-12 2012-10-24 AzエレクトロニックマテリアルズIp株式会社 ケイ素含有微細パターン形成用組成物を用いた微細パターン形成方法
TWI452419B (zh) * 2008-01-28 2014-09-11 Az Electronic Mat Ip Japan Kk 細微圖案光罩及其製造方法、及使用其之細微圖案形成方法
JP5329825B2 (ja) 2008-02-25 2013-10-30 株式会社東芝 半導体装置の製造方法
JP5306669B2 (ja) * 2008-02-29 2013-10-02 AzエレクトロニックマテリアルズIp株式会社 シリカ質膜の形成方法およびそれにより形成されたシリカ質膜
JP5405031B2 (ja) * 2008-03-06 2014-02-05 AzエレクトロニックマテリアルズIp株式会社 シリカ質膜の製造に用いる浸漬用溶液およびそれを用いたシリカ質膜の製造法
US7999355B2 (en) 2008-07-11 2011-08-16 Air Products And Chemicals, Inc. Aminosilanes for shallow trench isolation films
JP5700615B2 (ja) * 2009-02-02 2015-04-15 旭化成イーマテリアルズ株式会社 ポリシラザン系トレンチ埋め込み用組成物
US8084186B2 (en) * 2009-02-10 2011-12-27 Az Electronic Materials Usa Corp. Hardmask process for forming a reverse tone image using polysilazane
US8906153B2 (en) 2009-06-24 2014-12-09 Asahi Kasei E-Materials Corporation Product of polysiloxane condensation
JP5692736B2 (ja) 2009-10-05 2015-04-01 株式会社Adeka 絶縁膜形成用塗布液、それを用いた絶縁膜
KR101288574B1 (ko) 2009-12-02 2013-07-22 제일모직주식회사 갭필용 충전제 및 상기 충전제를 사용한 반도체 캐패시터의 제조 방법
JP5172867B2 (ja) * 2010-01-07 2013-03-27 AzエレクトロニックマテリアルズIp株式会社 ポリシラザンを含むコーティング組成物
US8766240B2 (en) * 2010-09-21 2014-07-01 Universal Display Corporation Permeation barrier for encapsulation of devices and substrates
CN102569060B (zh) * 2010-12-22 2015-03-11 第一毛织株式会社 形成硅氧层的组合物及其生产方法、利用其的硅氧层及生产硅氧层的方法
JP5781323B2 (ja) 2011-02-18 2015-09-16 メルク、パテント、ゲゼルシャフト、ミット、ベシュレンクテル、ハフツングMerck Patent GmbH 絶縁膜の形成方法
KR101432606B1 (ko) 2011-07-15 2014-08-21 제일모직주식회사 갭필용 충전제, 이의 제조 방법 및 이를 사용한 반도체 캐패시터의 제조 방법
JP2013030614A (ja) * 2011-07-28 2013-02-07 Dainippon Screen Mfg Co Ltd 膜形成方法および膜形成装置
JP6060460B2 (ja) 2012-11-22 2017-01-18 アーゼット・エレクトロニック・マテリアルズ(ルクセンブルグ)ソシエテ・ア・レスポンサビリテ・リミテ シリカ質膜の形成方法及び同方法で形成されたシリカ質膜
KR101556672B1 (ko) 2012-12-27 2015-10-01 제일모직 주식회사 실리카계 절연층 형성용 조성물, 실리카계 절연층 형성용 조성물의 제조방법, 실리카계 절연층 및 실리카계 절연층의 제조방법
CN103910885A (zh) 2012-12-31 2014-07-09 第一毛织株式会社 制备间隙填充剂的方法、用其制备的间隙填充剂和使用间隙填充剂制造半导体电容器的方法
US10227160B2 (en) 2013-09-04 2019-03-12 Owens-Brockway Glass Container Inc. Polysilazane-derived coating for glass containers
KR101825546B1 (ko) 2014-05-26 2018-02-05 제일모직 주식회사 실리카계 막 형성용 조성물, 및 실리카계 막의 제조방법
KR101806328B1 (ko) * 2014-10-07 2017-12-07 삼성에스디아이 주식회사 실리카계 막 형성용 조성물, 실리카계 막, 및 전자 디바이스
US10020185B2 (en) 2014-10-07 2018-07-10 Samsung Sdi Co., Ltd. Composition for forming silica layer, silica layer, and electronic device
KR101833800B1 (ko) 2014-12-19 2018-03-02 삼성에스디아이 주식회사 실리카계 막 형성용 조성물, 실리카계 막의 제조방법 및 상기 실리카계 막을 포함하는 전자 소자
KR101837971B1 (ko) 2014-12-19 2018-03-13 삼성에스디아이 주식회사 실리카계 막 형성용 조성물, 실리카계 막, 및 전자 디바이스
KR20170014946A (ko) 2015-07-31 2017-02-08 삼성에스디아이 주식회사 실리카 막 형성용 조성물, 실리카 막의 제조방법 및 실리카 막
TWI751127B (zh) * 2015-12-17 2022-01-01 日商信越化學工業股份有限公司 藍寶石複合基材與其製造方法
US10316216B2 (en) 2016-08-31 2019-06-11 Samsung Sdi Co., Ltd. Composition for forming silica layer, and silica layer
US10647578B2 (en) 2016-12-11 2020-05-12 L'Air Liquide, Société Anonyme pour l'Etude et l'Exploitation des Procédés Georges Claude N—H free and SI-rich per-hydridopolysilzane compositions, their synthesis, and applications
JP7013832B2 (ja) * 2017-08-18 2022-02-01 コニカミノルタ株式会社 塗布液、当該塗布液を用いたインクジェット用インク、封止膜及び封止膜の形成方法
KR102194975B1 (ko) * 2017-10-13 2020-12-24 삼성에스디아이 주식회사 실리카 막 형성용 조성물, 실리카 막의 제조방법 및 실리카 막
US11739220B2 (en) 2018-02-21 2023-08-29 L'Air Liquide, Société Anonyme pour l'Etude et l'Exploitation des Procédés Georges Claude Perhydropolysilazane compositions and methods for forming oxide films using same
KR102395487B1 (ko) 2019-08-21 2022-05-06 삼성에스디아이 주식회사 실리카 막 형성용 조성물 및 실리카 막
KR20210128235A (ko) * 2020-04-16 2021-10-26 삼성에스디아이 주식회사 실리카 막 형성용 조성물, 그로부터 형성된 실리카 막, 및 상기 실리카 막을 포함하는 전자 소자

Family Cites Families (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01223742A (ja) * 1988-03-02 1989-09-06 Nec Corp トレンチ絶縁分離層の形成方法
JPH05243212A (ja) * 1992-02-28 1993-09-21 Fujitsu Ltd 半導体装置の製造方法
JPH05243223A (ja) * 1992-02-28 1993-09-21 Fujitsu Ltd 集積回路装置の製造方法
JPH06204214A (ja) * 1992-12-28 1994-07-22 Tonen Corp スパッタリング用窒化珪素系ターゲット材料
JPH088248A (ja) * 1994-06-16 1996-01-12 Fujitsu Ltd 半導体装置の製造方法
US5747623A (en) 1994-10-14 1998-05-05 Tonen Corporation Method and composition for forming ceramics and article coated with the ceramics
US5907382A (en) * 1994-12-20 1999-05-25 Kabushiki Kaisha Toshiba Transparent conductive substrate and display apparatus
US5922411A (en) 1995-07-13 1999-07-13 Tonen Corporation Composition for forming ceramic material and process for producing ceramic material
JP3696939B2 (ja) * 1995-08-11 2005-09-21 東京応化工業株式会社 シリカ系被膜の形成方法
JPH09239992A (ja) * 1996-03-12 1997-09-16 Canon Inc 液体噴射記録ヘッド、その製造方法、及び該ヘッドを有する液体噴射記録装置
JP2904110B2 (ja) 1996-04-02 1999-06-14 日本電気株式会社 半導体装置の製造方法
JP3718034B2 (ja) * 1997-11-11 2005-11-16 株式会社ルネサステクノロジ 半導体集積回路装置の製造方法
JP3686248B2 (ja) * 1998-01-26 2005-08-24 株式会社日立製作所 半導体集積回路装置およびその製造方法
JP3178412B2 (ja) * 1998-04-27 2001-06-18 日本電気株式会社 トレンチ・アイソレーション構造の形成方法

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