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JP2003037162A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JP2003037162A
JP2003037162A JP2001221897A JP2001221897A JP2003037162A JP 2003037162 A JP2003037162 A JP 2003037162A JP 2001221897 A JP2001221897 A JP 2001221897A JP 2001221897 A JP2001221897 A JP 2001221897A JP 2003037162 A JP2003037162 A JP 2003037162A
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JP
Japan
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film
interlayer insulating
hard mask
insulating film
forming
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JP2001221897A
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Kaoru Maekawa
薫 前川
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Tokyo Electron Ltd
Original Assignee
Tokyo Electron Ltd
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Publication date
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Abstract

(57)【要約】 【課題】 製造工程数が少なく効率的な半導体装置の製
造方法を提供する。 【解決手段】 デュアルダマシン法を利用した多層配線
構造を有する半導体装置の製造方法において、実質的に
は第一のハードマスク膜270をマスクとして、第二の
層間絶縁膜260を除去し、開口部260Aを形成す
る。さらに、エッチングストッパ膜250を除去し、そ
の後、第一の層間絶縁膜240を除去して、第一の層間
絶縁膜240にヴィアホール240Aを形成する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、半導体装置の製造
方法に関し、より詳細には、製造工程数が少なく効率的
な多層配線構造を有する半導体装置の製造方法に関す
る。
【0002】
【従来の技術】半導体装置の微細化に伴い、今日の先端
的な半導体装置では基板上に数多くの半導体素子が形成
されている。かかる半導体装置にて、基板上の半導体素
子間を接続させるには、一層の配線層では不十分であ
り、複数の配線層を層間絶縁膜を介して積層させた、い
わゆる多層配線構造が利用されている。
【0003】特に、最近では、層間絶縁膜中に配線部分
となる溝(以下、「配線溝」という)と、ヴィアコンタ
クトになる孔(以下、「ヴィアホール」という)とを予
め形成しておき、上記配線溝及びヴィアホールを導体で
埋めることにより配線層を形成する、いわゆるデュアル
ダマシン法による多層配線構造の研究・開発が盛んに行
われている。
【0004】デュアルダマシン法には種々な変形法が存
在するが、特開2000−124306号公報には、層
間絶縁膜を利用した半導体装置の製造方法が開示されて
いる。層間絶縁膜を使ったデュアルダマシン構造の多層
配線構造の形成方法を、図1(A)〜図2(C)に示
す。
【0005】図1(A)を参照するに、基板10上に
は、図示しない絶縁膜を介してCuよりなる第一の配線
パターン11が形成されており、前記配線パターン11
上には、バリア膜12としてSiN膜が形成されてい
る。次に、前記バリア膜12上に、第一の層間絶縁膜1
3としての有機SOG膜が形成され、さらに前記第一の
層間絶縁膜13上に絶縁膜14としてSiO膜が形成
されている。
【0006】さらに、第二の層間絶縁膜15が前記絶縁
膜14上に設けられ、次に、前記第二の層間絶縁膜15
上に2層構造のハードマスク膜16、17が形成され
る。具体的には、約20nmのSiNよりなる第一のハ
ードマスク膜16と、約100nmのSiOからなる
第二のハードマスク膜17とが形成されている。これら
ハードマスク16、17は、エッチングストッパと呼ば
れることもある。
【0007】前記第二のハードマスク膜17の形成後、
図1(B)の工程において、前記第二のハードマスク膜
17上に、前記第二の層間絶縁膜中に形成したい配線溝
に対応した開口部20Aを有するレジストパターン20
が形成される。図1(C)の工程にて、前記レジストパ
ターン20をマスクとして、前記第二のハードマスク膜
17を、例えば、CF/Ar系のドライエッチングに
よりパターニングし、その後前記レジストパターン20
をアッシングにより除去する。前記第二のハードマスク
膜17のパターニングにより、前記マスク17中には前
記開口部20Aに対応した開口部17Aが形成される。
前記開口部17Aにおいて、第一のハードマスク膜16
が露出される。
【0008】つぎに、図1(D)に示すように、前記第
一の層間絶縁膜13に形成したいヴィアホールに対応し
た開口部21Aを有するレジストパターン21が形成さ
れる。図1(E)の工程において、前記レジストパター
ン21をマスクとして、前記第一のハードマスク膜16
をパターニングし、続いて前記第二の層間絶縁膜15を
ドライエッチングする。その際に、前記絶縁膜14がエ
ッチングストッパとして働く。しかる後に、前記レジス
トパターン21をアッシング等により除去する。
【0009】図2(A)の工程にて、前記第二のハード
マスク膜17をマスクとして、その下層の表出した前記
第一のハードマスク膜16をドライエッチングにより除
去する。その際同時に、前記絶縁膜14も除去される。
【0010】次に、図2(B)の工程で、残留している
前記第二のハードマスク膜17をマスクとして、前記第
二及び第一の層間絶縁膜15、13をドライエッチング
によりパターニングして、配線溝25及びヴィアホール
26を同時に開口させる。その際、前記絶縁膜14はヴ
ィアホールを形成する際のマスクとして作用する。
【0011】さらに、図2(C)に示す工程で、前記ヴ
ィアホール26の底部に表出したバリア膜12をドライ
エッチングにより除去する。その後、図2(D)の工程
にて、図2(C)の構造上に前記ヴィアホール26及び
配線溝25を埋めるようにCu膜30を堆積させて、化
学機械研磨法(以下、「CMP法」という)により前記
第二のハードマスク膜17上にある余分なCu膜を除去
して、前記ヴィアホール26及び配線溝25を埋めるC
u配線パターンを形成することができる。
【0012】
【発明が解決しようとする課題】しかしながら、前記製
造方法では半導体装置の製造工程の数が多く、そのため
歩留まりに悪影響を及ぼし、半導体装置の製造コストの
増大が避けられない。
【0013】本発明は上述の点に鑑みてなされたもので
あり、上記の問題点を解決した新規で有用であり、かつ
従来の製造方法と比較して製造工程数を削減させた、半
導体装置の製造方法を提供することを包括的課題とす
る。
【0014】本発明のより具体的な課題は、デュアルダ
マシン構造を有する半導体装置の効率的な製造方法を提
供することである。
【0015】
【課題を解決するための手段】本発明に係る半導体装置
の製造方法は、基板上にあるバリア膜上に第一の層間絶
縁膜を形成する工程と、前記第一の層間絶縁膜上に第二
の層間絶縁膜を形成する工程と、前記第二の層間絶縁膜
上に第一のハードマスク膜を形成する工程と、前記第一
のハードマスク膜上に、前記第一のハードマスク膜とは
異なる第二のハードマスク膜を形成する工程とを含む半
導体装置の製造方法であって、前記第二のハードマスク
膜上に形成させた所望のレジストパターンをマスクとし
て、前記第一のハードマスク膜が露出するように、前記
第二のハードマスク膜に第一の開口部を形成する工程
と、前記第二のハードマスク膜及び前記第一のハードマ
スク膜上に形成させた所望のレジストパターンをマスク
として、前記露出した第一のハードマスク膜中に第二の
開口部を形成する工程と、前記第一のハードマスク膜を
マスクとして、前記第二の層間絶縁膜に前記第二の開口
部に対応した開口部を形成するように、前記第二の層間
絶縁膜を除去する第一の除去工程と、前記第一のハード
マスク膜をマスクとして、前記第一の層間絶縁膜に前記
第二の開口部に対応したヴィアホールを形成し、前記バ
リア膜が露出するように前記第一の層間絶縁膜を除去す
る第二の除去工程と、前記第二のハードマスク膜をマス
クとして、前記第一のハードマスク膜及び前記ヴィアホ
ールの底部に露出したバリア膜を同時に除去する第三の
除去工程と、前記第二のハードマスク膜をマスクとし
て、前記第二の層間絶縁膜に前記第一の開口部に対応し
た配線溝を形成するように、前記第二の層間絶縁膜を除
去する第四の除去工程と、を具備することを特徴とす
る。
【0016】また、本発明に係る半導体装置の製造方法
は、前記第四の除去工程は、N及びHを含むガスを利用
したプラズマエッチングにより行われることを特徴とす
る。
【0017】また、本発明に係る半導体装置の製造方法
は、前記第二の層間絶縁膜は有機低誘電率膜であること
を特徴とする。
【0018】また、本発明に係る半導体装置の製造方法
は、前記第一の層間絶縁膜を形成する工程と前記第二の
層間絶縁膜を形成する工程との間にエッチングストッパ
膜を形成する工程をさらに有し、前記第二の除去工程に
おいて、前記第一の層間絶縁膜とともに前記エッチング
ストッパ膜を除去することを特徴とする。 [作用]本発明によれば、基板と、前記基板上に形成さ
れたバリア膜と、前記バリア膜上に形成された第一の層
間絶縁膜と、前記第一の層間絶縁膜上に形成された第二
の層間絶縁膜と、前記第二の層間絶縁膜上に形成された
第一のハードマスク膜と、前記第一のハードマスク膜上
に形成された第二のハードマスク膜とを有する多層配線
構造からなる半導体装置の製造方法において、開口部を
有する前記第一のハードマスク膜を実質的にマスクとし
て、開口部を形成するように前記第二の層間絶縁膜を除
去し、次いで、バリア膜が露出するように前記第一の層
間絶縁膜を除去する。次に、開口部を有する前記第二の
ハードマスク膜をマスクとして、前記第一のハードマス
ク膜及び前記ヴィアホールの底部に露出したバリア膜を
同時に除去する。したがって製造工程全体の工程数が従
来に比べて低減する。しかる後に、配線溝を形成するよ
うに第二の層間絶縁膜を除去することにより、配線溝と
ヴィアホールを有する構造が形成される。第二の層間絶
縁膜を除去する工程は、Nを含むガスを利用したプラズ
マエッチングにより実行することにより、エッチング時
に前記バリア膜の下に位置する導体であるCuの、露出
する表面に損傷を与えずに配線溝を形成することができ
る。
【0019】
【発明の実施の形態】図3は、本発明の各実施例で使用
されるプラズマ処理装置100の構成を示す。図3を参
照するに、プラズマ処理装置100は被処理基板Wを保
持する保持台106を収納した処理室102を形成する
反応容器104を具備する。前記反応容器104の上部
には、絶縁部材105により電気的に絶縁されている。
ライン122からプラズマガスを供給させるシャワーヘ
ッド114が、前記保持台106上の被処理基板Wに対
面するように配設されている。前記シャワーヘッド11
4は数多の開口部114aを備え、かかる開口部114
aを介して前記ライン122から供給されたプラズマガ
スが前記保持台106上に保持されている被処理基板W
に向けて流される。一方、前記処理室102は排気ポー
ト124を介して排気される。
【0020】前記保持台106には、コントローラ11
2により制御されるバイアス電源110から整合器10
8を介して、2MHzの高周波電力が供給される。一
方、前記シャワーヘッド114には同じくコントローラ
112により制御されるプラズマ励起電源120から整
合器118を介して、60MHzの高周波電力が供給さ
れる。その結果、下側電極として作用する保持台106
と上側電極として作用するシャワーヘッド114との間
に、プラズマが形成される。
【0021】本発明においては、かかるプラズマによ
り、前記被処理基板W上に形成された層間絶縁膜等が処
理される。 [実施例]図4(A)から図6(B)には、本発明によ
る多層配線構造を有する半導体装置の製造工程を示す。
ただし、説明を簡潔にするため、多層配線構造が形成さ
れる部分のみを図示し、能動素子が形成される部分の説
明は省略する。
【0022】図4(A)を参照するに、MOSトランジ
スタ等、図示しない能動素子が形成されたSi基板20
0はCVD−SiOなどの層間絶縁膜210により覆
われており、前記層間絶縁膜210上にはCuからなる
配線パターン220Aが形成されている。前記配線パタ
ーン220Aは、前記層間絶縁膜210上に形成された
層間絶縁膜220中に埋め込まれている。前記配線パタ
ーン220A及び層間絶縁膜220Bによりなる配線層
220は、プラズマCVD法により形成されたSiN等
のバリア膜230により覆われている。
【0023】前記バリア膜230は、さらに第一の層間
絶縁膜240により覆われ、前記層間絶縁膜240上に
は、SiN等のエッチングストッパ膜250が形成され
ている。エッチングストッパ膜として、SiN膜のほか
に、SiON膜やSiOC膜からなるものでもかまわな
い。
【0024】図示の例では、前記エッチングストッパ膜
250上にはさらに第二の層間絶縁膜260が形成さ
れ、さらに前記第二の層間絶縁膜260には第一のハー
ドマスク膜270と、前記第一のハードマスク膜270
とは異なる第二のハードマスク膜280により順次覆わ
れている。前記ハードマスク膜270、280の具体例
として、SiN膜からなる第一のハードマスク膜270
とSiO膜からなる第二のハードマスク膜280との
組合せ、SiON膜からなる第一のハードマスク膜27
0とSiO膜からなる第二のハードマスク膜280と
の組合せ、SiO 膜、SiON膜、SiN膜あるいは
SiC膜からなる群から選択された第一のハードマスク
膜270と、アモルファスSi膜からなる第二のハード
マスク膜280との組合せ、SiO膜、SiN膜、S
iC膜からなる群から選択された第一のハードマスク膜
270と、TiN膜からなる第二のハードマスク膜28
0との組合せ等があるが、上記の組合せに限定されるも
のではない。前記ハードマスクの形成方法として、典型
的にはプラズマCVD法により実行することができる
が、他の成膜方法を使用してもよい。
【0025】また、図示の例では前記第一の層間絶縁膜
240は有機膜及び/又は無機膜でもよく、その成膜方
法としてはスピンコート法やプラズマCVD法により行
うことができる。最終的に配線層を構成することになる
前記第二の層間絶縁膜260はN(窒素)とH(水素)
を含むガスによりエッチングできるものが好ましい。特
に、近年の配線遅延の問題を解決するために、従来の層
間絶縁膜と比して誘電率の低い有機層間絶縁膜がより好
ましい。具体的には、ダウ・ケミカル社製のSiLK
(商標名)などがある。
【0026】以下の説明では、第一の層間絶縁膜と第二
の層間絶縁膜との間にエッチングストッパ膜250を有
する多層配線構造を利用して説明するが、本発明による
製造方法によれば、前記エッチングストッパ膜250を
有しない多層配線構造にも適用可能である。
【0027】図4(B)の工程では、前記第二のハード
マスク膜280上にフォトリソグラフィー工程により所
望の配線溝に対応した開口部300Aを有するレジスト
パターン300が形成され、前記レジストパターン30
0をマスクにして、前記第二のハードマスク膜280
を、例えばCF/Ar系のドライエッチングにより除
去する。その結果、前記配線溝に対応した開口部280
Aが第二のハードマスク膜280中に形成される。その
後、前記レジストパターン300を酸素ラジカル雰囲気
下に晒すことによるアッシングにより剥離させる。第二
のハードマスク膜280の開口部280Aを介して、第
一のハードマスク膜270が露出される。
【0028】図4(C)の工程にて、前記第二のハード
マスク膜280及び前記第一のハードマスク膜270上
にフォトリソグラフィー工程により所望のヴィアホール
に対応した開口部310Aを有するレジストパターン3
10が形成され、前記レジストパターン310をマスク
にして、前記第一のハードマスク膜270を、例えばC
/Ar系のドライエッチングにより除去する。その
結果、前記ヴィアホールに対応した開口部270Aが第
一のハードマスク膜270中に形成され、第二の層間絶
縁膜260が露出される。
【0029】次に、図5(A)の工程で、図3に示した
プラズマ処理装置にてN(窒素)とH(水素)を含むガ
ス系で、ドライエッチングすることにより、図4(C)
の工程のレジストパターン310をマスクとして、言い
かえれば、実質的には第一のハードマスク膜270をマ
スクとして、第二の層間絶縁膜260を除去し、前記開
口部310Aに対応した開口部260Aが形成される。
このとき、レジストパターン300が同時に除去され
る。
【0030】しかる後に、図5(B)の工程に示すよう
に、図3に示すプラズマ処理装置にてドライエッチング
することにより、前記第一のハードマスク膜270をマ
スクとして、前記第一のハードマスク膜270中に形成
された開口部270Aに対応させて前記エッチングスト
ッパ膜250をCF系のガスで除去し、その後、前記第
一の層間絶縁膜240を除去する。したがって、前記第
一の層間絶縁膜240に前記開口部270Aに対応した
ヴィアホール240Aを形成することができる。図示し
た例では、第二の層間絶縁膜260と第一の層間絶縁膜
との間にエッチンストッパ膜250が存在している場合
で説明したが、前記膜250が存在しない場合は、より
簡便にエッチングすることが可能である。
【0031】図5(B)に示す工程にて、エッチングス
トッパ膜250が存在しない場合には、上記エッチング
条件を調整することにより、図5(B)に示すような処
理をすることが可能であることは、当業者には理解でき
る。
【0032】さらに、図5(C)の工程に示すように、
前記第二のハードマスク膜280をマスクとして、前記
第一のハードマスク膜270と前記バリア膜230を、
図3に示すプラズマ処理装置にて、CF系のガスを用い
たドライエッチングにより同時に除去する。これによ
り、前記開口部280に対応した、前記開口部270A
よりも大きな開口部270Bが形成される。かかる工程
により、半導体装置の製造工程を減少させ、当該製造工
程の効率化を図ることができ、本発明の目的を達成する
ことが可能となる。
【0033】次に、図5(D)の工程にて、前記第二の
ハードマスク膜280をマスクとして、前記第二の層間
絶縁膜260を、図3に示すプラズマ処理装置にてドラ
イエッチングにより除去し、前記膜260中に前記開口
部270Bに対応した配線溝260Bが形成される。
【0034】前述したように、本発明の第二の層間絶縁
膜280は有機膜であることが好ましい。一般的に、有
機絶縁膜からなる層間絶縁膜のエッチングには、O
ガスが利用されるが、本発明には好ましくない。本発明
のプラズマエッチングのガスとしては、酸素を含まず、
Nを含むガスを利用することが好ましい。なぜならば、
前記ドライエッチング中に、図5(C)の工程で露出し
た銅220Aの表面が酸化され易いので、露出される銅
の表面を酸化させないために、酸素を含まずNを含むガ
スを利用する。また、エッチング中に露出された銅の表
面は、Nを含むガスにより銅の表面に窒素と銅が反応し
た保護膜が同時に形成されるという利点がある。かかる
保護膜が形成されると、半導体装置類の大気搬送中に、
Cuへの損傷を受けることがなくなるという副次的効果
も得られる。
【0035】具体的にNを含むガスとしては、N、N
及びそれらの混合物がある。また、プラズマエッチ
ングを行う際のガスとして、Nを含むガスのほかに、H
を含むガスを利用することも好ましい。具体的にHを含
むガスとしては、Hおよびその混合物を挙げることが
できる。
【0036】プラズマエッチングの際に、NおよびHを
含むガスを利用すると、前記第一及び第二の層間絶縁膜
のエッチング時に不純物として残存する有機物が容易に
除去されるという効果もある。
【0037】その後、図6(A)の工程に示すように、
配線溝260B及びヴィアホール240AにAlあるい
はCu等の導体350を、CVD法やPVD法などによ
り埋設する。次いで、図6(B)の工程にて、不必要な
導体部分をCMP法により研磨することにより、配線パ
ターン220Aがヴィアホール240Aにより接続され
た配線パターンが得られる。以上の工程をさらに繰り返
すことにより、3層目、4層目の配線パターンを形成す
ることが可能である。
【0038】以上、本発明を好適な実施態様について説
明したが、本発明はかかる特定の実施態様に限定される
ものではなく、特許請求の範囲に記載した要旨内におい
て、種々の変形及び変更態様が可能である。
【0039】
【発明の効果】上述の如く、本発明によれば、次に述べ
る効果を奏することができる。請求項1ないし8に記載
の発明によれば、多層配線構造を有する半導体装置の、
デュアルダマシン法を利用した製造方法において、第一
のハードマスク膜と配線パターンのバリア膜とを同時に
エッチングすることにより、製造工程数を減少させるこ
とができ、半導体装置を高い歩留まり率で製造すること
が実現できる。さらに、次に行うべき第二の層間絶縁膜
を除去する際に、Nを有するガスを利用してエッチング
するので、バリア膜の下の存在するCuからなる配線パ
ターンに損傷を与えずに保護することが可能となる。
【図面の簡単な説明】
【図1】図1(A)〜図1(D)は、従来の半導体装置
の製造工程の前半部分を示す図である。
【図2】図2(A)〜図2(D)は、従来の半導体装置
の製造工程の後半部分を示す図である。
【図3】本発明で利用されるプラズマ処理装置の構成を
示す断面図である。
【図4】図4(A)〜図4(C)は、本発明の実施例に
よる半導体装置の製造工程の前段部分を示す図である。
【図5】図5(A)〜図5(D)は、本発明の実施例に
よる半導体装置の製造工程の中段部分を示す図である。
【図6】図6(A)及び図6(B)は、本発明の実施例
による半導体装置の製造工程の後段部分を示す図であ
る。
【符号の説明】
100 プラズマ処理装置 102 処理室 104 反応器 105 絶縁部材 106 ウェーハ保持台 108、118 インピーダンス整合器 110、120 高周波電源 112 コントローラ 114 シャワーヘッド 114a 開口部 122 プラズマガスライン 124 排気ポート 200 Si基板 210 層間絶縁膜 220 配線層 220A 配線パターン 230 バリア膜 240 第一の層間絶縁膜 250 エッチングストッパ膜 260 第二の層間絶縁膜 270 第一のハードマスク膜 280 第二のハードマスク膜 300、310 レジストパターン 350 導体(Cu膜)
フロントページの続き Fターム(参考) 5F004 AA08 DA00 DA24 DB23 EB01 EB03 5F033 HH08 HH11 HH33 JJ01 JJ08 JJ11 KK11 MM02 PP06 PP14 QQ09 QQ10 QQ11 QQ12 QQ15 QQ25 QQ27 QQ28 QQ30 QQ37 QQ48 RR01 RR04 RR06 RR08 RR25 SS11 SS15 SS21 TT02 TT04 XX24 XX33

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】 基板上にあるバリア膜上に第一の層間絶
    縁膜を形成する工程と、 前記第一の層間絶縁膜上に第二の層間絶縁膜を形成する
    工程と、 前記第二の層間絶縁膜上に第一のハードマスク膜を形成
    する工程と、 前記第一のハードマスク膜上に、前記第一のハードマス
    ク膜とは異なる第二のハードマスク膜を形成する工程と
    を含む半導体装置の製造方法であって、 前記第二のハードマスク膜上に形成させた所望のレジス
    トパターンをマスクとして、前記第一のハードマスク膜
    が露出するように、前記第二のハードマスク膜に第一の
    開口部を形成する工程と、 前記第二のハードマスク膜及び前記第一のハードマスク
    膜上に形成させた所望のレジストパターンをマスクとし
    て、前記露出した第一のハードマスク膜中に第二の開口
    部を形成する工程と、 前記第一のハードマスク膜をマスクとして、前記第二の
    層間絶縁膜に前記第二の開口部に対応した開口部を形成
    するように、前記第二の層間絶縁膜を除去する第一の除
    去工程と、 前記第一のハードマスク膜をマスクとして、前記第一の
    層間絶縁膜に前記第二の開口部に対応したヴィアホール
    を形成し、前記バリア膜が露出するように前記第一の層
    間絶縁膜を除去する第二の除去工程と、 前記第二のハードマスク膜をマスクとして、前記第一の
    ハードマスク膜及び前記ヴィアホールの底部に露出した
    バリア膜を同時に除去する第三の除去工程と、 前記第二のハードマスク膜をマスクとして、前記第二の
    層間絶縁膜に前記第一の開口部に対応した配線溝を形成
    するように、前記第二の層間絶縁膜を除去する第四の除
    去工程と、を具備することを特徴とする半導体装置の製
    造方法。
  2. 【請求項2】 前記第四の除去工程は、N及びHを含む
    ガスを利用したプラズマエッチングにより行われること
    を特徴とする請求項1に記載の半導体装置の製造方法。
  3. 【請求項3】 前記第二の層間絶縁膜は有機低誘電率膜
    であることを特徴とする請求項1に記載の半導体装置の
    製造方法。
  4. 【請求項4】 前記第一の層間絶縁膜を形成する工程と
    前記第二の層間絶縁膜を形成する工程との間にエッチン
    グストッパ膜を形成する工程をさらに有し、前記第二の
    除去工程において、前記第一の層間絶縁膜とともに前記
    エッチングストッパ膜を除去することを特徴とする請求
    項1に記載の半導体装置の製造方法。
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