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JP2001015371A - Chip-type ceramic electronic component and manufacture thereof - Google Patents

Chip-type ceramic electronic component and manufacture thereof

Info

Publication number
JP2001015371A
JP2001015371A JP11183993A JP18399399A JP2001015371A JP 2001015371 A JP2001015371 A JP 2001015371A JP 11183993 A JP11183993 A JP 11183993A JP 18399399 A JP18399399 A JP 18399399A JP 2001015371 A JP2001015371 A JP 2001015371A
Authority
JP
Japan
Prior art keywords
sintered body
ceramic sintered
ceramic
chip
electronic component
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP11183993A
Other languages
Japanese (ja)
Inventor
Shinichiro Kuroiwa
慎一郎 黒岩
Yasunobu Yoneda
康信 米田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Murata Manufacturing Co Ltd
Original Assignee
Murata Manufacturing Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Murata Manufacturing Co Ltd filed Critical Murata Manufacturing Co Ltd
Priority to JP11183993A priority Critical patent/JP2001015371A/en
Publication of JP2001015371A publication Critical patent/JP2001015371A/en
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01GCAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
    • H01G4/00Fixed capacitors; Processes of their manufacture
    • H01G4/002Details
    • H01G4/018Dielectrics
    • H01G4/06Solid dielectrics
    • H01G4/08Inorganic dielectrics
    • H01G4/12Ceramic dielectrics
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01GCAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
    • H01G4/00Fixed capacitors; Processes of their manufacture
    • H01G4/002Details
    • H01G4/228Terminals
    • H01G4/252Terminals the terminals being coated on the capacitive element

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Chemical & Material Sciences (AREA)
  • Manufacturing & Machinery (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Ceramic Engineering (AREA)
  • Inorganic Chemistry (AREA)
  • Ceramic Capacitors (AREA)

Abstract

PROBLEM TO BE SOLVED: To obtain highly reliable chip-type ceramic electronic components, the ceramic sintered body of which hardly cracks, even when a printed circuit board expands, contracts or bends and stresses are applied to the sintered body after the electronic components are mounted on the board. SOLUTION: A laminated capacitor 1 constituted as a chip-type ceramic electronic component is constituted, in such a way that first and second terminal electrodes 9 and 10 are formed to respectively cover the first and second terminal faces of a ceramic sintered body 2, and the electrodes 9 and 10 have electrode cover sections 9a and 20 reaching the top face 2c, bottom face 2d, and side faces of the sintered body 2. In addition, voids 11 and 12 are respectively formed between the internal surfaces of the cover sections 9a and 10a and the external surface of the sintered body 2.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、例えば積層コンデ
ンサのようなチップ型セラミック電子部品に関し、より
詳細には、セラミック焼結体の端面を覆うように端子電
極が形成されているチップ型セラミック電子部品に関す
る。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a chip-type ceramic electronic component such as a multilayer capacitor, and more particularly, to a chip-type ceramic electronic component having terminal electrodes formed so as to cover end faces of a ceramic sintered body. Related to parts.

【0002】[0002]

【従来の技術】図6は、従来のチップ型電子部品の一例
としての積層コンデンサを示す縦断面図である。積層コ
ンデンサ51では、誘電体セラミックスよりなるセラミ
ック焼結体52の内部に複数の内部電極53〜58がセ
ラミック層を介して厚み方向に重なり合うように配置さ
れている。内部電極53,55,57がセラミック焼結
体52の端面52aに引き出されており、内部電極5
4,56,58が端面52bに引き出されている。端面
52a,52bには、端子電極59,60がそれぞれ形
成されている。
2. Description of the Related Art FIG. 6 is a longitudinal sectional view showing a multilayer capacitor as an example of a conventional chip-type electronic component. In the multilayer capacitor 51, a plurality of internal electrodes 53 to 58 are arranged inside a ceramic sintered body 52 made of dielectric ceramic so as to overlap in a thickness direction via a ceramic layer. The internal electrodes 53, 55, 57 are drawn out to the end face 52 a of the ceramic sintered body 52, and the internal electrodes 5
4, 56, 58 are drawn out to the end face 52b. Terminal electrodes 59 and 60 are formed on the end faces 52a and 52b, respectively.

【0003】端子電極59,60は、端面52a,52
bを覆うだけでなく、上面52c、下面52d及び両側
面に至る電極被り部59a,60aを有する。すなわ
ち、上記電極被り部59a,60aを形成することによ
り、例えばプリント回路基板に実装した際の半田付けを
容易とすることが可能とされている。
[0003] Terminal electrodes 59 and 60 are connected to end faces 52a and 52, respectively.
b, but also has electrode covering portions 59a and 60a reaching the upper surface 52c, the lower surface 52d, and both side surfaces. That is, by forming the electrode covering portions 59a and 60a, for example, it is possible to facilitate soldering when mounted on a printed circuit board.

【0004】また、積層コンデンサ51のようなチップ
型セラミック電子部品において、外力に対する機械的強
度を高めるために、空孔を有する端子電極を備えたチッ
プ型電子部品が種々提案されている(例えば、特開平5
−3132号公報、特開平8−107038号公報、特
開平8−162359号公報、特開平9−162064
号公報など)。
[0004] Further, for chip-type ceramic electronic components such as the multilayer capacitor 51, various chip-type electronic components having terminal electrodes having holes have been proposed in order to increase the mechanical strength against external force (for example, see, for example, Japanese Patent Application Laid-Open No. H11-157556). JP 5
-3132, JP-A-8-107038, JP-A-8-162359, JP-A-9-162604
Issue publication).

【0005】これらの先行技術に記載のチップ型電子部
品では、複数の層を積層することにより端子電極を形
成し、少なくとも1つの層に空孔を形成したもの、ある
いはセラミック焼結体の内部電極が引き出されている
端面にガラス層及び端子電極を積層形成し、該端面上に
おいてガラス層と端子電極との間に空隙を形成したもの
などが採用されている。
In the chip type electronic components described in these prior arts, terminal electrodes are formed by laminating a plurality of layers, and holes are formed in at least one layer, or internal electrodes of a ceramic sintered body. In this case, a glass layer and a terminal electrode are laminated on the end face from which is drawn, and a gap is formed between the glass layer and the terminal electrode on the end face.

【0006】[0006]

【発明が解決しようとする課題】しかしながら、従来の
チップ型セラミック電子部品では、プリント回路基板実
装後に熱が加えられたり、プリント回路基板がたわんだ
際に、これらに起因する応力によりセラミック焼結体に
クラックが生じるという問題があった。すなわち、例え
ば図6に示す積層コンデンサ51が下面側からプリント
回路基板に実装された際に、プリント回路基板が凹状も
しくは凸状に変形したとする。その場合、積層コンデン
サ51はプリント回路基板に端子電極59,60を用い
て固定されているので、積層コンデンサ51もまた凹状
または凸状となるような応力を受ける。その結果、セラ
ミック焼結体52においてクラックが生じがちであっ
た。
However, in a conventional chip-type ceramic electronic component, when heat is applied after the printed circuit board is mounted or when the printed circuit board is bent, the ceramic sintered body is subjected to stress caused by these. There was a problem that cracks were generated in the steel. That is, for example, it is assumed that when the multilayer capacitor 51 shown in FIG. 6 is mounted on the printed circuit board from the lower surface side, the printed circuit board is deformed into a concave shape or a convex shape. In this case, since the multilayer capacitor 51 is fixed to the printed circuit board by using the terminal electrodes 59 and 60, the multilayer capacitor 51 is also subjected to a stress such that it becomes concave or convex. As a result, cracks tend to occur in the ceramic sintered body 52.

【0007】本発明の目的は、プリント回路基板などに
実装された後に、プリント回路基板がたわんだとして
も、セラミック焼結体のクラックが生じ難い、機械的強
度及び信頼性に優れたチップ型セラミック電子部品を提
供することにある。
SUMMARY OF THE INVENTION An object of the present invention is to provide a chip-type ceramic having excellent mechanical strength and reliability, in which even if the printed circuit board is bent after being mounted on the printed circuit board, cracking of the ceramic sintered body is unlikely to occur. To provide electronic components.

【0008】[0008]

【課題を解決するための手段】本発明の広い局面によれ
ば、対向し合う第1,第2の端面を有するセラミック焼
結体と、前記セラミック焼結体の第1,第2の端面を覆
い、上面、下面及び両側面に至る電極被り部を有する第
1,第2の端子電極とを備え、前記第1,第2の端子電
極の電極被り部の内面とセラミック焼結体の外表面との
間に空隙が形成されていることを特徴とする、チップ型
セラミック電子部品が提供される。
According to a broad aspect of the present invention, a ceramic sintered body having first and second end faces facing each other and a first and second end face of the ceramic sintered body are connected to each other. And a first and second terminal electrode having an electrode covering portion extending to the upper surface, the lower surface, and both side surfaces. The inner surface of the electrode covering portion of the first and second terminal electrodes and the outer surface of the ceramic sintered body. And a chip-type ceramic electronic component, wherein a void is formed between the two.

【0009】好ましくは、前記第1,第2の端面を結ぶ
方向を長さ方向とした場合に、前記空隙の長さは、空隙
が設けられている端子電極の電極被り部の長さの10〜
90%の範囲とされる。
Preferably, when the direction connecting the first and second end faces is the length direction, the length of the gap is 10 times the length of the electrode covering portion of the terminal electrode provided with the gap. ~
The range is 90%.

【0010】また、本発明の特定の局面では、セラミッ
ク焼結体内においてセラミック層を介して重なり合うよ
うに配置された複数の内部電極がさらに備えられ、前記
内部電極が、セラミック焼結体の第1または第2の端面
に引き出されて第1または第2の端子電極に電気的に接
続され、それによって積層型セラミック電子部品が構成
される。
[0010] In a specific aspect of the present invention, there is further provided a plurality of internal electrodes arranged so as to overlap each other via a ceramic layer in the ceramic sintered body, wherein the internal electrodes are formed of a first ceramic sintered body. Alternatively, the multilayer ceramic electronic component is formed by being drawn out to the second end face and electrically connected to the first or second terminal electrode.

【0011】本発明の他の広い局面によれば、対向し合
う第1,第2の端面を有するセラミック焼結体を用意す
る工程と、前記セラミック焼結体の第1,第2の端面近
傍において、セラミック焼結体の上面、下面及び両側面
の少なくとも1つの面に端子電極焼付け時の熱により飛
散する有機材料ペーストを塗布する工程と、前記セラミ
ック焼結体の第1,第2の端面及び第1,第2の端面か
ら上面、下面及び両側面に至るように、かつ前記有機材
料ペースト層を被覆するように導電ペーストを塗布する
工程と、前記導電ペーストを焼き付けて、第1,第2の
端子電極を形成すると共に、該焼付けに際し前記有機材
料ペーストを飛散させて空隙を形成する工程とを備える
ことを特徴とする、チップ型セラミック電子部品の製造
方法が提供される。
According to another broad aspect of the present invention, a step of preparing a ceramic sintered body having opposed first and second end faces, and a step of preparing a ceramic sintered body near the first and second end faces A step of applying an organic material paste scattered by heat at the time of baking terminal electrodes to at least one of an upper surface, a lower surface, and both side surfaces of the ceramic sintered body; and first and second end surfaces of the ceramic sintered body. And a step of applying a conductive paste from the first and second end surfaces to the upper surface, the lower surface and both side surfaces, and coating the organic material paste layer, and baking the conductive paste to form the first and second conductive pastes. Forming a terminal electrode, and scattering the organic material paste during the baking to form a void.

【0012】[0012]

【発明の実施の形態】以下、図面を参照しつつ本発明の
具体的な実施例を説明することにより、本発明を明らか
にする。
DESCRIPTION OF THE PREFERRED EMBODIMENTS Hereinafter, the present invention will be clarified by describing specific embodiments of the present invention with reference to the drawings.

【0013】図1は、本発明の一実施例に係るチップ型
セラミック電子部品としての積層コンデンサを示す縦断
面図である。積層コンデンサ1は、チタン酸バリウム系
セラミックスのような誘電体セラミックスよりなる直方
体状のセラミック焼結体2を有する。セラミック焼結体
2内には、複数の内部電極3〜8がセラミック層を介し
て厚み方向に重なり合うように配置されている。
FIG. 1 is a longitudinal sectional view showing a multilayer capacitor as a chip-type ceramic electronic component according to one embodiment of the present invention. The multilayer capacitor 1 has a rectangular parallelepiped ceramic sintered body 2 made of a dielectric ceramic such as a barium titanate-based ceramic. In the ceramic sintered body 2, a plurality of internal electrodes 3 to 8 are arranged so as to overlap in the thickness direction via a ceramic layer.

【0014】内部電極3,5,7は、セラミック焼結体
2の第1の端面2aに引き出されている。内部電極4,
6,8は、第1の端面とは反対側の第2の端面2bに引
き出されている。
The internal electrodes 3, 5, 7 are drawn out to the first end face 2 a of the ceramic sintered body 2. Internal electrode 4,
6 and 8 are drawn out to the second end face 2b opposite to the first end face.

【0015】上記内部電極3〜8は、Ag、Ag−Pd
またはNiなどの適宜の貴金属や卑金属を用いて構成す
ることができる。また、内部電極3〜8を有するセラミ
ック焼結体2は、周知の積層コンデンサの製造方法に従
って得ることができる。すなわち、セラミックグリーン
シート上に内部電極を構成するための導電ペーストを印
刷し、導電ペーストが印刷されたセラミックグリーンシ
ートを積層し、積層体を得、該積層体を焼成することに
より得ることができる。
The internal electrodes 3 to 8 are made of Ag, Ag-Pd
Alternatively, it can be configured using an appropriate noble metal or base metal such as Ni. Further, the ceramic sintered body 2 having the internal electrodes 3 to 8 can be obtained according to a known method of manufacturing a multilayer capacitor. That is, it can be obtained by printing a conductive paste for forming an internal electrode on a ceramic green sheet, stacking the ceramic green sheets on which the conductive paste is printed, obtaining a laminate, and firing the laminate. .

【0016】セラミック焼結体2の第1の端面2aを覆
うように第1の端子電極9が形成されている。また、第
2の端面2bを覆うように第2の端子電極10が形成さ
れている。端子電極9,10は、導電ペーストの塗布・
焼き付けにより形成されている。なお、本実施例では、
端子電極9,10は単一の層により構成されているが、
導電ペーストの焼き付け層の外表面に、他の金属材料を
メッキしてもよい。すなわち、Niメッキ層及びSnメ
ッキ層を順に形成し、それによって導電ペーストの塗布
・焼き付けにより形成された電極膜の半田喰われをNi
層により防止し、Sn層により半田付け性を高めてもよ
い。
A first terminal electrode 9 is formed so as to cover the first end face 2a of the ceramic sintered body 2. Further, a second terminal electrode 10 is formed so as to cover the second end face 2b. The terminal electrodes 9 and 10 are coated with a conductive paste.
It is formed by baking. In this embodiment,
Although the terminal electrodes 9 and 10 are constituted by a single layer,
The outer surface of the baked layer of the conductive paste may be plated with another metal material. That is, a Ni plating layer and a Sn plating layer are sequentially formed, and thereby, the solder erosion of the electrode film formed by applying and baking a conductive paste is reduced to Ni.
This may be prevented by a layer, and solderability may be enhanced by a Sn layer.

【0017】第1,第2の端子電極9,10は、第1,
第2の端面2a,2bを覆うように形成されているの
で、内部電極3,5,7が第1の端子電極9に、内部電
極4,6,8が第2の端子電極10に電気的に接続され
ている。
The first and second terminal electrodes 9 and 10 are
Since the second electrodes 2 are formed so as to cover the second end faces 2 a and 2 b, the internal electrodes 3, 5 and 7 are electrically connected to the first terminal electrode 9, and the internal electrodes 4, 6 and 8 are electrically connected to the second terminal electrode 10. It is connected to the.

【0018】また、端子電極9,10は、電極被り部9
a,10aを有する。電極被り部9a,10aは、セラ
ミック焼結体2の上面2c、下面2d及び両側面に至る
ように形成されている。上記電極被り部9a,10aが
形成されているので、プリント回路基板などに電極被り
部9a,10aを利用して容易に面実装することができ
る。
The terminal electrodes 9 and 10 are
a and 10a. The electrode covering portions 9a and 10a are formed so as to reach the upper surface 2c, the lower surface 2d, and both side surfaces of the ceramic sintered body 2. Since the electrode covering portions 9a and 10a are formed, surface mounting can be easily performed on the printed circuit board or the like by using the electrode covering portions 9a and 10a.

【0019】本実施例の積層コンデンサ1の特徴は、電
極被り部9a,10aとセラミック焼結体2の外表面と
の間に空隙11,12が形成されていることにある。本
実施例では、空隙11,12は、セラミック焼結体2の
周囲を巻回するように形成されている。すなわち、空隙
11,12は、上面2c、下面2d及び両側面に至るよ
うに形成されている。
A feature of the multilayer capacitor 1 of the present embodiment is that voids 11 and 12 are formed between the electrode covering portions 9 a and 10 a and the outer surface of the ceramic sintered body 2. In the present embodiment, the gaps 11 and 12 are formed so as to be wound around the ceramic sintered body 2. That is, the gaps 11 and 12 are formed so as to reach the upper surface 2c, the lower surface 2d, and both side surfaces.

【0020】積層コンデンサ1では、空隙11,12
が、電極被り部9a,10aとセラミック焼結体2の外
表面との間に形成されている。言い換えれば、空隙1
1,12は、電極被り部9a,10aの一部をセラミッ
ク焼結体2の外表面と接触させないように、設けられて
いる。従って、空隙11,12の周囲は、セラミック焼
結体2の外表面と電極被り部9aまたは電極被り部10
aにより囲まれていることになる。
In the multilayer capacitor 1, the gaps 11, 12
Are formed between the electrode covering portions 9 a and 10 a and the outer surface of the ceramic sintered body 2. In other words, void 1
The reference numerals 1 and 12 are provided so that a part of the electrode covering portions 9 a and 10 a does not contact the outer surface of the ceramic sintered body 2. Therefore, the periphery of the gaps 11 and 12 is formed between the outer surface of the ceramic sintered body 2 and the electrode covering portion 9a or the electrode covering portion 10a.
a is surrounded by a.

【0021】上記空隙11,12が形成されているの
で、後述の実験例から明らかなように、プリント回路基
板に実装した際に、プリント回路基板がたわみ、該たわ
みに起因する応力が端子電極9,10が加えられたとし
ても、セラミック焼結体2におけるクラックの発生が効
果的に抑制される。すなわち、従来の積層コンデンサ5
1のセラミック焼結体52において生じたクラックは、
電極被り部59a,60aの内側端からセラミック焼結
体52内に至るように起こることが多かった。これは、
プリント回路基板のたわみに起因する応力が、端子電極
59,60の被り部59a,60aの内側端に集中する
ためであると考えられる。
Since the voids 11 and 12 are formed, the printed circuit board bends when mounted on the printed circuit board, and the stress caused by the bend is caused by the terminal electrode 9, as will be apparent from an experimental example described later. , 10 are effectively prevented from cracking in the ceramic sintered body 2. That is, the conventional multilayer capacitor 5
The cracks generated in the first ceramic sintered body 52 are as follows:
In many cases, this occurred from the inner ends of the electrode covering portions 59a and 60a to the inside of the ceramic sintered body 52. this is,
It is considered that the stress caused by the bending of the printed circuit board is concentrated on the inner ends of the covering portions 59a and 60a of the terminal electrodes 59 and 60.

【0022】本実施例の積層コンデンサ1では、空隙1
1,12が設けられているので、端子電極9,10にプ
リント回路基板のたわみに起因する応力が加わったとし
ても、空隙11,12により端子電極9,10が適度に
変形したりして、電極被り部9a,10aに応力が集中
し難い。従って、上記応力集中に起因するセラミック焼
結体2のクラックを確実に抑制することができる。
In the multilayer capacitor 1 of this embodiment, the gap 1
Since the terminals 1 and 12 are provided, even if the terminal electrodes 9 and 10 are subjected to a stress due to the deflection of the printed circuit board, the gaps 11 and 12 cause the terminal electrodes 9 and 10 to be appropriately deformed. It is difficult for stress to concentrate on the electrode covering portions 9a and 10a. Therefore, cracks in the ceramic sintered body 2 caused by the stress concentration can be reliably suppressed.

【0023】すなわち、空隙11,12は、プリント回
路基板などが膨張/収縮したり、たわんだりした際に、
端子電極9,10に加わる応力の集中を緩和する機能を
果たし、それによってクラックの発生を抑制する。
That is, the gaps 11 and 12 are formed when the printed circuit board or the like expands / contracts or flexes.
It functions to alleviate the concentration of stress applied to the terminal electrodes 9 and 10, thereby suppressing the occurrence of cracks.

【0024】次に、具体的な実験例に基づき、上記空隙
11,12の作用効果を明らかにすると共に、本実施例
のチップ型セラミック電子部品の製造方法を説明する。
まず、複数の内部電極がセラミック層を介して重なり合
うように配置されており、かつ対向し合う第1,第2の
端面2a,2bを有するセラミック焼結体2を用意し
た。
Next, based on specific experimental examples, the operation and effect of the gaps 11 and 12 will be clarified, and a method of manufacturing the chip-type ceramic electronic component of this embodiment will be described.
First, there was prepared a ceramic sintered body 2 in which a plurality of internal electrodes were arranged so as to overlap each other with a ceramic layer interposed therebetween, and had first and second end faces 2a and 2b facing each other.

【0025】次に、セラミック焼結体2の端面2a,2
b近傍において、セラミック焼結体2を巻回するように
有機材料ペースト13,14を付与した。有機材料ペー
スト13,14は、端子電極9,10を構成する導電ペ
ーストの焼き付けに際して飛散し得る材料、例えばエチ
ルセルロース、アルキッド、及びアクリル樹脂を含む材
料により構成される。もっとも、有機材料ペースト1
3,14を構成する材料については、これらに限定され
るものではなく、導電ペーストの焼き付けの際に飛散す
る適宜の有機材料を用いて構成することができる。
Next, the end faces 2a, 2a of the ceramic sintered body 2
In the vicinity of b, organic material pastes 13 and 14 were applied so as to wind the ceramic sintered body 2. The organic material pastes 13 and 14 are made of a material that can be scattered when the conductive paste forming the terminal electrodes 9 and 10 is baked, for example, a material containing ethyl cellulose, alkyd, and an acrylic resin. However, organic material paste 1
The materials constituting the layers 3 and 14 are not limited to these, and can be formed using an appropriate organic material that is scattered when the conductive paste is baked.

【0026】次に、セラミック焼結体2の端面2a側か
らAgペーストを塗布し、次に端面2b側から同様にA
gペーストを塗布した。しかる後、600℃の温度で導
電ペーストを焼き付け、端子電極9,10を形成した。
この場合、上記有機材料ペースト13,14は飛散し、
図1に示す空隙11,12が形成される。このようにし
て、長さ2.00mm×幅1.25mm×厚さ0.85
mmの寸法の積層コンデンサ1を得た。積層コンデンサ
1の外観を図3に示す。
Next, an Ag paste is applied from the end face 2a side of the ceramic sintered body 2, and then A paste is similarly applied from the end face 2b side.
g paste was applied. Thereafter, the conductive paste was baked at a temperature of 600 ° C. to form terminal electrodes 9 and 10.
In this case, the organic material pastes 13 and 14 scatter,
The gaps 11 and 12 shown in FIG. 1 are formed. Thus, length 2.00 mm x width 1.25 mm x thickness 0.85
Thus, a multilayer capacitor 1 having a size of mm was obtained. FIG. 3 shows the appearance of the multilayer capacitor 1.

【0027】積層コンデンサ1を製造するにあたり、内
部電極積層数は35、内部電極間のセラミック層の厚み
は10μmとした。また、電極被り部9a,10aの長
さA、すなわち端面2aまたは端面2bから電極被り部
9aまたは10aの内側端までの距離は0.4mmとし
た。さらに、積層コンデンサ1の製造にあたり、上記有
機材料ペースト13,14の幅を種々異ならせ、空隙1
1,12の長さ、すなわち空隙11,12の第1,第2
の端面2a,2bを結ぶ方向の長さを種々変化させ、そ
れぞれ、積層コンデンサを得た。
In manufacturing the multilayer capacitor 1, the number of laminated internal electrodes was 35, and the thickness of the ceramic layer between the internal electrodes was 10 μm. The length A of the electrode covering portions 9a and 10a, that is, the distance from the end surface 2a or the end surface 2b to the inner end of the electrode covering portion 9a or 10a was 0.4 mm. Further, in manufacturing the multilayer capacitor 1, the widths of the organic material pastes 13 and 14 are variously changed so that the gap 1
1, 12, that is, the first and second gaps 11 and 12
The lengths in the direction connecting the end surfaces 2a and 2b were variously changed to obtain multilayer capacitors.

【0028】比較のために、有機材料ペースト13,1
4を塗布せず、すなわち空隙11,12が形成されてい
ないことを除いては、上記と同様にして、積層コンデン
サを作製した。
For comparison, the organic material pastes 13, 1
A multilayer capacitor was manufactured in the same manner as described above, except that No. 4 was not applied, that is, the gaps 11 and 12 were not formed.

【0029】これらの積層コンデンサについて、以下の
要領でたわみ試験及び剪断試験を行った。 たわみ試験…1.6mm厚のガラスエポキシ基板上の
電極に、半田付けにより積層コンデンサを実装した。し
かる後、端子電極9,10間の中央において、ガラスエ
ポキシ基板が上方に5mm移動するように、ガラスエポ
キシ基板を凸状にたわませ、その場合のセラミック焼結
体2におけるクラックの発生率を評価した。なお、たわ
み試験における試験数nは100個とし、100個の積
層コンデンサにおいて、クラックが発生した積層コンデ
ンサの数の割合を、クラック発生率とした。
A deflection test and a shear test were performed on these multilayer capacitors in the following manner. Deflection test: A multilayer capacitor was mounted on an electrode on a 1.6 mm thick glass epoxy substrate by soldering. Thereafter, in the center between the terminal electrodes 9 and 10, the glass epoxy substrate is bent in a convex shape so that the glass epoxy substrate moves upward by 5 mm, and the occurrence rate of cracks in the ceramic sintered body 2 in that case is reduced. evaluated. The number of tests n in the bending test was 100, and the ratio of the number of the multilayer capacitors in which cracks occurred in 100 multilayer capacitors was defined as the crack occurrence rate.

【0030】剪断試験…たわみ試験で用いたのと同じ
ガラスエポキシ基板上の電極に積層コンデンサを半田付
けにより実装した後、積層コンデンサに側面2e側から
端面2a,2bと平行な方向に20Nの剪断応力を加
え、積層コンデンサがガラスエポキシ基板から外れるか
否かを観察し、外れた場合を「破断」とした。100個
の積層コンデンサにおいて剪断試験を行い、破断が生じ
た積層コンデンサの数の割合を求め、破断発生率とし
た。たわみ試験及び剪断試験の結果を下記の表1に示
す。
Shear test: After mounting the multilayer capacitor on the same electrode on the glass epoxy board as used in the deflection test by soldering, the shear was applied to the multilayer capacitor from the side surface 2e in a direction parallel to the end surfaces 2a and 2b by 20N. A stress was applied, and it was observed whether or not the multilayer capacitor came off the glass epoxy substrate. A shear test was performed on 100 multilayer capacitors, and the ratio of the number of multilayer capacitors in which breakage occurred was determined, which was defined as a breakage occurrence rate. The results of the deflection test and the shear test are shown in Table 1 below.

【0031】[0031]

【表1】 [Table 1]

【0032】表1から明らかなように、空隙の設けられ
ていない試料番号1の積層コンデンサでは、たわみ試験
におけるクラック発生率が83%と非常に高いことがわ
かる。これに対して、試料番号2〜9の積層コンデンサ
では、空隙11,12が設けられているため、クラック
発生率が著しく低くなり、特に、空隙11,12の長さ
Bの電極被り部9a,10aの長さAに対する割合が1
0%以上である試料番号4〜9の積層コンデンサではク
ラック発生率は皆無であった。
As is clear from Table 1, the multilayer capacitor of Sample No. 1 having no voids has a very high crack generation rate of 83% in the deflection test. On the other hand, in the multilayer capacitors of Sample Nos. 2 to 9, since the gaps 11 and 12 are provided, the crack generation rate is extremely low, and particularly, the electrode covering portions 9a and 9 having the length B of the gaps 11 and 12 are provided. The ratio to the length A of 10a is 1
The multilayer capacitors of Sample Nos. 4 to 9 having 0% or more had no crack generation rate.

【0033】他方、空隙11,12の長さが相対的に長
い試料番号9の積層コンデンサでは、剪断試験における
破断発生率が12%であった。従って、表1の結果か
ら、空隙11,12の長さを、空隙が設けられている電
極被り部の長さの10〜90%の範囲とすることによ
り、たわみ強度を改善し得ると共に、実装強度を高め得
ることがわかる。
On the other hand, in the multilayer capacitor of Sample No. 9 in which the lengths of the gaps 11 and 12 were relatively long, the breakage rate in the shear test was 12%. Therefore, from the results in Table 1, by setting the length of the gaps 11 and 12 to be in the range of 10 to 90% of the length of the electrode covering portion provided with the gap, the bending strength can be improved and the mounting can be performed. It can be seen that the strength can be increased.

【0034】図4及び図5は、空隙の変形例を説明する
ための図である。図4に部分切欠断面図で示すように、
電極被り部9aとセラミック焼結体2の外表面との間
に、複数の空隙11a〜11cを形成してもよい。この
場合、空隙11a〜11cは、空隙11と同様に、セラ
ミック焼結体2の周囲を巻回するように形成されてい
る。
FIGS. 4 and 5 are views for explaining a modified example of the gap. As shown in the partially cutaway sectional view in FIG.
A plurality of voids 11a to 11c may be formed between the electrode covering portion 9a and the outer surface of the ceramic sintered body 2. In this case, the gaps 11 a to 11 c are formed so as to be wound around the ceramic sintered body 2, similarly to the gap 11.

【0035】また、空隙11,12は、セラミック焼結
体2の外周を巻回するように形成されていたが、少なく
とも1つの面の電極被り部内に形成されていればよく、
また上面2c、下面2d及び側面2e上において分断さ
れた複数の空隙を形成してもよい。例えば、図5(a)
に示すように、上面2c及び側面2e上に複数の有機材
料ペースト13a〜13f,14a〜14fを形成し、
有機材料ペースト13a〜13f,14a〜14fを導
電ペーストの焼き付け時に飛散させて複数の空洞を形成
してもよい。なお、図5(a)では、下面及び他方の側
面に形成された有機材料ペーストは図示されていない。
Although the gaps 11 and 12 are formed so as to be wound around the outer periphery of the ceramic sintered body 2, the gaps 11 and 12 may be formed in at least one surface of the electrode covering portion.
Further, a plurality of divided voids may be formed on the upper surface 2c, the lower surface 2d, and the side surface 2e. For example, FIG.
As shown in FIG. 3, a plurality of organic material pastes 13a to 13f and 14a to 14f are formed on the upper surface 2c and the side surface 2e,
A plurality of cavities may be formed by scattering the organic material pastes 13a to 13f and 14a to 14f at the time of baking the conductive paste. In FIG. 5A, the organic material paste formed on the lower surface and the other side surface is not shown.

【0036】上記のようにして、図5(b)に示すよう
に、複数の空隙11d〜11hを端子電極9の折り返し
部9aに形成してもよい。図4及び図5から明らかなよ
うに、電極被り部の内面とセラミック焼結体の外表面と
の間に設けられる限り、空隙の数及び平面形状等につい
ては特に限定されるものではない。
As described above, a plurality of voids 11d to 11h may be formed in the folded portion 9a of the terminal electrode 9, as shown in FIG. As is clear from FIGS. 4 and 5, as long as the gap is provided between the inner surface of the electrode covering portion and the outer surface of the ceramic sintered body, the number of voids and the planar shape are not particularly limited.

【0037】また、上記実施例では、セラミック焼結体
2内に内部電極3〜8が形成された積層コンデンサ1を
示したが、本発明は、複数の内部電極を有する積層バリ
スタや積層サーミスタなどにも適用することができる。
さらに、本発明に係るチップ型セラミック電子部品は、
内部電極を有しないセラミック電子部品にも適用するこ
とができる。すなわち、誘電体セラミックスよりなるセ
ラミック焼結体の両端面に電極被り部を有する第1,第
2の端子電極が形成されたチップ型セラミックコンデン
サや、絶縁性セラミックスの両端面に第1,第2の端子
電極を電極被り部を有するように形成してなるチップ型
セラミック抵抗素子などにも、本発明を適用することが
できる。
In the above embodiment, the multilayer capacitor 1 in which the internal electrodes 3 to 8 are formed in the ceramic sintered body 2 has been described. However, the present invention relates to a multilayer varistor or a multilayer thermistor having a plurality of internal electrodes. Can also be applied.
Further, the chip-type ceramic electronic component according to the present invention,
The present invention can be applied to a ceramic electronic component having no internal electrode. That is, a chip-type ceramic capacitor in which first and second terminal electrodes having electrode covering portions are formed on both end surfaces of a ceramic sintered body made of dielectric ceramic, and first and second terminal electrodes on both end surfaces of an insulating ceramic. The present invention can also be applied to a chip-type ceramic resistance element formed by forming the terminal electrode having an electrode covering portion.

【0038】[0038]

【発明の効果】本発明に係るチップ型セラミック電子部
品では、第1,第2の端子電極の電極被り部の内面とセ
ラミック焼結体外表面との間に空隙が形成されているの
で、該空隙の存在により、端子電極が適度に変形したり
して、電極被り部とセラミック焼結体外表面との間にお
ける応力集中が緩和される。すなわち、プリント回路基
板などに実装された際に、プリント回路基板の熱膨張・
収縮やたわみに起因する応力の被り部への集中が、効果
的に抑制される。従って、外力や温度変化などによりプ
リント回路基板などが伸び縮みしたり、たわんだりした
場合であっても、チップ型セラミック電子部品における
クラックの発生を抑制することができ、チップ型セラミ
ック電子部品のたわみ強度を改善することができ、ひい
てはチップ型セラミック電子部品の信頼性を高めること
が可能となる。
In the chip-type ceramic electronic component according to the present invention, a gap is formed between the inner surface of the electrode covering portion of the first and second terminal electrodes and the outer surface of the ceramic sintered body. , The terminal electrode is appropriately deformed and the stress concentration between the electrode covering portion and the outer surface of the ceramic sintered body is reduced. In other words, when mounted on a printed circuit board, the thermal expansion of the printed circuit board
Concentration of the stress caused by shrinkage or bending on the covered portion is effectively suppressed. Therefore, even when the printed circuit board or the like expands and contracts or bends due to an external force, a temperature change, or the like, it is possible to suppress the occurrence of cracks in the chip-type ceramic electronic component. The strength can be improved, and the reliability of the chip-type ceramic electronic component can be improved.

【0039】また、上記空隙の長さを、空隙が設けられ
ている端子電極の電極被り部の長さの10〜90%の範
囲としたときには、上記クラックの発生をより効果的に
抑制することができると共に、チップ型セラミック電子
部品のプリント回路基板などに対する実装強度の低下も
生じ難い。
Further, when the length of the gap is in the range of 10 to 90% of the length of the electrode covering portion of the terminal electrode provided with the gap, the generation of the crack can be suppressed more effectively. In addition, the mounting strength of the chip-type ceramic electronic component on a printed circuit board or the like does not easily decrease.

【0040】セラミック焼結体内においてセラミック層
を介して重なり合うように複数の内部電極が配置されて
おり、内部電極が第1,第2の端面にそれぞれ引き出さ
れて第1,第2の端子電極に電気的に接続されており、
それによって積層型セラミック電子部品が構成されてい
る場合には、内部電極先端と端子電極の電極被り部内側
端との間で応力集中が生じ易い。ところが、本発明で
は、上記空隙の存在により、応力集中が緩和され、従っ
て、クラックが生じ難く、信頼性に優れた積層型セラミ
ック電子部品を提供することができる。
A plurality of internal electrodes are arranged so as to overlap each other via the ceramic layer in the ceramic sintered body, and the internal electrodes are respectively drawn to the first and second end faces to be connected to the first and second terminal electrodes. Electrically connected,
Thus, when a multilayer ceramic electronic component is configured, stress concentration is likely to occur between the tip of the internal electrode and the inner end of the electrode covering portion of the terminal electrode. However, according to the present invention, the presence of the above-mentioned voids alleviates stress concentration, and therefore, it is possible to provide a multilayer ceramic electronic component which is less likely to crack and has excellent reliability.

【0041】本発明に係るチップ型セラミック電子部品
の製造方法では、セラミック焼結体の第1,第2の端面
近傍において、上面、下面及び両側面の少なくとも1つ
の面に端子電極焼き付け時の熱により飛散する有機材料
ペーストが塗布され、端子電極を形成するために導電ペ
ーストを塗布し、焼き付ける際に、上記有機材料ペース
トが飛散され、空隙が形成される。従って、従来のチッ
プ型セラミック電子部品の製造方法において、上記有機
材料ペーストを塗布する工程を付与するだけで、容易に
本発明に係るチップ型セラミック電子部品を提供するこ
とができる。
In the method for manufacturing a chip-type ceramic electronic component according to the present invention, heat generated when terminal electrodes are baked on at least one of the upper surface, the lower surface, and both side surfaces near the first and second end surfaces of the ceramic sintered body. The organic material paste is scattered, and the conductive paste is applied to form a terminal electrode. When the conductive paste is applied and baked, the organic material paste is scattered to form voids. Therefore, the chip-type ceramic electronic component according to the present invention can be easily provided only by adding the step of applying the organic material paste in the conventional method of manufacturing the chip-type ceramic electronic component.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の一実施例に係るチップ型セラミック電
子部品としての積層コンデンサを示す縦断面図。
FIG. 1 is a longitudinal sectional view showing a multilayer capacitor as a chip-type ceramic electronic component according to one embodiment of the present invention.

【図2】図1に示した実施例の積層コンデンサを得るに
あたり、セラミック焼結体外表面に有機材料ペーストを
塗布した状態を示す斜視図。
FIG. 2 is a perspective view showing a state in which an organic material paste is applied to the outer surface of the ceramic sintered body in obtaining the multilayer capacitor of the embodiment shown in FIG.

【図3】図1に示した実施例の積層コンデンサの外観を
示す斜視図。
FIG. 3 is a perspective view showing the appearance of the multilayer capacitor of the embodiment shown in FIG. 1;

【図4】空隙の変形例を説明するための積層コンデンサ
の部分切欠縦断面図。
FIG. 4 is a partially cutaway longitudinal sectional view of a multilayer capacitor for explaining a modification of a gap.

【図5】(a)及び(b)は、それぞれ、空隙の他の変
形例を説明するための図であり、(a)は有機材料ペー
ストが塗布されたセラミック焼結体を示す斜視図、
(b)は得られた積層コンデンサの部分切欠平面図。
FIGS. 5A and 5B are diagrams for explaining other modified examples of the air gap, and FIG. 5A is a perspective view showing a ceramic sintered body to which an organic material paste is applied;
(B) is a partially cutaway plan view of the obtained multilayer capacitor.

【図6】従来の積層コンデンサを示す縦断面図。FIG. 6 is a longitudinal sectional view showing a conventional multilayer capacitor.

【符号の説明】[Explanation of symbols]

1…積層コンデンサ 2…セラミック焼結体 2a,2b…第1,第2の端面 2c…上面 2d…下面 2e…側面 3〜8…内部電極 9,10…第1,第2の端子電極 9a,10a…電極被り部 9a1 ,10a1 …内側端 11,12…空隙 11a〜11c…空隙 11d〜11h…空隙 13,14…有機材料ペースト 13a〜13f,14a〜14f…有機材料ペーストDESCRIPTION OF SYMBOLS 1 ... Multilayer capacitor 2 ... Ceramic sintered body 2a, 2b ... 1st, 2nd end surface 2c ... Upper surface 2d ... Lower surface 2e ... Side surface 3-8 ... Internal electrode 9, 10 ... 1st, 2nd terminal electrode 9a, 10a ... electrode suffered portion 9a 1, 10a 1 ... inner end 11, 12 ... gap 11 a to 11 c ... gap 11d to 11h ... gap 13 ... organic material paste 13a to 13f, 14a to 14f ... organic material paste

Claims (4)

【特許請求の範囲】[Claims] 【請求項1】 対向し合う第1,第2の端面を有するセ
ラミック焼結体と、 前記セラミック焼結体の第1,第2の端面を覆い、上
面、下面及び両側面に至る電極被り部を有する第1,第
2の端子電極とを備え、 前記第1,第2の端子電極の電極被り部の内面とセラミ
ック焼結体の外表面との間に空隙が形成されていること
を特徴とする、チップ型セラミック電子部品。
1. A ceramic sintered body having first and second end faces facing each other, and an electrode covering part covering the first and second end faces of the ceramic sintered body and reaching to an upper surface, a lower surface, and both side surfaces. And a first and a second terminal electrode having: a gap formed between an inner surface of the electrode covering portion of the first and second terminal electrodes and an outer surface of the ceramic sintered body. Chip-type ceramic electronic components.
【請求項2】 前記第1,第2の端面を結ぶ方向を長さ
方向とした場合に、前記空隙の長さが、空隙が設けられ
ている端子電極の電極被り部の長さの10〜90%の範
囲とされていることを特徴とする、請求項1に記載のチ
ップ型セラミック電子部品。
2. When the direction connecting the first and second end faces is a length direction, the length of the gap is 10 to 10 of the length of the electrode covering portion of the terminal electrode provided with the gap. The chip-type ceramic electronic component according to claim 1, wherein the range is 90%.
【請求項3】 前記セラミック焼結体内においてセラミ
ック層を介して重なり合うように配置された複数の内部
電極をさらに備え、 前記内部電極が、セラミック焼結体の第1または第2の
端面に引き出されて第1または第2の端子電極に電気的
に接続されており、それによって積層型セラミック電子
部品が構成されている、請求項1または2に記載のチッ
プ型セラミック電子部品。
3. The device according to claim 1, further comprising a plurality of internal electrodes arranged so as to overlap each other via a ceramic layer in the ceramic sintered body, wherein the internal electrodes are drawn out to a first or second end face of the ceramic sintered body. The chip-type ceramic electronic component according to claim 1, wherein the chip-type ceramic electronic component is electrically connected to the first or second terminal electrode to form a multilayer ceramic electronic component.
【請求項4】 対向し合う第1,第2の端面を有するセ
ラミック焼結体を用意する工程と、 前記セラミック焼結体の第1,第2の端面近傍におい
て、セラミック焼結体の上面、下面及び両側面の少なく
とも1つの面に端子電極焼付け時の熱により飛散する有
機材料ペーストを塗布する工程と、 前記セラミック焼結体の第1,第2の端面及び第1,第
2の端面から上面、下面及び両側面に至るように、かつ
前記有機材料ペースト層を被覆するように導電ペースト
を塗布する工程と、 前記導電ペーストを焼き付けて、第1,第2の端子電極
を形成すると共に、該焼付けに際し前記有機材料ペース
トを飛散させて空隙を形成する工程とを備えることを特
徴とする、チップ型セラミック電子部品の製造方法。
4. A step of preparing a ceramic sintered body having first and second end faces facing each other, and an upper surface of the ceramic sintered body near the first and second end faces of the ceramic sintered body. A step of applying an organic material paste scattered by heat at the time of baking the terminal electrode to at least one of the lower surface and both side surfaces, and from the first, second, and first and second end surfaces of the ceramic sintered body. A step of applying a conductive paste so as to reach the upper surface, the lower surface and both side surfaces, and to cover the organic material paste layer; and baking the conductive paste to form first and second terminal electrodes, Forming a void by scattering the organic material paste at the time of baking.
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